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高速數(shù)傳中定時同步設計與FPGA實現(xiàn)
- 摘要 文中對適用于高速突發(fā)通信的基于數(shù)字濾波平方的定時同步算法進行了研究。通過對在高速數(shù)據(jù)傳輸通信中,該定時同步環(huán)路的定時誤差估計模塊進行并行結構實現(xiàn),大幅降低了系統(tǒng)對于時鐘的要求,且更加易于實現(xiàn);將文
- 關鍵字: 高速突發(fā)通信 定時同步 定時控制 Field Programmable Gate Array
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