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結(jié)合超寬帶測距和雷達(dá)功能以實現(xiàn)高級IoT應(yīng)用 11.14珠海｜與泰克共探半導(dǎo)體產(chǎn)業(yè)鏈來這里瞧瞧NXP技術(shù)培訓(xùn)視頻吧>> 來學(xué)習(xí)NXP基于i.MX處理器的工業(yè)解決方案吧！

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fbs-pld 文章進(jìn)入fbs-pld技術(shù)社區(qū)

PLD在顯示、汽車及便攜產(chǎn)品中開拓新應(yīng)用

通過技術(shù)上的不斷創(chuàng)新，F(xiàn)PGA（現(xiàn)場可編程門陣列）及CPLD（復(fù)雜可編程邏輯器件）產(chǎn)品正趨向更低功耗、更低成本和更高性...
關(guān)鍵字： PLD 顯示汽車便攜產(chǎn)品

基于Matlab/Simulink的滑模軟起動器仿真研究

摘要：隨著電動機(jī)的廣泛使用，對電機(jī)起動的要求越來越高，對軟起動裝置也使用越來越多?；＼浧饎悠鲙追N軟起動方...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

汽車信息娛樂應(yīng)用中PLD管理圖像數(shù)據(jù)

　信息娛樂系統(tǒng)能在幫助司機(jī)安全前往目的地的同時娛樂乘客，而且這已不再是高檔車輛的專利：現(xiàn)在新興的汽車輔助駕駛系統(tǒng)正進(jìn)入主流市場。前面的液晶顯示器需要動態(tài)地從GPS顯示器切換到許多攝相機(jī)中的一個，甚至是由車
關(guān)鍵字： PLD 汽車信息娛樂圖像數(shù)據(jù)

基于PLD的嵌入式系統(tǒng)外存模塊設(shè)計

基于PLD的嵌入式系統(tǒng)外存模塊設(shè)計,摘要：以MCS-96系列單片機(jī)為例，介紹了一種采用可編程邏輯器件(PLD)的存儲器模塊的設(shè)計方案，該模塊包含了Flash閃存和RAM。提出了一種方便的存儲器擴(kuò)展方法，該方法有效地解決了嵌入式系統(tǒng)尤其是數(shù)據(jù)采集、存儲等系統(tǒng)
關(guān)鍵字：模塊設(shè)計系統(tǒng) 嵌入式 PLD 基于

PLD/FPGA硬件語言設(shè)計verilog HDL

PLD/FPGA硬件語言設(shè)計verilog HDL,HDL概述　　隨著EDA技術(shù)的發(fā)展，使用硬件語言設(shè)計PLD/FPGA成為一種趨勢。目前最主要的硬件描述語言是VHDL和verilog HDL及System Verilog。 VHDL發(fā)展的較早，語法嚴(yán)格;而Verilog HDL是在C語言的基礎(chǔ)上發(fā)展起來的一種硬
關(guān)鍵字： verilog HDL 設(shè)計語言硬件 PLD/FPGA

FPGA基礎(chǔ)入門（二）

很多兄弟對于CPLD下JTAG的下載很熟悉了,可轉(zhuǎn)到FPGA來的時候,多多少少有些迷惑,怎么出現(xiàn)配置芯片了,為什么...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于CPLD設(shè)計的電器定時開關(guān)控制系統(tǒng)

1前言隨著當(dāng)今社會工作和生活節(jié)奏的加快，人們對許多電器、儀器、設(shè)備的自動化要求也越來越高，但現(xiàn)有...
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利用CPLD來替代微控制器的6種方法

引言如果告訴便攜式電子設(shè)計人員有一種低功耗數(shù)字器件能使他們利用軟件程序來重新配置硬件工作，他們中的十個...
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我學(xué)習(xí)FPGA的總結(jié)

閱讀本文的人群：熟悉數(shù)字電路基本知識（如加法器、計數(shù)器、RAM等），熟悉基本的同步電路設(shè)計方法，熟悉HDL語言，對FPGA...
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verilog中阻塞賦值和非阻塞復(fù)制的理解

阻塞和非阻塞語句作為verilogHDL語言的最大難點之一，一直困擾著FPGA設(shè)計者，即使是一個頗富經(jīng)驗的設(shè)計工程師，...
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選擇VHDL或者verilog HDL還是System Verilog？

硬件描述語言HDL（HardwareDescribeLanguage）HDL概述隨著EDA技術(shù)的發(fā)展，使用硬件語言設(shè)計PLD/FPGA成為一...
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系統(tǒng)級芯片設(shè)計語言和驗證語言的發(fā)展

作者：韓俊剛時間：2006-02-1117:08:15來自：西安郵電學(xué)院ASIC設(shè)計中心簡介：由于微電子技術(shù)的迅速發(fā)...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

FPGA設(shè)計中關(guān)鍵問題的研究

隨著FPGA(FieldProgrammableGateArray)容量、功能以及可靠性的提高，其在現(xiàn)代數(shù)字通信系統(tǒng)中的應(yīng)用日漸廣...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

讓Verilog仿真狀態(tài)機(jī)時可以顯示狀態(tài)名

Situation:我們平時使用Verilog進(jìn)行狀態(tài)機(jī)編碼時，通常使用parameter對狀態(tài)名進(jìn)行定義，這樣寫Case語句的時候...
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基于Nios的DDS高精度信號源實現(xiàn)

摘要：直接數(shù)字頻率合成器DDS具有極高的分辨率、頻率轉(zhuǎn)換速度快、相位噪聲低等優(yōu)點。以ALTERA公司的CPU軟核Ni...
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基于CPLD的FPGA從并快速加載方案
基于CPLD的系統(tǒng)硬件看門狗設(shè)計
基于DSP+CPLD的伺服控制卡的設(shè)計
分布式PLD解決方案可降低服務(wù)器成本并提升靈活性

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MachXO3StarterKitUsersGuideEB95.pdf
20150603102240239.pdf
基于可編程邏輯器件PLD的數(shù)字電路設(shè)計方案
Design @Machxo2 speed
【應(yīng)用筆記】使用Altera的PLD實現(xiàn)多協(xié)議標(biāo)簽切換(Implementing Multiprotocol Label Switching with Altera PLDs)
【應(yīng)用筆記】使用Altera的高密度BGA封裝器件進(jìn)行設(shè)計(Designing With High-Density BGA Packages for Altera Devices)
【應(yīng)用筆記】AN307:Xilinx用戶的Altera設(shè)計流程(AN 307: Altera Design Flow for Xilinx Users)
【應(yīng)用筆記】一種PLD JTAG配置的嵌入式解決方案—JRunner驅(qū)動軟件(The JRunner Software Driver:An Embedded Solution for PLD JTAG Configuration)

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