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為什么嵌入式開發(fā)人員要使用FPGA？
- 在一個領(lǐng)域中，如果唯一不變的是變化，那么不需要對電子技術(shù)和設(shè)計方法的發(fā)展變化做多少回顧，就能見證到變化是如何使設(shè)計工程師能夠創(chuàng)建出下一代創(chuàng)新產(chǎn)品。微處理器得到大規(guī)模應(yīng)用后，價廉物美的新技術(shù)為基于軟件的革新性電子產(chǎn)品設(shè)計打開了大門，這就是一個很好的例子。簡言之，把設(shè)計的主要元素——在這兒是控制“智能”——轉(zhuǎn)入到軟領(lǐng)域后，設(shè)計工程師就可以在更短時間內(nèi)創(chuàng)建出更好、更智能、更廉價的產(chǎn)品。 這個變化意味著嵌入式軟件開發(fā)人員是當今定義電
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FPGA如何改變改變嵌入設(shè)計格局？
- 由于經(jīng)濟下滑損及開發(fā)預(yù)算減少，嵌入系統(tǒng)設(shè)計者正在轉(zhuǎn)向FPGA（現(xiàn)場可編程門陣列）技術(shù)，以縮減開發(fā)周期、對抗設(shè)備老化以及簡化產(chǎn)品升級。通過采用數(shù)量龐大且不斷增加的FPGA開發(fā)工具、可重用邏輯單元以及市售商用模塊，設(shè)計者可以構(gòu)思出高性能嵌入系統(tǒng)，并且能夠根據(jù)需求變化作重新配置，從而盡量減少對工程和制造的影響。過去，電路板設(shè)計者使用這些器件作系統(tǒng)元件之間的互連，但最新的高密度產(chǎn)品也可以替代一個典型嵌入項目中的處理器、內(nèi)存、定制邏輯及很多外設(shè)。盡管它有能力改變嵌入架構(gòu)，設(shè)計者仍應(yīng)分析性能、功率和成本局限，以確
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三星與海力士提升NAND Flash芯片產(chǎn)量
- 據(jù)了解，由于智能型手機(Smartphone)和平板計算機(Tablet PC)需求暴增，三星電子(Samsung Electronics)和海力士(Hynix) 2011年雙雙提升NAND Flash芯片產(chǎn)量。
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Altera MIPS聯(lián)手SLS發(fā)布業(yè)界首款FPGA軟核處理器
- 近日Altera公司、MIPS科技公司以及System Level Solutions (SLS) 公司聯(lián)合推出了MIPS-Based?、FPGA優(yōu)化軟核處理器，適用于Altera FPGA以及ASIC器件。MP32處理器是MIPS?兼容應(yīng)用類處理器，繼承了業(yè)界規(guī)模最大的軟件開發(fā)工具以及操作系統(tǒng)支持生態(tài)系統(tǒng)。MP32處理器是業(yè)界第一款基于FPGA的軟核處理器，由Wind River公司的VxWorks RTOS和MIPS Navigator ICS軟件開發(fā)套裝提供支持。
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FAE講堂：提升創(chuàng)造力的數(shù)字設(shè)計工具 FPGA Editor
- 工程師在設(shè)計過程中，經(jīng)常需要一定的創(chuàng)造力(你不妨稱之為數(shù)字管道膠帶)才能夠保證設(shè)計的順利完成。過去8年時間里，我曾經(jīng)目睹許多優(yōu)秀工程師利用這一方法出色地完成了許多工作，而他們采用的最主要工具就是 FPGA Editor。 利用FPGA Editor，你可以察看完成的設(shè)計并確定是否在FPGA構(gòu)造一級真正實現(xiàn)了設(shè)計意圖 – 而這對于任何工程師或現(xiàn)場應(yīng)用工程師來說都是非常需要的。假設(shè)你拿到協(xié)作者的設(shè)計，需要對其進行修改，但他們的 HDL源代碼非常難于理解，或者根本沒有任何注釋或文檔。也許你
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TMS320F2812片內(nèi)Flash在線燒寫技術(shù)
- TMS320F2812(以下簡稱F2812)是美國德州儀器公司(TI)新一代32位定點數(shù)字信號處理器(DSP)，主要應(yīng)用于逆變器控制、電機控制等領(lǐng)域，并擁有工作頻率高達150 MHz的32位DSP內(nèi)核處理器，可以高效可靠地實現(xiàn)自適應(yīng)控制和狀
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基于ARM和FPGA的線陣CCD測徑系統(tǒng)的設(shè)計
- 近幾年來，電線、電纜、光纖等產(chǎn)品的需求量大大增加，外徑尺寸的質(zhì)量控制成為許多生產(chǎn)廠家急需解決的問題。傳統(tǒng) ...
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優(yōu)化FIR數(shù)字濾波器的FPGA實現(xiàn)
- 摘要：基于提高速度和減少面積的理念，對傳統(tǒng)的FIR數(shù)字濾波器進行改良。考慮到FPGA的實現(xiàn)特點，研究并設(shè)計了采用Radix-2的Booth算法乘法器以及結(jié)合了CSA加法器和樹型結(jié)構(gòu)的快速加法器，并成功應(yīng)用于FIR數(shù)字濾波器的設(shè)
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在賽靈思FPGA設(shè)計中保留可重復(fù)結(jié)果
- 滿足設(shè)計的時序要求本身已非易事，而要實現(xiàn)某項設(shè)計的整體時序具有完全可重復(fù)性有時候卻是不可能的任務(wù)。幸運的是，設(shè)計人員可以借助有助于實現(xiàn)可重復(fù)時序結(jié)果的設(shè)計流程概念。影響最大的四個方面分別是 HDL 設(shè)計實踐、綜合優(yōu)化、平面布局和實施方案。 就獲得可重復(fù)結(jié)果而言，資源利用和頻率要求都很高的設(shè)計是最大的挑戰(zhàn)。它們也是可重復(fù)結(jié)果流程需求最高的設(shè)計。得到可重復(fù)結(jié)果的第一步是在 HDL設(shè)計階段運用設(shè)計合理的實踐。遵循出色的分層邊界實踐有助于保持邏輯整體性，而這在設(shè)計變更時有助于保持可重復(fù)結(jié)果。一條不錯的規(guī)
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基于賽靈思Virtex-5 FPGA的LTE仿真器實現(xiàn)
- 功能強大的可編程邏輯平臺使得Prisma Engineering公司能夠針對所有蜂窩網(wǎng)絡(luò)提供可重配置無線測試設(shè)備。長期演進(LTE)是移動寬帶的最3GPP標準，它打破了現(xiàn)有蜂窩網(wǎng)絡(luò)的固有模式。LTE與前代UMTS和GSM標準相比，除采用高頻譜效率的射頻技術(shù)外，其架構(gòu)還得到了大幅簡化。LTE系統(tǒng)的無線接入部分Node-B，是連接無線電和整個互聯(lián)網(wǎng)協(xié)議核心網(wǎng)絡(luò)之間的邊緣設(shè)備。這種架構(gòu)無法監(jiān)測和測試等效于UMTS中間鏈路上的元件。必須通過無線電接口，才能有效地測試LTE網(wǎng)絡(luò)元件。 這正是Prisma
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