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fpga 文章進入fpga 技術(shù)社區(qū)

基于FPGA 的偽隨機序列的生成方法及應(yīng)用

摘要：通過分析各種偽隨機序列生成方法，提出了一種基于M 序列的連續(xù)抽樣方法，可以生成滿足自適應(yīng)光學(xué)系統(tǒng)SPGD 控制算法要求的多路、相互獨立以及服從伯努利分布的偽隨機序列。該方法適合于用FPGA 等超大規(guī)模集成
關(guān)鍵字： FPGA 偽隨機序列方法

基于FPGA的DDS基本信號發(fā)生器的設(shè)計

摘要：本設(shè)計基于DDS原理和FPGA技術(shù)按照順序存儲方式，將對正弦波、方波、三角波、鋸齒波四種波形的取樣數(shù)據(jù)依次全部存儲在ROM波形表里，通過外接設(shè)備撥扭開關(guān)和鍵盤控制所需波形信號的輸出，最終將波形信息顯示在LC
關(guān)鍵字： FPGA DDS 信號發(fā)生器

基于FPGA的TCP／IP通信協(xié)議與Matlab通信系統(tǒng)的研究

O 引言　　近年來，隨著信息技術(shù)的發(fā)展，網(wǎng)絡(luò)化日加普遍，以太網(wǎng)被廣泛應(yīng)用到各個領(lǐng)域。例如在數(shù)據(jù)采集領(lǐng)域，一些小型監(jiān)測設(shè)備需要增加網(wǎng)絡(luò)實現(xiàn)遠程數(shù)據(jù)傳輸?shù)墓δ?，只要那些設(shè)備上增加一個網(wǎng)絡(luò)接口并實現(xiàn)了TCP／IP協(xié)
關(guān)鍵字：通信 Matlab 系統(tǒng) 研究協(xié)議基于 TCP IP FPGA

便攜式測試設(shè)備的FPGA設(shè)計

過去，TMOEM設(shè)計的儀器都是根據(jù)某種標準完成測試過程。這樣，當(dāng)一個新的標準或修訂后的標準發(fā)布出來時，他...
關(guān)鍵字：便攜式測試設(shè)備 FPGA

FPGA在廣播視頻中的應(yīng)用

FPGA在廣播視頻中的應(yīng)用, 1.時機

在世界范圍內(nèi)，廣播視頻系統(tǒng)的需求都在逐年顯著增加，原因是以下的一些因素同時發(fā)生了作用：

可供觀眾選擇的廣播頻道的增加。世界范圍內(nèi)，更多觀眾的選擇從很少的幾個頻道發(fā)展到幾百個頻道。
關(guān)鍵字：應(yīng)用視頻廣播 FPGA

簡化UART功能的FPGA實現(xiàn)

1　引　言在ARM＋FPGA系統(tǒng)結(jié)構(gòu)中，實現(xiàn)基于ARM的嵌入式處理器和FPGA之間通信最簡單的方法就是通過異步串行接口EIARS232C?？紤]選用集成有UART(Universal Asynchronous Receiver / TraNSmitter )控制器的嵌入式處理器
關(guān)鍵字： UART FPGA

如何有效的管理FPGA設(shè)計中的時序問題

如何有效的管理FPGA設(shè)計中的時序問題,　當(dāng)
　　　　二、導(dǎo)言　　FPGA的設(shè)計與高速接口技術(shù)可以幫助你滿足今天的市場要求，但也提出了一些有趣的設(shè)計挑戰(zhàn)。為了確保存儲器接口的數(shù)據(jù)傳輸準確，在超過200兆赫茲以上，進行時序分析將發(fā)揮更突出的作用，以
關(guān)鍵字：時序問題設(shè)計 FPGA 有效管理如何

基于FPGA的星載計算機自檢EDAC電路設(shè)計

摘要：為了消除空間環(huán)境中單粒子翻轉(zhuǎn)(SEU)的影響,目前星載計算機中均對RAM存儲單元采用檢錯糾錯(EDAC)設(shè)計。隨著FPGA在航天領(lǐng)域的廣泛應(yīng)用,FPGA已成為EDAC功能實現(xiàn)的最佳硬件手段。本文介紹了EDAC的編碼和實現(xiàn),提出一
關(guān)鍵字： FPGA EDAC 星載計算機

基于FPGA 的UART 擴展總線設(shè)計和應(yīng)用

摘要：現(xiàn)在嵌入式系統(tǒng)的功能越來越集合化,需要控制大量外設(shè)。外設(shè)模塊普遍采用UART作為通信接口,但是通常處理器都會自帶一個UART串口。實際應(yīng)用中一個串口往往不夠用,需要對系統(tǒng)進行擴展。本文所介紹的就是以FPGA為實
關(guān)鍵字： FPGA UART 總線設(shè)計

基于FPGA的水聲信號采樣存儲系統(tǒng)設(shè)計

摘要：為了提高水聲傳感器網(wǎng)絡(luò)通信系統(tǒng)試驗和算法研究的效率，水聲傳感器網(wǎng)絡(luò)節(jié)點需要具有水聲通信的原始波形數(shù)據(jù)的記錄功能。本文設(shè)計了一種水聲信號采樣存儲系統(tǒng)，實現(xiàn)了數(shù)據(jù)變速率AD采集、數(shù)據(jù)環(huán)形存儲、數(shù)據(jù)連續(xù)
關(guān)鍵字： FPGA 水聲信號采樣存儲

基于FPGA的高精度時差測量系統(tǒng)設(shè)計

摘要：在時差定位(TDOA)技術(shù)中，高精度的時差測量是準確定位的關(guān)鍵。針對這一需要，提出一種基于FPGA 的高精度時差測量系統(tǒng)的實現(xiàn)方案。本系統(tǒng)的時差測算單元以Altera 公司Cyclone 系列的EP1C3T144 芯片為核心，并提
關(guān)鍵字： FPGA 高精度時差測量系統(tǒng)設(shè)計

基于FPGA的軟件無線電平臺設(shè)計

0 引言軟件無線電的出現(xiàn)，是無線電通信從模擬到數(shù)字、從固定到移動后，由硬件到軟件的第三次變革。簡單地說，軟件無線電就是一種基于通用硬件平臺，并通過軟件可提供多種服務(wù)的、適應(yīng)多種標準的、多頻帶多模式的、可
關(guān)鍵字： FPGA 軟件無線電平臺設(shè)計

基于EDA 技術(shù)（FPGA）的自動門控制系統(tǒng)設(shè)計

引言門和人類文明是孿生的，它伴隨著人類文明的發(fā)展而躍動。21 世紀的今天，門更加突出了安全理念，強調(diào)了有效性：有效地防范、通行、疏散，同時還突出了建筑藝術(shù)的理念，強調(diào)門與建筑以及周圍環(huán)境整體的協(xié)調(diào)、和諧
關(guān)鍵字： FPGA EDA 自動門控制系統(tǒng)設(shè)計

基于FPGA核心的數(shù)字化儀模塊設(shè)計

PXI總線是NI公司在計算機外設(shè)總線PCI的基礎(chǔ)上實現(xiàn)的新一代儀器總線，已經(jīng)成為業(yè)界開放式總線的標準，基于PXI總線的數(shù)字化儀模塊是現(xiàn)代測試系統(tǒng)中重要的一種數(shù)據(jù)記錄與處理設(shè)備。設(shè)計一個雙通道12 bit/250 MHz采樣頻
關(guān)鍵字： FPGA 核心數(shù)字化儀模塊設(shè)計

Altera通過早期使用計劃，讓客戶提前了解面向FPGA的OpenCL效能優(yōu)勢

　　Altera公司(NASDAQ: ALTR)今天發(fā)布其面向FPGA的OpenCL (開放計算語言)早期使用計劃(EAP)，支持客戶提前了解Altera面向FPGA的OpenCL解決方案。采用這一開放標準，設(shè)計團隊可以在高級C語言框架中面向FPGA設(shè)計他們自己的系統(tǒng)和算法，大大簡化了FPGA的開發(fā)。作為EAP計劃的一部分，客戶能夠預(yù)先了解Altera的OpenCL解決方案，參加面向FPGA的OpenCL培訓(xùn)課程，獲得相關(guān)資料，觀看其技術(shù)演示。　　OpenCL是一種開放編程標準，能夠跨CPU、GPU和
關(guān)鍵字： Altera FPGA OpenCL

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fpga 介紹

FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。 FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個新概念，內(nèi)部包括可 [ 查看詳細 ]

fpga 電路

利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設(shè)計的方法
基于FPGA的機載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠程監(jiān)控器設(shè)計與實現(xiàn)
基于FPGA的LCD顯示遠程更新

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