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基于單片機(jī)與FPGA可調(diào)延時模塊的設(shè)計(jì)
- 系統(tǒng)結(jié)構(gòu)框圖如圖1。其硬件結(jié)構(gòu)比較簡單,主要由單片機(jī)P89C51RD、RS-232/TTL接口電路MAX232和可編程邏輯器件FPGA三部分組成。單片機(jī)P89C51RD2是上位PC機(jī)和FPGA的連接紐帶,它通過并口發(fā)送數(shù)據(jù)給FPGA,另一邊通過RS-2
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一種基于FPGA的UART 電路實(shí)現(xiàn)
- 1 引 言 UART 即通用異步收發(fā)器,他廣泛使用串行數(shù)據(jù)傳輸協(xié)議。UART 功能包括微處理器接口、用于數(shù)據(jù)傳輸?shù)木彌_器(Buffer)、幀產(chǎn)生、奇偶校驗(yàn)、并串轉(zhuǎn)換,用于數(shù)據(jù)接收的緩沖器、幀產(chǎn)生、奇偶校驗(yàn)、串并轉(zhuǎn)換等。
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基于FPGA的LVDS高速數(shù)據(jù)通信卡設(shè)計(jì)
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- 摘要 基于FPGA、PCI9054、SDRAM和DDS設(shè)計(jì)了用于某遙測信號模擬源的專用板卡。PCI9054實(shí)現(xiàn)與上位機(jī)的數(shù)據(jù)交互,F(xiàn)PGA實(shí)現(xiàn)PCI本地接口轉(zhuǎn)換、數(shù)據(jù)接收發(fā)送控制及DDS芯片的配置。通過WDM驅(qū)動程序設(shè)計(jì)及MFC交互界面設(shè)計(jì),最
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FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì)
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- FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì),隨著可編程邏輯器件的不斷進(jìn)步和發(fā)展,F(xiàn)PGA在嵌入式系統(tǒng)中發(fā)揮著越來越重要的作用。本文介紹的在電能質(zhì)量監(jiān)測系統(tǒng)中信號采集模塊控制器的 IP核,是采用硬件描述語言來實(shí)現(xiàn)的。首先它是以ADS8364芯片為控制對象,結(jié)合
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fpga 介紹
FPGA是英文Field-Programmable Gate Array的縮寫,即現(xiàn)場可編程門陣列,它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
FPGA采用了邏輯單元陣列LCA(Logic Cell Array)這樣一個新概念,內(nèi)部包括可 [ 查看詳細(xì) ]
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