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PLD/FPGA新手入門
- PLD是可編程邏輯器件（Programable Logic Device）的簡稱，F(xiàn)PGA是現(xiàn)場可編程門陣列（Field Programable Gate Array)的簡稱，兩者的功能基本相同，只是實現(xiàn)原理略有不同，所以我們有時可以忽略這兩者的區(qū)別，統(tǒng)稱為可編程邏輯器件或PLD/FPGA。 PLD是電子設計領域中最具活力和發(fā)展前途的一項技術，它的影響絲毫不亞于70年代單片機的發(fā)明和使用。 PLD能做什么呢？可以毫不夸張的講，PLD能完成任何數(shù)字器件的功能，上至高性能CPU,下至簡單的74
- 關鍵字： PLD FPGA 入門
ADS8344和FPGA的高精度數(shù)據(jù)采集前端
- 數(shù)據(jù)采集在工業(yè)測試系統(tǒng)中是一個很重要的環(huán)節(jié)，其精確性和可靠性是至關重要的。本文闡述的數(shù)據(jù)采集系統(tǒng)精度高達16位，能夠?qū)?個外部模擬通道進行A/D采樣，最大模擬輸入信號范圍達到-15～+15V。該系統(tǒng)具有限幅保護功能，程序編寫簡便，能夠?qū)崿F(xiàn)對遠端數(shù)據(jù)的采集和傳輸。 1 系統(tǒng)硬件設計 數(shù)據(jù)采集系統(tǒng)框圖如圖1所示。 ? 圖中，A/D轉(zhuǎn)換器采用了TI公司的16位逐次逼近型ADS8344;FPGA主要用于控制ADC的啟動、停止和查詢ADC狀態(tài)等，同時對數(shù)據(jù)進行高速數(shù)據(jù)緩
- 關鍵字： ADS8344 FPGA 數(shù)據(jù)采集
基于FPGA和DSP的高速瞬態(tài)信號檢測系統(tǒng)
- 引 言 目前國內(nèi)急需一種能夠?qū)﹄娀鸸て返陌l(fā)火過程進行實時無損耗監(jiān)測的方法和手段，并根據(jù)監(jiān)測結(jié)果對火工品的可靠性進行準確的判決和認證，解決科研和生產(chǎn)過程中的具體問題。本系統(tǒng)采用感應式線圈作為非接觸式啟爆電流的啟爆裝置，并采用高速A/D、FPGA、DSP等先進的集成電路實現(xiàn)了電火工品的無損耗檢測。其主要目的是：第一，解決電火工品可靠性試驗中微秒級瞬態(tài)信號的檢測、處理和存儲技術;第二，為可靠性試驗提供一種在線的無損耗實時檢測系統(tǒng)，以便對電火工品的發(fā)火全過程進行監(jiān)測;第三，為電火工品的發(fā)火可靠性認證和評
- 關鍵字： FPGA DSP A/D
使用VHDL語言設計FPGA的幾個常見問題的探討
- ?????? 詳細討論了在MAX plusⅡ開發(fā)平臺下使用VHDL硬件描述語言設計現(xiàn)場可編程門陣列(FP-GA)時常見的三個問題：等占空比分頻電路、延時任意量的延時電路、雙向電路。 ????? 1 引言 ??? ?????? 隨著EDA技術的發(fā)展，使用硬件語言設計可編程邏輯器件(PLD)/現(xiàn)場可編程門陣
- 關鍵字： VHDL FPGA 問題
基于FPGA的鎖相環(huán)位同步提取電路設計
- 概述 同步是通信系統(tǒng)中一個重要的問題。在數(shù)字通信中，除了獲取相干載波的載波同步外，位同步的提取是更為重要的一個環(huán)節(jié)。因為只有確定了每一個碼元的起始時刻，才能對數(shù)字信息作出正確的判決。利用全數(shù)字鎖相環(huán)可直接從接收到的單極性不歸零碼中提取位同步信號。 一般的位同步電路大多采用標準邏輯器件按傳統(tǒng)數(shù)字系統(tǒng)設計方法構成，具有功耗大，可靠性低的缺點。用FPGA設計電路具有很高的靈活性和可靠性，可以提高集成度和設計速度，增強系統(tǒng)的整體性能。本文給出了一種基于fpga的數(shù)字鎖相環(huán)位同步提取電路。 數(shù)
- 關鍵字： FPGA 鎖相環(huán) 分頻器
PLD公司三極化形成
- 可編程邏輯器件（PLD）在與ASIC之激戰(zhàn)中已經(jīng)告捷：每年開始PLD設計的項目數(shù)目遠遠高于ASIC項目開工數(shù)。同時，PLD廠家之間也發(fā)生微妙的變化，由崛起時的爭強好斗和互不相讓，漸漸找到了各自的落腳點。目前看來，Xilinx的產(chǎn)品穩(wěn)居65nm FPGA市場，Altera最大的量產(chǎn)在90nm FPGA，Actel憑低功耗0.13微米FPGA在對功耗要求苛刻的領域站穩(wěn)了腳跟。昔日的兩個龐然大物——Xilinx和Altera之間拉開了距離，同時小型FPGA廠商如Actel躍躍欲試，漸漸跳
- 關鍵字： PLD FPGA ASIC
Xilinx屢獲殊榮的65nm Virtex-5系列新增三款器件
- 賽靈思公司宣布為其屢獲殊榮的65nm Virtex?-5 LX 和 LXT FPGA平臺增加三款新型小尺寸封裝器件，以滿足新興市場對可編程邏輯器件成本和密度的要求。其中邏輯優(yōu)化的LX平臺增加了Virtex-5 LX155器件，Virtex-5 LXT平臺則增加了LX20T以及LX155T器件，外加帶有低功率收發(fā)器的小尺寸 19mm FF323封裝。這些新增器件將支持工業(yè)網(wǎng)絡、醫(yī)療影像、馬達控制、國防和高性能計算應用等領域 實現(xiàn)更高水平的成本優(yōu)化。 “由于Virtex-5系
- 關鍵字： 賽靈思 FPGA 可編程邏輯器件
Altera的Stratix II GX FPGA提供50-Gbps SFI-5接口
- Altera公司宣布，帶有嵌入式收發(fā)器的Stratix? II GX FPGA支持SERDES成幀器接口Level 5 (SFI-5)標準，為高性能光通信應用提供40至50-Gbps接口。SFI-5規(guī)范是芯片至芯片標準，保證了前向糾錯(FEC)技術、成幀器以及業(yè)界最佳光轉(zhuǎn)發(fā)器之間的通用性。硬件測試驗證了Stratix II GX FPGA符合SFI-5標準，其20個高速串行收發(fā)器通道的數(shù)據(jù)速率在600 Mbps至6.375 Gbps之間，很容易滿足SFI-5接口要求。 SFI-5光互聯(lián)論
- 關鍵字： Altera FPGA 芯片
Actel的 ProASIC3L系列實現(xiàn)低功耗高速度和低成本之間的平衡
- Actel公司進一步擴展其業(yè)界領先的低功耗可編程解決方案組合，面向高性能及對功耗敏感的系統(tǒng)設計人員推出ProASIC3L系列現(xiàn)場可編程門陣列 (FPGA)。相比前一代ProASIC3 FPGA，新推出的以 Flash為基礎的FPGA系列可以在高達350MHz的工作頻率下大幅降低功耗，能分別對動態(tài)和靜態(tài)功耗降低達40% 和 90%，從而為工業(yè)、醫(yī)療和科研等高性能市場領域的設計人員提供高速度、低功耗及低成本的靈活且功能豐富的解決方案。ProASIC3L系列還支持FPGA優(yōu)化32位ARM Cortex-M1
- 關鍵字： Actel 可編程 FPGA
基于FPGA的數(shù)字濾波器的設計與實現(xiàn)
- 在信息信號處理過程中,如對信號的過濾、檢測、預測等,都要使用到濾波器,數(shù)字濾波器是數(shù)字信號處理中使用最廣泛的一種方法,常用的數(shù)字濾波器有無限長單位脈沖響應（IIR）濾波器和有限長單位脈沖響應（FIR）濾波器兩種[1]。對于應用設計者,由于開發(fā)速度和效率的要求很高,短期內(nèi)不可能全面了解數(shù)字濾波器相關的優(yōu)化技術,需要花費很大的精力才能使設計出的濾波器在速度、資源利用、性能上趨于較優(yōu)。而采用調(diào)試好的IP核需要向Altera公司購買。本文采用了一種基于DSP Builder的FPGA設計方法,以一個低通的16
- 關鍵字： FPGA 數(shù)字濾波器
TD-SCDMA系統(tǒng)基帶處理的DSP+FPGA實現(xiàn)方案
- 本文首先介紹TD-SCDMA系統(tǒng)無線信道的基帶發(fā)送方案，說明其對多媒體業(yè)務的支持及實現(xiàn)的復雜性。然后，從硬件實現(xiàn)角度，進行了DSP和FPGA的性能比較，提出DSP+FPGA基帶發(fā)送的實現(xiàn)方案，并以基站分系統(tǒng)(BTS)的發(fā)送單元為例，具體給出了該實現(xiàn)方案在下行無線信道基帶發(fā)送單元中的應用。
- 關鍵字： TD-SCDMA，DSP+FPGA
提高ASIC驗證的速度與可視性
- 前言 高性能、高容量FPGA在ASIC/SoC原型設計及系統(tǒng)兩方面的應用持續(xù)增長。這些設計通常包括硬件及嵌入式軟件(也可能包括應用軟件)的復雜組合，這給系統(tǒng)驗證帶來了巨大負擔，原因是檢測、隔離、調(diào)試及校正故障要比最初設計所花費的時間、資金和工程資源多得多。 由于軟硬件之間交互作用相當復雜且無法預見，僅僅是找到深藏于系統(tǒng)中的故障就需要進行長時間的測試序列，而且隨后的調(diào)試過程還需要花費更多的時間及精力。另外，如果驗證測試使用視頻流等實際數(shù)據(jù)時，那么間發(fā)故障將很難(如果并非不可能)重現(xiàn)。
- 關鍵字： FPGA ASIC 模擬器
fpga 介紹
FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。
FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個新概念，內(nèi)部包括可 [ 查看詳細 ]
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