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基于FPGA的HDLC轉(zhuǎn)E1傳輸控制器的實(shí)現(xiàn)
- 摘 要：本文介紹了一種用FPGA實(shí)現(xiàn)的HDLC轉(zhuǎn)E1的協(xié)議控制器，能實(shí)現(xiàn)將速率為N
- 關(guān)鍵字： E1 FPGA HDLC 幀結(jié)構(gòu)
數(shù)字頻率合成器的FPGA實(shí)現(xiàn)
- 介紹了DDFS的原理和Altera公司的FPGA器件ACEX 1K的主要特點(diǎn)，給出了用ACEX 1K系列器件EP1K10TC144－1實(shí)現(xiàn)數(shù)字頻率合成器的工作原理、設(shè)計(jì)思路、電路結(jié)構(gòu)和仿真結(jié)果。
- 關(guān)鍵字： FPGA 數(shù)字頻率合成器
基于MicroBlaze軟核的FPGA片上系統(tǒng)設(shè)計(jì)
- 分析軟處理器MicroBlaze的體系結(jié)構(gòu)，給出MicroBlaze內(nèi)核在軟件無線電系統(tǒng)中的應(yīng)用，實(shí)現(xiàn)SOPC（可編程系統(tǒng)芯片）。
- 關(guān)鍵字： MicroBlaze FPGA 軟核 片上系統(tǒng)
數(shù)字簽名算法SHA-1的FPGA高速實(shí)現(xiàn)
- 常用的信息驗(yàn)證碼是使用單向散列函數(shù)生成驗(yàn)證碼，安全散列算法SHA-1使用在是因特網(wǎng)協(xié)議安全性(IPSec)標(biāo)準(zhǔn)中。
- 關(guān)鍵字： FPGA SHA 數(shù)字簽名算法 高速實(shí)現(xiàn)
3-DES算法的FPGA高速實(shí)現(xiàn)
- 介紹3-DES算法的概要；以Xilinx公司SPARTANII結(jié)構(gòu)的XC2S100為例，闡述用FPGA高速實(shí)現(xiàn)3-DES算法的設(shè)計(jì)要點(diǎn)及關(guān)鍵部分的設(shè)計(jì)。
- 關(guān)鍵字： FPGA DES 算法 高速實(shí)現(xiàn)
fpga 介紹
FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個新概念，內(nèi)部包括可 [ 查看詳細(xì) ]
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