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UWB - 智能物聯(lián)的未來之星，你怎么看他？低功耗Wi-Fi解決方案在智能家居的應(yīng)用和發(fā)展結(jié)合超寬帶測距和雷達(dá)功能以實(shí)現(xiàn)高級IoT應(yīng)用來這里瞧瞧NXP技術(shù)培訓(xùn)視頻吧>>

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fpga ip 文章進(jìn)入fpga ip技術(shù)社區(qū)

FPGA走向硅片融合時代

　　對FPGA這種特殊芯片產(chǎn)品的認(rèn)識開始于10年前對Altera公司的認(rèn)識。Altera公司獨(dú)特的嚴(yán)謹(jǐn)氣質(zhì)與FPGA這種芯片非常契合。多年來跟蹤報道Altera在FPGA技術(shù)上的不斷創(chuàng)新，加之后來有機(jī)會結(jié)識賽靈思公司，兩家業(yè)內(nèi)翹楚的針鋒相對與惺惺相惜，使我對FPGA整個體系架構(gòu)的演進(jìn)過程有了比較全面的理解。前段時間，有機(jī)會與Altera公司CTO、資深副總裁Misha Burich先生交流FPGA業(yè)界發(fā)展趨勢，使得自己對FPGA技術(shù)發(fā)展的理解愈加清晰和深刻。　　FPGA體系架構(gòu)演進(jìn) 　　FPGA興起
關(guān)鍵字： Altera FPGA

一種新的嵌入式Simplified TCP/IP協(xié)議棧的研究與實(shí)現(xiàn)

一種新的嵌入式Simplified TCP/IP協(xié)議棧的研究與實(shí)現(xiàn),1　引言　　嵌入式nternet是近幾年隨著嵌入式系統(tǒng)的廣泛應(yīng)用和計算機(jī)網(wǎng)絡(luò)技術(shù)的發(fā)展而興起的一項(xiàng)新興概念和技術(shù)。單片機(jī)或微控制器(MCU,Micro ControllerUnit)被廣泛應(yīng)用在家庭和工業(yè)的各個領(lǐng)域,通稱嵌入式系統(tǒng)。嵌入
關(guān)鍵字：研究實(shí)現(xiàn) 協(xié)議 TCP/IP Simplified 嵌入式

基于SOPC的紅外解碼IP核設(shè)計與實(shí)現(xiàn)

摘要：提出一種紅外解碼IP核在SoPC系統(tǒng)中的設(shè)計與實(shí)現(xiàn)方案，重點(diǎn)研究紅外系統(tǒng)的數(shù)據(jù)編碼和傳輸機(jī)制，紅外解碼電路的HDL設(shè)計，IP核的制作及在SoPC系統(tǒng)中的應(yīng)用。該方案的紅外發(fā)送接收芯片分別是TC9012和DS338S，在DE2
關(guān)鍵字：設(shè)計實(shí)現(xiàn) IP 解碼 SOPC 紅外基于

IP/HD-SDI高清高速球技術(shù)發(fā)展趨勢探討

標(biāo)簽：IP/HD-SDI 高速球技術(shù)高清網(wǎng)絡(luò)高速球技術(shù)分析高清網(wǎng)絡(luò)高速球是在傳統(tǒng)模擬高速球的基礎(chǔ)上發(fā)展而來，在其基礎(chǔ)上，增加高清一體化機(jī)芯、視音頻編碼模塊、網(wǎng)絡(luò)接入模塊，即可構(gòu)成一個基本的網(wǎng)絡(luò)型高速球，實(shí)現(xiàn)高清
關(guān)鍵字：趨勢探討發(fā)展技術(shù) 高清高速 IP/HD-SDI

Xilinx Spartan-3A FPGA 的DDR2接口設(shè)計

1 引言DDR2(Double DataRate2)SDRAM是由JEDEC(電子設(shè)備工程聯(lián)合委員會)制定的新生代內(nèi)存技術(shù)標(biāo)準(zhǔn)，它與上一代DDR內(nèi)存技術(shù)標(biāo)準(zhǔn)最大的不同：雖然采用時鐘的上升／下降沿同時傳輸數(shù)據(jù)的基本方式，但DDR2卻擁有2倍的DDR
關(guān)鍵字： Spartan Xilinx FPGA DDR2

安富利X-fest研討會北京站打破參會人數(shù)記錄

X-fest 2012全球系列研討會北京站于7月10日舉辦，創(chuàng)下了單場活動吸引上千名業(yè)內(nèi)人士參加的新記錄。X-fest是為期一天的全球性培訓(xùn)活動，由安富利公司 (NYSE: AVT) 旗下安富利電子元件亞洲 (Avnet Electronics Marketing )主辦，深受FPGA、ARM MCU、DSP和嵌入式系統(tǒng)開發(fā)人員歡迎。
關(guān)鍵字：安富利 X-fest FPGA

一種基于FPGA的三坐標(biāo)測量機(jī)電機(jī)控制系統(tǒng)

1、控制系統(tǒng)概述隨著工業(yè)的發(fā)展，三坐標(biāo)測量機(jī)越來越顯示出其重要作用。而電機(jī)控制系統(tǒng)對三坐標(biāo)測量機(jī)的運(yùn)行有著非常重要的作用。由于FPGA可以現(xiàn)場可編程，可以實(shí)現(xiàn)專用集成電路，能滿足片上系統(tǒng)設(shè)計(SOC)的要求，使
關(guān)鍵字： FPGA 三坐標(biāo)測量機(jī) 電機(jī)控制系統(tǒng)

DDS調(diào)頻信號發(fā)生器的FPGA電路設(shè)計

關(guān)鍵字： DDS FPGA 信號發(fā)生器

閥門簡易控制

溫度/壓力/流量/液位控制器通過簡單連接就可以直接控制電動閥門（含電動蝶閥與電動球閥等），免去伺服放大器，可選...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費(fèi)電子 FPGA

256 級灰度顯示 - 基于FPGA的OLED真彩色顯示設(shè)計

256 級灰度顯示 - 基于FPGA的OLED真彩色顯示設(shè)計,摘要利用FPGA 控制模塊，設(shè)計了OLED 真彩色動態(tài)圖像驅(qū)動控制電路。介紹采用FPGA 實(shí)現(xiàn)OLED 外圍控制電路和256 級灰度的方法，并分析電路中模塊的作用及整個電路的工作過程。電路系統(tǒng)采用基于Altera 公司的FPGA技術(shù)進(jìn)行
關(guān)鍵字：顯示彩色設(shè)計 OLED FPGA 基于級灰度

工程師分析實(shí)例，帶你走近Xilinx FPGA設(shè)計

工程師分析實(shí)例，帶你走近Xilinx FPGA設(shè)計,一.概述　　本文主要幫助大家熟悉利用ISE進(jìn)行Xilinx 公司FPGA 代碼開發(fā)的基本流程。主要是幫助初學(xué)者了解和初步掌握 ISE 的使用，不需要 FPGA 的開發(fā)基礎(chǔ)，所以對每個步驟并不進(jìn)行深入的討論?！　”疚慕榻B的內(nèi)容從新
關(guān)鍵字： FPGA 設(shè)計 Xilinx 走近分析實(shí)例工程師

采用FPGA與SRAM的大容量數(shù)據(jù)存儲的設(shè)計

采用FPGA與SRAM的大容量數(shù)據(jù)存儲的設(shè)計,1 前言　針對FPGA中內(nèi)部BlockRAM有限的缺點(diǎn)，提出了將FPGA與外部SRAM相結(jié)合來改進(jìn)設(shè)計的方法，并給出了部分VHDL程序。　　2 硬件設(shè)計　　這里將主要討論以Xilinx公司的FPGA(XC2S600E-6fg456)和ISSI公司的SRAM(IS61LV
關(guān)鍵字：存儲設(shè)計數(shù)據(jù) 大容量 FPGA SRAM 采用

采用上位機(jī)與FPGA開發(fā)板的光纖通道接口適配器設(shè)計

采用上位機(jī)與FPGA開發(fā)板的光纖通道接口適配器設(shè)計,隨著存儲技術(shù)的迅速發(fā)展，存儲容量得到了迅速的增長，存儲系統(tǒng)的數(shù)據(jù)傳輸速度成為了主要的瓶頸。光纖的傳輸具有其速度上的優(yōu)勢，然而，在光纖傳輸要受到光纖通道接口的限制，因此光纖通道應(yīng)用于高速數(shù)據(jù)傳輸?shù)囊粋€關(guān)
關(guān)鍵字：接口適配器設(shè)計通道光纖上位 FPGA 開發(fā) 采用

利用Java良好的移植特性的FPGA可編程嵌入式系統(tǒng)

利用Java良好的移植特性的FPGA可編程嵌入式系統(tǒng),傳統(tǒng)的嵌入式產(chǎn)品只能實(shí)現(xiàn)某種特定的功能，不能滿足用戶可變的豐富多彩的應(yīng)用需求。為解決這個問題，本文設(shè)計并實(shí)現(xiàn)了一種使用Java作為軟件平臺的基于FPGA的可編程嵌入式系統(tǒng)，以實(shí)現(xiàn)系統(tǒng)對多種本地應(yīng)用和網(wǎng)絡(luò)的支持
關(guān)鍵字：可編程嵌入式系統(tǒng) FPGA 特性 Java 良好移植利用

FPGA全局時鐘資源相關(guān)Xilinx器件原語及使用

FPGA全局時鐘資源相關(guān)Xilinx器件原語及使用,FPGA全局時鐘資源一般使用全銅層工藝實(shí)現(xiàn)，并設(shè)計了專用時鐘緩沖與驅(qū)動結(jié)構(gòu)，從而使全局時鐘到達(dá)芯片內(nèi)部的所有可配置單元(CLB)、I/O單元(IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應(yīng)復(fù)雜設(shè)
關(guān)鍵字： Xilinx 器件使用相關(guān) 資源全局時鐘 FPGA

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fpga ip介紹

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fpga ip電路

利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計的方法
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計與實(shí)現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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fpga ip資料下載

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