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基于FPGA的高精度時間數(shù)字轉(zhuǎn)換電路設(shè)計
- 摘要：本文介紹一種基于 FPGA高精度時間數(shù)字轉(zhuǎn)換電路的設(shè)計方法，利用片內(nèi)鎖相環(huán)（PLL）和環(huán)形移位寄存器，采用不高的系統(tǒng)時鐘便可得到很高的時間分辨率，且占用較少邏輯資源?？勺鳛楣δ茈娐藩毩⑹褂茫部勺鳛?IP核
- 關(guān)鍵字： FPGA 高精度 電路設(shè)計 數(shù)字轉(zhuǎn)換
加速SoC設(shè)計：把C代碼直接轉(zhuǎn)為SoC GDSII
- *IC設(shè)計業(yè)中第一家提供從C模型的算法，直接轉(zhuǎn)為完整的SoC GDSII 的公司 *對于制程越小，設(shè)計越復雜、需要盡快上市的設(shè)計，就越適合。 問：Algotochip公司的規(guī)模是怎么樣的？ 答：Algotochip成立只有三年，公司員工約40人。但是Algotochip的團隊加起來，做過超過150個SoC的tapeout（芯片設(shè)計完成）。由日本某創(chuàng)投集團投資。 問：Algotochip的訣竅技術(shù)是什么？ 答：我們把C code（代碼）拿來，把它進行分析一下，一邊是一個可以可編程的，一邊是固定的
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DARPA授權(quán)RF-FPGA項目合同 開發(fā)可編程射頻前端技術(shù)
- ? 美國國防預先研究計劃局射頻和微波技術(shù)專家正在與6家國防企業(yè)和大學合作，開發(fā)可編程射頻前端元件，以減少軍事通信、電子戰(zhàn)和信號情報系統(tǒng)(SIGINT)的成本和開發(fā)時間。 迄今為止，DARPA授權(quán)了6份關(guān)于“現(xiàn)場可編程門陣列射頻技術(shù)(RF-FPGA)”項目的合同。該項目旨在通過收發(fā)器鏈編程，跨不同應用程序重復使用同一組射頻前端元件。從根本上講， RF-FPGA項目試圖將現(xiàn)場可編程門陣列(FPGA)在數(shù)字計算方面的成功應用經(jīng)驗轉(zhuǎn)移到射頻和微波技術(shù)，從而在廣泛應用中減少
- 關(guān)鍵字： DARPA FPGA
ARM與Synopsys合作達成ARM架構(gòu)之SoC功耗能效最佳化
- ARM及新思科技(Synopsys)簽訂一項多年期協(xié)定，進一步擴大新思科技(Synopsys)使用ARM硅智財(IP)的權(quán)利。雙方將擴展合作關(guān)係，讓SoC設(shè)計人員透過新思科技Galaxy實作平臺及Discovery VIP達成以ARM架構(gòu)為基礎(chǔ)之SoC功耗及效能的最佳化，同時降低成本并加速上市時程。新的協(xié)定是以先前EDA工具及ARM Cortex-A15處理器授權(quán)協(xié)定為基礎(chǔ)，允許新思科技取得一系列Cortex處理器的使用權(quán)利，包括執(zhí)行ARM big.LITTLE處理的技術(shù)、ARM Arti
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ARM與Synopsys宣布擴展雙方合作關(guān)系
- ARM及新思科技( Synopsys )宣布簽訂一項多年期協(xié)定，進一步擴大新思科使用ARM矽智財(IP)的權(quán)利。雙方將擴展合作關(guān)系，讓SoC設(shè)計人員透過新思科技Galaxy實作平臺及Discovery VIP達成以ARM架構(gòu)為基礎(chǔ)之SoC功耗及效能的最佳化，同時降低成本并加速上市時程。 新的協(xié)定乃以先前EDA工具及ARM Cortex -A15 處理器授權(quán)協(xié)定為基礎(chǔ)，允許新思科技取得一系列Cortex處理器的使用權(quán)利，包括執(zhí)行ARM big.LITTLE處理的技術(shù)、ARM Artis
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