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          在汽車娛樂(lè)電子中采用FPGA推動(dòng)的參考設(shè)計(jì)

          • 汽車娛樂(lè)電子推動(dòng)了功能和容量的快速發(fā)展,促使設(shè)計(jì)人員在性能、成本和靈活性上做出綜合考慮。與其他汽車電子領(lǐng)域不同,多媒體圖形應(yīng)用高度可視化,其需求多變,在許多情況下甚至還沒(méi)有建立標(biāo)準(zhǔn)。汽車設(shè)計(jì)人員需要一個(gè)能夠提供最靈活、性能最佳而成本可控的解決方案??删幊踢壿?,特別是現(xiàn)場(chǎng)可編程門陣列(FPGA)便是這樣的解決方案。 在以前,專用集成電路(ASIC)能夠?yàn)橹圃焐烫峁┏杀拘б孑^好的芯片方案,因此,汽車圖形應(yīng)用在半導(dǎo)體方面一般選用ASIC。但是,ASIC開(kāi)發(fā)成本不斷攀升,降低批量?jī)r(jià)格、快速面市的要求以及功能復(fù)雜
          • 關(guān)鍵字: FPGA  汽車電子  汽車電子  

          原型驗(yàn)證過(guò)程中的ASIC到FPGA的代碼轉(zhuǎn)換

          • 在對(duì)ASIC設(shè)計(jì)進(jìn)行FPGA原型驗(yàn)證時(shí),由于物理結(jié)構(gòu)不同,ASIC的代碼必須進(jìn)行一定的轉(zhuǎn)換后才能作為FPGA的輸入 現(xiàn)代集成電路設(shè)計(jì)中,芯片的規(guī)模和復(fù)雜度正呈指數(shù)增加。尤其在ASIC設(shè)計(jì)流程中,驗(yàn)證和調(diào)試所花的時(shí)間約占總工期的70%。為了縮短驗(yàn)證周期,在傳統(tǒng)的仿真驗(yàn)證的基礎(chǔ)上,涌現(xiàn)了許多新的驗(yàn)證手段,如斷言驗(yàn)證、覆蓋率驅(qū)動(dòng)的驗(yàn)證,以及廣泛應(yīng)用的基于現(xiàn)場(chǎng)可編程器件(FPGA)的原型驗(yàn)證技術(shù)。 采用FPGA原型技術(shù)驗(yàn)證ASIC設(shè)計(jì),首先需要把ASIC設(shè)計(jì)轉(zhuǎn)化為FPGA設(shè)計(jì)。但ASIC是基于標(biāo)準(zhǔn)單元庫(kù),F(xiàn)P
          • 關(guān)鍵字: FPGA  單片機(jī)  嵌入式系統(tǒng)  

          ADPCM語(yǔ)音編解碼電路設(shè)計(jì)及FPGA實(shí)現(xiàn)

          • 近年來(lái),多媒體技術(shù)逐漸深入到人們的生活中。MP3播放器已經(jīng)成為流行的便攜式音頻播放設(shè)備,由于MP3編碼算法非常復(fù)雜,目前,一部分MP3播放器的錄音功能主要基于ADPCM算法和DSP來(lái)實(shí)現(xiàn)。本文闡述了ADPCM語(yǔ)音編解碼VLSI芯片的設(shè)計(jì)方法以及利用FPGA的硬件實(shí)現(xiàn)。 ADPCM算法及其編解碼器原理 ADPCM(Adaptive Differential Pulse Code Modulation,自適應(yīng)差分脈沖編碼調(diào)制)綜合了APCM的自適應(yīng)特性和DPCM系統(tǒng)的差分特性,是一種性能較好的波形編碼。它
          • 關(guān)鍵字: FPGA  消費(fèi)電子  消費(fèi)電子  

          英飛凌推出高度集成的SoC解決方案

          • 英飛凌科技公司發(fā)布了一個(gè)基于雙核架構(gòu)、包含多個(gè)集成式外設(shè)的高度集成的片上系統(tǒng)(SoC)解決方案家族。全新TwinPass家族主要面向家庭數(shù)字應(yīng)用,如存儲(chǔ)和多媒體應(yīng)用、基于VDSL和PON接入調(diào)制解調(diào)器的綜合接入設(shè)備(IAD)、基于IP的語(yǔ)音業(yè)務(wù)(VoIP)路由器、家用網(wǎng)關(guān)和外圍數(shù)據(jù)應(yīng)用(打印機(jī)服務(wù)器)等。TwinPass-VE直接在SoC中集成了一個(gè)VoIP引擎,可以為家庭用戶和小型企業(yè)用戶提供電信級(jí)語(yǔ)音業(yè)務(wù)。TwinPass-E則具備一顆面向新一代網(wǎng)關(guān)和路由器的高性能CPU,可支持更高帶寬的應(yīng)用,如IP
          • 關(guān)鍵字: 處理器  單片機(jī)  嵌入式系統(tǒng)  通信  通訊  網(wǎng)關(guān)  網(wǎng)絡(luò)  無(wú)線  英飛凌  SoC  ASIC  

          基于FPGA的前向糾錯(cuò)算法

          • 研究數(shù)字音頻無(wú)線傳輸中的前向糾錯(cuò)(FEC)算法的設(shè)計(jì)及實(shí)現(xiàn),對(duì)前向糾錯(cuò)中的主要功能模塊,如RS編解碼、交織器與解交織器等給出基本算法及基于現(xiàn)場(chǎng)可編程門陣列(FPGA)和硬件描述語(yǔ)言的解決方案。
          • 關(guān)鍵字: FPGA  前向糾錯(cuò)  算法    

          基于XC2V1000型FPGA的FIR抽取濾波器的設(shè)計(jì)

          • 介紹XC2V1000型現(xiàn)場(chǎng)可編程門陣列(FPGA)的主要特性和FIR抽取濾波器的工作原理,重點(diǎn)闡述用XC2V1000實(shí)現(xiàn)FIR抽取濾波器的方法,并給出仿真波形和設(shè)計(jì)特點(diǎn)。
          • 關(guān)鍵字: V1000  1000  FPGA  FIR    

          2006年,SEED成為美國(guó)賽靈思(Xilinx)的合作伙伴

          •   2006年,成為美國(guó)賽靈思(Xilinx)的合作伙伴,代理Xilinx FPGA的軟、硬件業(yè)務(wù),積極推廣FPGA大學(xué)計(jì)劃。
          • 關(guān)鍵字: SEED  FPGA  

          基于FPGA的生物芯片掃描儀的位置檢測(cè)

          • 詳細(xì)闡述了FPGA中辨向細(xì)分、可逆計(jì)數(shù)器,接口電路的設(shè)計(jì)實(shí)現(xiàn),并給出了仿真波形。
          • 關(guān)鍵字: FPGA  生物芯片  位置檢測(cè)    

          降低FPGA設(shè)計(jì)的功耗是一種協(xié)調(diào)和平衡藝術(shù)

          • 目前許多終端市場(chǎng)對(duì)可編程邏輯器件設(shè)計(jì)的低功耗要求越來(lái)越苛刻。工程師們?cè)谠O(shè)計(jì)如路由器、交換機(jī)、基站及存...
          • 關(guān)鍵字: FPGA  低功耗  

          Actel低功耗的FPGA系列靜態(tài)功耗僅為5µW

          •   Actel 公司宣布推出業(yè)界最低功耗的現(xiàn)場(chǎng)可編程門陣列 (FPGA) -- IGLOO™ 系列。這個(gè)以 Flash 為基礎(chǔ)的產(chǎn)品系列的靜態(tài)功耗為5µW,是最接近競(jìng)爭(zhēng)產(chǎn)品功耗的四分之一;與目前領(lǐng)先的PLD產(chǎn)品比較,更可延長(zhǎng)便攜式應(yīng)用的電池壽命達(dá)5倍,因而奠定了低功耗的新標(biāo)準(zhǔn)。        由于便攜式產(chǎn)品的生命周期短及市場(chǎng)競(jìng)爭(zhēng)激烈,設(shè)計(jì)人員必需不斷增加新的功能和復(fù)雜性,但卻不能耗用
          • 關(guān)鍵字: Actel  FPGA  單片機(jī)  靜態(tài)功耗  嵌入式系統(tǒng)  通訊  網(wǎng)絡(luò)  無(wú)線  

          XILINX宣布推出PLANAHEAD 8.2設(shè)計(jì)套件

          • 進(jìn)一步擴(kuò)展 65-NM VIRTEX-5 FPGA性能優(yōu)勢(shì) 新版軟件可提高性能、加快設(shè)計(jì)收斂速度并提供了更好的信號(hào)完整性分析能力  賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX)宣布即日起推出PlanAhead™ 分層設(shè)計(jì)和分析軟件8.2版。新版軟件支持賽靈思公司最新的Virtex™-5 LX系列65nm FPGA器件。配合賽靈思公司的集成軟件環(huán)境(ISE͐
          • 關(guān)鍵字: 65nm  FPGA  ISE  PlanAhead  Virtex-5  Xilinx  單片機(jī)  嵌入式系統(tǒng)  賽靈思  通訊  網(wǎng)絡(luò)  無(wú)線  

          基于FPGA的樂(lè)曲發(fā)生器設(shè)計(jì)

          • 本設(shè)計(jì)在美國(guó)ALTERA公司MAX + plusⅡ的EDA軟件平臺(tái)上,使用層次化設(shè)計(jì)方法,實(shí)現(xiàn)了樂(lè)曲發(fā)生器的設(shè)計(jì)。
          • 關(guān)鍵字: FPGA  發(fā)生器    

          基于FPGA的誤碼率測(cè)試儀的設(shè)計(jì)與實(shí)現(xiàn)

          SoC降低ZigBee節(jié)點(diǎn)成本(05-100)

          • 引言 據(jù)預(yù)測(cè),嵌入式無(wú)線監(jiān)控網(wǎng)絡(luò)的市場(chǎng)將會(huì)有突破性的增長(zhǎng)。其典型的應(yīng)用領(lǐng)域?yàn)樯套〖白≌ㄖ詣?dòng)化,工業(yè)監(jiān)控,資產(chǎn)追蹤,環(huán)境監(jiān)控以及其他控制及傳感器應(yīng)用。ZigBee就是符合以上系統(tǒng)的無(wú)線網(wǎng)絡(luò)標(biāo)準(zhǔn)。對(duì)于ZigBee的市場(chǎng),SoC(系統(tǒng)芯片)解決方案將變得越來(lái)越重要。因?yàn)镾oC可以大大節(jié)省ZigBee節(jié)點(diǎn)的成本。 功耗及單元成本的降低是目前短距離無(wú)線通信RF-IC開(kāi)發(fā)的主要原動(dòng)力。采用具有高性價(jià)比的亞微級(jí)CMOS技術(shù)和高集成度的發(fā)射接收結(jié)構(gòu)是實(shí)現(xiàn)以上要求的關(guān)鍵因素。而且,基于CMOS的技術(shù)可以更好的發(fā)展無(wú)線通
          • 關(guān)鍵字: Chipcon  SoC  ASIC  

          賽普拉斯推出PSoC Express™ 設(shè)計(jì)工具

          •   最新版設(shè)計(jì)工具包括第三方開(kāi)發(fā)的60多款新型驅(qū)動(dòng)器 日前,賽普拉斯半導(dǎo)體公司(Cypress Semiconductor Corporation)宣布推出針對(duì)PSoC®(可編程片上系統(tǒng))混合信號(hào)陣列的創(chuàng)新型開(kāi)發(fā)工具——PSoC Express™2.1版,該開(kāi)發(fā)工具能夠顯著簡(jiǎn)化嵌入式系統(tǒng)的設(shè)計(jì)工作,進(jìn)而提高設(shè)計(jì)效率。新版工具包括使軟件開(kāi)發(fā)人員能夠編寫(xiě)特定功能模塊的由第三方提供的多種開(kāi)發(fā)功能。此外,該工具還增加了眾多新型設(shè)備驅(qū)動(dòng)器,這樣設(shè)計(jì)人員能
          • 關(guān)鍵字: 工業(yè)控制  通訊  網(wǎng)絡(luò)  無(wú)線  SoC  ASIC  工業(yè)控制  
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          fpga soc介紹

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