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基于 STEP-MAX10M08核心板的簡易電子琴設(shè)計
- 實驗任務(wù)任務(wù)：基于 STEP-MAX10M08核心板 和 STEP BaseBoard V3.0底板 完成簡易電子琴設(shè)計并觀察調(diào)試結(jié)果要求：按動矩陣鍵盤，驅(qū)動底板無源蜂鳴器發(fā)出產(chǎn)生不同音調(diào)，彈奏一首《小星星》。解析：通過FPGA編程驅(qū)動矩陣鍵盤電路，獲取矩陣鍵盤鍵入的信息，然后通過編碼將鍵盤輸出的信息譯碼成對應(yīng)的音節(jié)數(shù)據(jù)，最后通過PWM發(fā)生模塊驅(qū)動底板上的無源蜂鳴器發(fā)出聲音。實驗?zāi)康脑诨A(chǔ)數(shù)字電路實驗部分我們已經(jīng)掌握了FPGA設(shè)計PWM信號發(fā)生器的原理及方法，上節(jié)實驗中又學(xué)習(xí)了矩陣鍵盤的驅(qū)動原理及方法，本
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Altera MAX10: 交通燈控制
- 簡易交通燈：本節(jié)將向您介紹Verilog語法之中的精髓內(nèi)容——狀態(tài)機(jī)，并且將利用狀態(tài)機(jī)實現(xiàn)十字路口的交通燈。====硬件說明與實現(xiàn)項目框圖====上圖為十字路口交通示意圖分之路與主路，要求如下：交通燈主路上綠燈持續(xù)15s的時間，黃燈3s的時間，紅燈10s的時間；交通燈支路上綠燈持續(xù)7s的時間， 黃燈持續(xù)3秒的時間，紅燈18秒的時間；根據(jù)上述要求，狀態(tài)機(jī)設(shè)計框架分析如下：S1:主路綠燈點亮，支路紅燈點亮，持續(xù)15s的時間；S2:主路黃燈點亮，支路紅燈點亮，持續(xù)3s的時間；S3:主路紅燈點亮，支路綠燈點亮，持
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Lattice MXO2: 交通燈控制
- 簡易交通燈：本節(jié)將向您介紹Verilog語法之中的精髓內(nèi)容——狀態(tài)機(jī)，并且將利用狀態(tài)機(jī)實現(xiàn)十字路口的交通燈。硬件說明與實現(xiàn)項目框圖上圖為十字路口交通示意圖分之路與主路，要求如下： * 交通燈主路上綠燈持續(xù)15s的時間，黃燈3s的時間，紅燈10s的時間； * 交通燈支路上綠燈持續(xù)7s的時間， 黃燈持續(xù)3秒的時間，紅燈18秒的時間；根據(jù)上述要求，狀態(tài)機(jī)設(shè)計框架分析如下： * S1:主路綠燈點亮，支路紅燈點亮，持續(xù)15s的時間； * S2:主路黃燈點亮，支路紅燈點亮，持續(xù)3s的時間； * S3:主路紅燈點亮，支
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Lattice MXO2: LED呼吸燈
- 呼吸燈：本節(jié)，我們將通過脈寬調(diào)制技術(shù)來實現(xiàn)“呼吸燈”，實現(xiàn)LED的亮度由最暗逐漸增加到最亮，再逐漸變暗的過程。 脈沖寬度調(diào)制(PWM:Pulse Width Modulation)，簡稱脈寬調(diào)制。它是利用微控制器的數(shù)字輸出調(diào)制實現(xiàn)，是對模擬電路進(jìn)行控制的一種非常有效的技術(shù)，廣泛應(yīng)用于測量、通信、功率控制與變換等眾多領(lǐng)域。硬件說明呼吸燈的設(shè)計較為簡單，我們使用12MHz的系統(tǒng)時鐘作為高頻信號做分頻處理，調(diào)整占空比實現(xiàn)PWM，通過LED燈LD1指示輸出狀態(tài)。實現(xiàn)原理如上圖所示，脈沖信號的周期為T，高電平脈沖寬
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小而美FPGA為邊緣AI賦能
- 1? ?小型和中端FPGA服務(wù)嵌入式AI領(lǐng)域?萊迪思經(jīng)過40多年的發(fā)展，目前擁有公司歷史上最強(qiáng)大的產(chǎn)品組合，其針對AI優(yōu)化、低功耗FPGA解決方案主要面向小型和中端FPGA市場。萊迪思旨在滿足客戶對各種網(wǎng)絡(luò)邊緣應(yīng)用日益增長的智能需求，提供超強(qiáng)適應(yīng)性的解決方案，幫助客戶跟進(jìn)不斷發(fā)展的AI算法。萊迪思提供包括嵌入式AI在內(nèi)的領(lǐng)先的解決方案，服務(wù)于工業(yè)、汽車、通信、計算和消費類應(yīng)用。萊迪思sensAI?解決方案集合幫助客戶實現(xiàn)最新的工廠自動化和工業(yè)機(jī)器視覺應(yīng)用，其低功耗FPGA提供
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創(chuàng)新加速,英特爾以全矩陣FPGA助產(chǎn)業(yè)智能化發(fā)展
- 近日，以“創(chuàng)新加速，塑造FPGA芯未來”為主題的2023年英特爾? FPGA中國技術(shù)日在北京成功舉行。期間，英特爾不僅披露了包括Agilex? 3系列、Agilex? 5系列在內(nèi)的多款FPGA產(chǎn)品細(xì)節(jié)及其早期驗證計劃，同時亦分享了與產(chǎn)業(yè)伙伴在數(shù)據(jù)中心、AI、網(wǎng)絡(luò)、嵌入式等關(guān)鍵領(lǐng)域的諸多應(yīng)用，旨在以逐步擴(kuò)大的產(chǎn)品組合進(jìn)一步滿足廣泛細(xì)分市場需求的同時，深度展示英特爾在加速可編程創(chuàng)新、推動中國行業(yè)數(shù)智化進(jìn)程上的重要作用。英特爾可編程方案事業(yè)部中國總經(jīng)理葉唯琛表示，“在新場景、新應(yīng)用海量增長的驅(qū)動下，中國本地市場
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Altera MAX10: 計時控制
- 計時控制在之前的實驗中我們掌握了如何進(jìn)行時鐘分頻、如何進(jìn)行數(shù)碼管顯示與按鍵消抖的處理，那么在本節(jié)實驗之中，我們將會實現(xiàn)一個籃球賽場上常見的24秒計時器。====硬件說明====在之前的實驗中我們?yōu)樽x者詳細(xì)介紹過小腳丫MXO2板卡上的按鍵、數(shù)碼管、LED等硬件外設(shè)，在此不再贅述。本節(jié)將實現(xiàn)由數(shù)碼管作為顯示模塊，按鍵作為控制信號的輸入(包含復(fù)位信號和暫停信號)，Altera MAX10作為控制核心的籃球讀秒系統(tǒng)，實現(xiàn)框圖如下：====Verilog代碼====// *****************
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Lattice MXO2: 計時控制
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Altera MAX10: 按鍵消抖
- 按鍵消抖在之前的實驗中我們學(xué)習(xí)了如何用按鍵作為FPGA的輸入控制，在本實驗中將學(xué)習(xí)如何進(jìn)行按鍵消抖，用按鍵完成更多的功能。====硬件說明====按鍵是一種常用的電子開關(guān)，電子設(shè)計中不可缺少的輸入設(shè)備。當(dāng)按下時使開關(guān)導(dǎo)通，松開時則開關(guān)斷開，內(nèi)部結(jié)構(gòu)是靠金屬彈片來實現(xiàn)通斷。按鍵抖動的原理抖動的產(chǎn)生 ：通常的按鍵所用的開關(guān)為機(jī)械彈性開關(guān)，當(dāng)機(jī)械觸點斷開、閉合時，由于機(jī)械觸點的彈性作用，一個按鍵開關(guān)在閉合時不會馬上穩(wěn)定地接通，在斷開時也不會一下子斷開。因而在閉合及斷開的瞬間均伴隨有一連串的抖動，為了不產(chǎn)生這種現(xiàn)
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Lattice MXO2: 按鍵消抖
- 按鍵消抖在之前的實驗中我們學(xué)習(xí)了如何用按鍵作為FPGA的輸入控制，在本實驗中將學(xué)習(xí)如何進(jìn)行按鍵消抖，用按鍵完成更多的功能。硬件說明按鍵是一種常用的電子開關(guān)，電子設(shè)計中不可缺少的輸入設(shè)備。當(dāng)按下時使開關(guān)導(dǎo)通，松開時則開關(guān)斷開，內(nèi)部結(jié)構(gòu)是靠金屬彈片來實現(xiàn)通斷。按鍵抖動的原理抖動的產(chǎn)生 ：通常的按鍵所用的開關(guān)為機(jī)械彈性開關(guān)，當(dāng)機(jī)械觸點斷開、閉合時，由于機(jī)械觸點的彈性作用，一個按鍵開關(guān)在閉合時不會馬上穩(wěn)定地接通，在斷開時也不會一下子斷開。因而在閉合及斷開的瞬間均伴隨有一連串的抖動，為了不產(chǎn)生這種現(xiàn)象而作的措施就是
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Altera MAX10: LED流水燈
- 在時鐘分頻實驗中我們練習(xí)了如何處理時鐘，接下來我們要學(xué)習(xí)如何利用時鐘來完成時序邏輯。====硬件說明====流水燈實現(xiàn)是很常見的一個實驗，雖然邏輯比較簡單，但是里面也包含了實現(xiàn)時序邏輯的基本思想。要用FPGA實現(xiàn)流水燈有很多種方法，在這里我們會用兩種不同的方法實現(xiàn)。1，模塊化設(shè)計：在之前的實驗中我們做了3-8譯碼器和時鐘分頻，如果把這兩個結(jié)合起來，我們就能搭建一個自動操作的流水LED顯示?？驁D如下：2，循環(huán)賦值：這是一種很簡潔的實現(xiàn)流水燈效果邏輯，就是定義一個8位的變量，在每個時鐘上升沿將最低位賦值給最高
- 關(guān)鍵字： 流水燈 FPGA Lattice Diamond 小腳丫
Lattice MXO2: LED流水燈
- 在時鐘分頻實驗中我們練習(xí)了如何處理時鐘，接下來我們要學(xué)習(xí)如何利用時鐘來完成時序邏輯。硬件說明流水燈實現(xiàn)是很常見的一個實驗，雖然邏輯比較簡單，但是里面也包含了實現(xiàn)時序邏輯的基本思想。要用FPGA實現(xiàn)流水燈有很多種方法，在這里我們會用兩種不同的方法實現(xiàn)。1，模塊化設(shè)計：在之前的實驗中我們做了3-8譯碼器和時鐘分頻，如果把這兩個結(jié)合起來，我們就能搭建一個自動操作的流水LED顯示?？驁D如下：2，循環(huán)賦值：這是一種很簡潔的實現(xiàn)流水燈效果邏輯，就是定義一個8位的變量，在每個時鐘上升沿將最低位賦值給最高位，其他位右移一
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利用搭載全域硬2D NoC的FPGA器件去完美實現(xiàn)智能化所需的高帶寬低延遲計算
- 隨著大模型、高性能計算、量化交易和自動駕駛等大數(shù)據(jù)量和低延遲計算場景不斷涌現(xiàn)，加速數(shù)據(jù)處理的需求日益增長，對計算器件和硬件平臺提出的要求也越來越高。發(fā)揮核心器件內(nèi)部每一個計算單元的作用，以更大帶寬連接內(nèi)外部存儲和周邊計算以及網(wǎng)絡(luò)資源，已經(jīng)成為智能化技術(shù)的一個重要趨勢。這使得片上網(wǎng)絡(luò)（Network-on-Chip）這項已被提及多年，但工程上卻不容易實現(xiàn)的技術(shù)再次受到關(guān)注。作為一種被廣泛使用的硬件處理加速器，F(xiàn)PGA可以加速聯(lián)網(wǎng)、運算和存儲，其優(yōu)點包括計算速度與ASIC相仿，也具備了高度的靈活性，能夠為數(shù)據(jù)
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Altera MAX10: 時鐘分頻
- 時鐘分頻在之前的實驗中我們已經(jīng)熟悉了小腳丫的各種外設(shè)，掌握了verilog的組合邏輯設(shè)計，接下來我們將學(xué)習(xí)時序邏輯的設(shè)計。====硬件說明====時鐘信號的處理是FPGA的特色之一，因此分頻器也是FPGA設(shè)計中使用頻率非常高的基本設(shè)計之一。一般在FPGA中都有集成的鎖相環(huán)可以實現(xiàn)各種時鐘的分頻和倍頻設(shè)計，但是通過語言設(shè)計進(jìn)行時鐘分頻是最基本的訓(xùn)練，在對時鐘要求不高的設(shè)計時也能節(jié)省鎖相環(huán)資源。在本實驗中我們將實現(xiàn)任意整數(shù)的分頻器，分頻的時鐘保持50%占空比。1，偶數(shù)分頻：偶數(shù)倍分頻相對簡單，比較容易理解。通
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