1 引言隨著同防工業(yè)對精確制導武器要求的不斷提高,武器系統(tǒng)總體設計方案的日趨復雜,以及電子元器件水平的飛速發(fā)展。導引頭信號處理器的功能越來越復雜,硬件規(guī)模越來越大.處理速度也越來越高.而且產(chǎn)品的更新速度
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FPGA DSP 雷達導引頭 關鍵技術
電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡家園
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FPGA ADSP TS201總線
基于Xilinx軟件的FPGA系統(tǒng)設計方法介紹,Solution:在對FPGA設計進行最初步的系統(tǒng)規(guī)劃的時候,需要進行模塊劃分,模塊接口定義等工作。通常,我們只能在紙上進行設計。雖然在紙上我們可以很隨意地書寫,而用紙畫的不方便就在于,如果對某一個模塊進行較大改動
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設計 方法 介紹 系統(tǒng) FPGA Xilinx 軟件 基于
Xilinx FPGA開發(fā)環(huán)境的安裝方法,一、計算機硬件環(huán)境要求: 1、操作系統(tǒng): Microsoft Windows XP Home Edition SP2 2、基本配置: A、處理器:Intel CPU T2050 1.6GHz B、內(nèi)存:512MB C、硬盤:60GB(其中軟件安裝的空問需要3GB)補充
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安裝 方法 環(huán)境 開發(fā) FPGA Xilinx
交織和解交織是組合信道糾錯系統(tǒng)的一個重要環(huán)節(jié),交織器和解交織器的實現(xiàn)方法有多種。本文利用Altera公司開發(fā)的Quartus軟件平臺和仿真環(huán)境,設計一種交織器和解交織器FPGA電路單倍實現(xiàn)的方法,并分析該電路實現(xiàn)的特點
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FPGA 交織器 電路實現(xiàn)
引言當今社會是數(shù)字化的社會,隨著微電子技術的發(fā)展,設計與制造集成電路的任務已不完全由半導體廠商來獨立承擔...
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FPGA 存儲設備
IIR數(shù)字濾波器設計-在FPGA上實現(xiàn)任意階IIR數(shù)字濾波器摘 要:本文介紹了一種采用級聯(lián)結構在FPGA上實現(xiàn)任意階IIR數(shù)字濾波器的方法。此設計擴展性好,便于調(diào)節(jié)濾波器的性能,可以根據(jù)不同的要求在不同規(guī)模的FPGA上加以實
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IIR FPGA 數(shù)字 濾波器設計
摘要:文章首先分析了循環(huán)冗余校驗碼的功能,在此基礎上提出了基于FPGA的實現(xiàn)方法,詳細闡述了CRC校驗編解碼的實現(xiàn)方法,并提出了基于現(xiàn)有的實驗箱設備實現(xiàn)小型的CRC校驗系統(tǒng)的總體設計框架和設計思路,完成了CRC校驗
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FPGA 循環(huán)冗余校驗 實驗系統(tǒng)
基于FPGA和單片機的串行通信接口設計,摘要:本文針對由FPGA構成的高速數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問題,提出FPGA與單片機實現(xiàn)數(shù)據(jù)串行通信的解決方案。在通信過程中完全遵守RS232協(xié)議,具有較強的通用性和推廣價值。1 前言 現(xiàn)場可編程邏輯器件(F
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接口 設計 通信 串行 FPGA 單片機 基于
FPGA DCM時鐘管理單元原理簡介,DCM概述 DCM內(nèi)部是DLL(Delay Lock Loop(?)結構,對時鐘偏移量的調(diào)節(jié)是通過長的延時線形成的。DCM的參數(shù)里有一個PHASESHIFT(相移),可以從0變到255。所以我們可以假設內(nèi)部結構里從clkin到clk_1x之間應該有256根延
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原理 簡介 單元 管理 DCM 時鐘 FPGA
摘 要: 設計實現(xiàn)了一種智能移動機器人的前端視頻采集系統(tǒng),該系統(tǒng)采用視頻解碼芯片SAA7111A和靈活可配置的FPG ...
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FPGA SAA7111A 視頻采集
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DSP FPGA 全姿態(tài)指引儀 圖形顯示
采用PCM編碼原理及FPGA編程技術實現(xiàn)PCM數(shù)字基群接口傳輸?shù)退贁?shù)據(jù)的接入一、概述----高速傳輸系統(tǒng)中低速設備的接入有廣泛的應用范圍。在環(huán)境監(jiān)控等監(jiān)控網(wǎng)絡中,被監(jiān)控設備往往提供RS-232/RS-485/V.10/V.35的通信接口,
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PCM FPGA 編碼 編程
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DSP FPGA 光柵 地震檢波器
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DSP FPGA 靈巧干擾平臺
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