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到底強在哪 ARMv8架構(gòu)詳解
- ARM公司宣布推出ARMv8系列處理器 ARM公司近日宣布推出新款A(yù)RMv8架構(gòu)ARM Cortex-A50處理器系列產(chǎn)品，進(jìn)一步擴大ARM在高性能與低功耗領(lǐng)域的領(lǐng)先地位。該系列率先推出的是Cortex-A53與Cortex-A57處理器 以及最新節(jié)能64位處理技術(shù)與現(xiàn)有32位處理技術(shù)的擴展升級。該處理器系列的可擴展性使ARM的合作伙伴能夠針對智能手機、高性能服務(wù)器等各類不同市場需求開發(fā)系統(tǒng)級芯片(SoC)。 ? 發(fā)布的處理器產(chǎn)品將持續(xù)推動移動計算體驗的發(fā)展，提供最多
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一盤大棋！ARM、Imagination瓜分MIPS
- 半年多前傳出消息稱，傳統(tǒng)處理器設(shè)計廠商MIPS正在尋求賣掉自己，而潛在的買家有高通、博通、AMD、Google等等，但最終得手的卻是移動CPU、GPU領(lǐng)域的兩個領(lǐng)頭羊：ARM、Imagination。他倆一個收購專利、一個收購公司，合伙把MIPS給瓜分了個干凈。 MIPS目前擁有專利和專利資產(chǎn)總計580項，其中82項最關(guān)鍵的被稱為“保留專利資產(chǎn)”(Retained Patent Properties)，直接與MIPS處理器架構(gòu)設(shè)計核心有關(guān)，全部歸屬Imagination，
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Cadence宣布使用ARM和IBM工藝技術(shù)流片14納米測試芯片
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)，日前宣布流片了一款14納米測試芯片，使用IBM的FinFET工藝技術(shù)設(shè)計實現(xiàn)了一顆ARM Cortex-M0處理器。這次成功流片是三家技術(shù)領(lǐng)先企業(yè)緊密合作的結(jié)果，他們一起建立了一個產(chǎn)品體系，解決基于14納米FinFET的設(shè)計流程中內(nèi)在的從設(shè)計到生產(chǎn)的過程中出現(xiàn)的新挑戰(zhàn)。
- 關(guān)鍵字： Cadence IBM ARM 芯片
兩大對手瓜分MIPS 誰贏誰輸
- MIPS要被收購這個事情其實也算折騰了挺長的時間，總算是塵埃落定。曾經(jīng)了解過MIPS的歷史，說實話很可惜的是MIPS這么經(jīng)典的處理器架構(gòu)一直沒有真正的商業(yè)化運作到出色，據(jù)說，當(dāng)初MIPS作為最經(jīng)典的RISC還是很有市場價值的，但是一次被收購后的架構(gòu)私有化徹底讓MIPS喪失了市場機遇，并且目送ARM一步步走向成功。而目前只能在專用處理器方面顯示實力的MIPS最大的遺憾
- 關(guān)鍵字： MIPS Imagination ARM 處理器架構(gòu)
FPGA構(gòu)成3/3相雙繞組感應(yīng)發(fā)電機勵磁控制系統(tǒng)
- FPGA構(gòu)成3/3相雙繞組感應(yīng)發(fā)電機勵磁控制系統(tǒng) 1系統(tǒng)簡介3/3相雙繞組感應(yīng)發(fā)電機帶有兩個繞組：勵磁補償繞組和功率繞組，如圖1所示。勵磁補償繞組上接一個電力電子變換裝置，用來提供感應(yīng)發(fā)電機需要的無功功率，使功率繞
- 關(guān)鍵字： FPGA 雙繞組 感應(yīng)發(fā)電機 勵磁控制
智能手機到服務(wù)器64位ARMv8處理器想一鍋端?
- ARM公司日前宣布推出新款64位ARMv8架構(gòu)ARM Cortex-A50處理器系列產(chǎn)品，率先推出的是Cortex-A53與Cortex-A57處理器，以最新節(jié)能64位處理技術(shù)與現(xiàn)有32位處理技術(shù)的擴展升級，首批采用該架構(gòu)的設(shè)備有望于2014年發(fā)貨。目前，AMD、博通、Calxeda、海思(HiSilicon)、三星和意法半導(dǎo)體已獲得Cortex-A50系列架構(gòu)授權(quán)。 ARM有史以來最重要的發(fā)布 ARM首席商務(wù)官Mike Inglis在發(fā)布會上表示，“Cortex-A50處理器
- 關(guān)鍵字： ARM 處理器 Cortex-A50
免費的 I/O：改進(jìn) FPGA 時鐘分配控制(圖)
- 同步數(shù)字系統(tǒng)中的時鐘信號(如遠(yuǎn)程通信中使用的)為系統(tǒng)中的數(shù)據(jù)傳送定義了時間基準(zhǔn)。一個時鐘分配網(wǎng)絡(luò)由多個時鐘信號組成，由一個點將所有信號分配給需要時鐘信號的所有組件。因為時鐘信號執(zhí)行關(guān)鍵的系統(tǒng)功能，很顯然應(yīng)給予更多的關(guān)注，不僅在時鐘的特性(即偏移和抖動)方面，還有那些組成時鐘分配網(wǎng)絡(luò)的組件。 FPGA開發(fā)團隊不斷面臨過于繁瑣、復(fù)雜的時鐘網(wǎng)絡(luò)的挑戰(zhàn)。各種因素，包括不斷增加的I/O需求、降低成本的要求和減少印刷電路板設(shè)計更改的需要，迫使設(shè)計人員重新審視時鐘網(wǎng)絡(luò)。本文將探討FPGA時鐘分配控制方面的挑戰(zhàn)
- 關(guān)鍵字： FPGA 時鐘
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