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          基于ARM的遠(yuǎn)程無(wú)線監(jiān)控系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

          • 摘要:介紹一種自主研發(fā)的高速計(jì)算機(jī)屏幕信息記錄系統(tǒng)。該系統(tǒng)支持VGA/DVI輸入,支持SVGA、XGA、SXGA、UXGA等多 ...
          • 關(guān)鍵字: ARM  程無(wú)線監(jiān)控  PXA270  

          基于ARM和CAN總線的嵌入式PLC設(shè)計(jì)

          • 摘要:為實(shí)現(xiàn)PLC低成本,個(gè)性化的社會(huì)需求,提出一種嵌入式PLC設(shè)計(jì)方案,重點(diǎn)討論了系統(tǒng)的總體構(gòu)成以及軟、硬件設(shè)計(jì) ...
          • 關(guān)鍵字: ARM  CAN總線  PLC  

          Linux基礎(chǔ)架構(gòu)在晶心平臺(tái)上的移植研究

          • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
          • 關(guān)鍵字: FPGA  Linux  基礎(chǔ)架構(gòu)  

          在低端FPGA中實(shí)現(xiàn)LVDS接口設(shè)計(jì)中的DPA功能

          • 在FPGA中,動(dòng)態(tài)相位調(diào)整(DPA)主要是實(shí)現(xiàn)LVDS接口接收時(shí)對(duì)時(shí)鐘和數(shù)據(jù)通道的相位補(bǔ)償,以達(dá)到正確接收的目的。ALTERA的高端FPGA,如STRATIX(r) 系列中自帶有DPA電路,但低端的FPGA,如CYCLONE(r)系列中是沒(méi)有的。本文主
          • 關(guān)鍵字: FPGA  LVDS  DPA  低端    

          利用FPGA實(shí)現(xiàn)與DS18B20的通信功能

          • DS18B20是DALLAS公司生產(chǎn)的一線式數(shù)字溫度傳感器,采用3引腳TO-92型小體積封裝;溫度測(cè)量范圍為-55℃~+125℃,可編程為9位~12位A/D轉(zhuǎn)換精度,測(cè)溫分辨率可達(dá)0.0625℃,被測(cè)溫度用符號(hào)擴(kuò)展的16位數(shù)字量方式串行輸出
          • 關(guān)鍵字: FPGA  18B  B20  DS    

          從開(kāi)發(fā)的角度看FPGA/DSP設(shè)計(jì)的區(qū)別

          • Q1:FPGA設(shè)計(jì)與DSP設(shè)計(jì)相比,最大的不同之處在哪里?A1:這個(gè)問(wèn)題要從多個(gè)角度看。它們都用于某個(gè)功能的硬件電路實(shí)現(xiàn),但是它們的側(cè)重點(diǎn)有所不同。這里涵蓋的說(shuō)一下。1) 內(nèi)部資源FPGA側(cè)重于設(shè)計(jì)具有某個(gè)功能的硬件電
          • 關(guān)鍵字: FPGA  DSP  角度    

          基于MCU/FPGA的多功能正弦信號(hào)發(fā)生器的設(shè)計(jì)

          • 在通信、廣播、電視系統(tǒng)中,都需要射頻發(fā)射,即載波,把音頻、視頻信號(hào)或脈沖信號(hào)運(yùn)載出去,這就需要能產(chǎn)生高頻信號(hào)的振蕩器。正弦波振蕩電路在各個(gè)科學(xué)技術(shù)部門(mén)的應(yīng)用是十分廣泛的。在工業(yè)、農(nóng)業(yè)、生物醫(yī)學(xué)等領(lǐng)域(如
          • 關(guān)鍵字: FPGA  MCU  多功能  正弦信號(hào)發(fā)生器    

          基于ARM處理器的SMTP協(xié)議的嵌入式遠(yuǎn)程通訊模式實(shí)現(xiàn)

          • 基于ARM處理器的SMTP協(xié)議的嵌入式遠(yuǎn)程通訊模式實(shí)現(xiàn),在本課題中,通過(guò)SMTP協(xié)議的方式提供了一種新的嵌入式遠(yuǎn)程通訊模式。即在ARM處理器中實(shí)現(xiàn)SMTP協(xié)議,并通過(guò)雙絞線連接到Internet上。在該平臺(tái)上開(kāi)發(fā)的遠(yuǎn)程控制設(shè)備或儀器儀表實(shí)現(xiàn)了通過(guò)Internet進(jìn)行數(shù)據(jù)的遠(yuǎn)程傳輸,在
          • 關(guān)鍵字: 遠(yuǎn)程  通訊  模式  實(shí)現(xiàn)  嵌入式  協(xié)議  ARM  處理器  SMTP  基于  

          采用WCDMA速率適配算法的FPGA設(shè)計(jì)

          • 采用WCDMA速率適配算法的FPGA設(shè)計(jì),隨著因特網(wǎng)爆炸性的增長(zhǎng)以及各種無(wú)線業(yè)務(wù)需求的增加,傳統(tǒng)的無(wú)線通信網(wǎng)已經(jīng)越來(lái)越無(wú)法適應(yīng)人們的需要。因此,以大容量、高數(shù)據(jù)率和承載多媒體業(yè)務(wù)為目的的第三代移動(dòng)通信系統(tǒng)(IMT-2000)應(yīng)運(yùn)而生。碼分多址(CDMA)由于
          • 關(guān)鍵字: FPGA  設(shè)計(jì)  算法  適配  WCDMA  速率  采用  

          ARM/DSP多機(jī)I2C通信方案

          • ARM/DSP多機(jī)I2C通信方案,引言在很多嵌入式控制系統(tǒng)中,系統(tǒng)既要完成大量的信息采集和復(fù)雜的算法,又要實(shí)現(xiàn)精確的控制功能。采用運(yùn)行有嵌入式Linux操作系統(tǒng)的ARM9微控制器完成信號(hào)采集及實(shí)現(xiàn)上層控制算法,并向DSP芯片發(fā)送上層算法得到控制參
          • 關(guān)鍵字: 方案  通信  I2C  多機(jī)  ARM/DSP  

          基于FPGA的LVDS內(nèi)核設(shè)計(jì)及其外圍電路設(shè)計(jì)

          • 低壓差分信號(hào)LVDS(Low Voltage Differential Signal)是由ANSI/TIA/EIA-644-1995定義的用于高速數(shù)據(jù)傳輸?shù)奈锢韺咏涌跇?biāo)準(zhǔn)。它具有超高速(1.4Gb/s)、低功耗及低電磁輻射的特性,是在銅介質(zhì)上實(shí)現(xiàn)千兆位級(jí)高速通信的
          • 關(guān)鍵字: 及其  外圍  電路設(shè)計(jì)  設(shè)計(jì)  內(nèi)核  FPGA  LVDS  基于  

          基于微處理器的FPGA的在線可重配置

          • 基于微處理器的FPGA的在線可重配置,可編程邏輯器件(PLD)廣泛應(yīng)用在各種電路設(shè)計(jì)中?;诓檎冶砑夹g(shù)、SRAM工藝的大規(guī)模PLD/FPGA,密度高且觸發(fā)器多,適用于復(fù)雜的時(shí)序邏輯,如數(shù)字信號(hào)處理和各種算法的設(shè)計(jì)。類器件使用SRAM單元存儲(chǔ)配置數(shù)據(jù)。配置數(shù)據(jù)
          • 關(guān)鍵字: 配置  在線  FPGA  微處理器  基于  

          對(duì)FPGA設(shè)計(jì)進(jìn)行編程并不困難

          • 對(duì)FPGA設(shè)計(jì)進(jìn)行編程并不困難,硬件設(shè)計(jì)者已經(jīng)開(kāi)始在高性能DSP的設(shè)計(jì)中采用FPGA技術(shù),因?yàn)樗梢蕴峁┍然赑C或者單片機(jī)的解決方法快上10-100倍的運(yùn)算量。以前,對(duì)硬件設(shè)計(jì)不熟悉的軟件開(kāi)發(fā)者們很難發(fā)揮出FPGA的優(yōu)勢(shì),而如今基于C語(yǔ)言的方法可以讓
          • 關(guān)鍵字: 困難  編程  進(jìn)行  設(shè)計(jì)  FPGA  

          YUV分離的兩種FPGA實(shí)現(xiàn)

          • 摘要:速度與面積的互換一直是基于FPGA設(shè)計(jì)中的一個(gè)不變的主題,在此介紹了兩種YUV分離的FPGA的實(shí)現(xiàn)方式:基于面積的實(shí)現(xiàn)和基于速度的實(shí)現(xiàn)。前者僅用一片雙口RAM串行,實(shí)現(xiàn)了YUV分離數(shù)據(jù)的輸出;后者利用流水線的思想
          • 關(guān)鍵字: FPGA  YUV  分離    

          混合信號(hào)FPGA實(shí)現(xiàn)真正單芯片SOC

          • 要實(shí)現(xiàn)能夠?qū)⑺兄匾δ芗稍趩我黄骷脑O(shè)計(jì)理由很簡(jiǎn)單,因?yàn)檫@樣就能將材料成本、部件庫(kù)存及電路板面積減至最低。另外,相較于多芯片解決方案,單芯片方案的功耗也較低,同時(shí)也有助于提高對(duì)知識(shí)產(chǎn)權(quán)的保護(hù)。如果
          • 關(guān)鍵字: FPGA  SOC  混合信號(hào)  單芯片    
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