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          基于FPGA的嵌入式PLC微處理器設(shè)計(jì)

          • 基于FPGA的嵌入式PLC微處理器設(shè)計(jì),前言  現(xiàn)場可編程門陣列(FPGA)是近幾年來出現(xiàn)并被廣泛應(yīng)用的大規(guī)模集成電路器件,它的特點(diǎn)是直接面向用戶,具有極大的靈活性和通用性使用方便,硬件測試和實(shí)現(xiàn)快捷,開發(fā)效率高,成本低,上市時(shí)間短,技術(shù)維護(hù)簡單
          • 關(guān)鍵字: 微處理器  設(shè)計(jì)  PLC  嵌入式  FPGA  基于  

          基于FPGA的可重構(gòu)智能儀器設(shè)計(jì)

          • 基于FPGA的可重構(gòu)智能儀器設(shè)計(jì),引言  傳統(tǒng)測試系統(tǒng)由于專用性強(qiáng)、相互不兼容、擴(kuò)展性差、缺乏通用化、模塊化,不能共享 軟硬件組成,不僅使開發(fā)效率低下,而且使得開發(fā)一套復(fù)雜測試系統(tǒng)的價(jià)格高昂[1]。 目前,傳統(tǒng)的分析儀表正在更新?lián)Q代,向數(shù)字
          • 關(guān)鍵字: 儀器  設(shè)計(jì)  智能  重構(gòu)  FPGA  基于  

          AT91系列ARM硬件設(shè)計(jì)筆記

          • AT91系列ARM硬件設(shè)計(jì)筆記, 電源問題  1.VDDCORE和VDDIO引腳電源  A)VDDCORE和VDDIO引腳電源必須連接到使用退耦電容的干凈的直流電源上;退耦電容應(yīng)盡可能的接近微控制器的VDD和GND引腳;退耦電容典型值是33nF到100nF?! )除保證復(fù)位的延
          • 關(guān)鍵字: 設(shè)計(jì)  筆記  硬件  ARM  系列  AT91  

          采用FPGA的紅外密集度光電立靶測試系統(tǒng)

          • 光電靶的基本原理是:當(dāng)光幕內(nèi)的光通量發(fā)生足夠大的變化時(shí),光電傳感器會響應(yīng)這種變化而產(chǎn)生電信號。這就是說,一些非彈丸物體在穿過光幕時(shí)也會使得光幕內(nèi)光通量發(fā)生變化以至光電傳感器產(chǎn)生電信號。從原理上,這種現(xiàn)
          • 關(guān)鍵字: FPGA  紅外  光電立靶  測試系統(tǒng)    

          基于ARM與μClinux系統(tǒng)的RTU設(shè)計(jì)

          • 在電力系統(tǒng)變電所以及電氣化鐵道牽引變電所遠(yuǎn)動控制系統(tǒng)中,遠(yuǎn)程數(shù)據(jù)采集與監(jiān)控終端(RTU)是關(guān)鍵設(shè)備,實(shí)現(xiàn)遙控...
          • 關(guān)鍵字: ARM  μClinux  RTU設(shè)計(jì)  

          為軟件工程師揭開 FPGA 的神秘面紗

          • 隨著產(chǎn)品設(shè)計(jì)復(fù)雜性的增加,需要使用集成組件(如ASSP)來滿足設(shè)計(jì)上的要求。幾年前,工程師會針對處理器、存儲器和外設(shè)選擇單獨(dú)的組件,然后通過分立邏輯器件將這些元素拼合到一起。后來,他們會搜索ASSP處理系統(tǒng)目
          • 關(guān)鍵字: FPGA  軟件工程師    

          基于DSP和FPGA的機(jī)載總線接口板研究

          • 基于DSP和FPGA的機(jī)載總線接口板研究,目前國內(nèi)對民用飛機(jī)機(jī)載數(shù)據(jù)總線ARINC429接口板的設(shè)計(jì)一般都是基于HARRIS公司的HS3282芯片完成的,它的缺點(diǎn)是路數(shù)有限、非常不靈活。因此對ARINC429總線接口板的研制,實(shí)現(xiàn)多通道ARINC429總線數(shù)據(jù)的接收和發(fā)送,成為
          • 關(guān)鍵字: 接口  研究  總線  機(jī)載  DSP  FPGA  基于  

          淺析FPGA將在4G系統(tǒng)中地位非淺

          • 除了語音連接之外,數(shù)字蜂窩無線網(wǎng)絡(luò)(如GSM和增強(qiáng)的GSM-EDGE)現(xiàn)在可以提供更高的數(shù)據(jù)傳輸速率,理論上可達(dá)到384 ...
          • 關(guān)鍵字: FPGA  4G  

          基于FPGA的系統(tǒng)易測試性的研究

          • 基于FPGA的系統(tǒng)易測試性的研究,引 言
              現(xiàn)代科技對系統(tǒng)的可靠性提出了更高的要求,而FPGA技術(shù)在電子系統(tǒng)中應(yīng)用已經(jīng)非常廣泛,因此FPGA易測試性就變得很重要。要獲得的FPGA內(nèi)部信號十分有限、FPGA封裝和印刷電路板(PCB)電氣噪聲,這一切使得設(shè)計(jì)
          • 關(guān)鍵字: 研究  測試  系統(tǒng)  FPGA  基于  

          基于FPGA的串口屏方案應(yīng)用

          • 本文主要介紹一個(gè)基于串口屏、M0單片機(jī)、微打模塊、讀卡模塊的充電樁應(yīng)用方案。此方案模擬了真實(shí)充電樁的絕大部分功能,通過使用本方案,設(shè)備制造商便能在短周期內(nèi)完成整個(gè)充電樁的設(shè)計(jì),迅速占領(lǐng)市場并取得成功。
          • 關(guān)鍵字: FPGA  單片機(jī)  TinyM0-CAN  201109  

          使用Xilinx公司的Spartan-6 FPGA作DDR芯片測試

          • 使用Xilinx公司的Spartan-6 FPGA系列芯片所提供的MCB,在生成控制模塊時(shí)設(shè)置不同參數(shù),可以輕而易舉的實(shí)現(xiàn)對不同型號的DDR存儲芯片的測試,數(shù)據(jù)率可高達(dá)800Mb/s以上。由于時(shí)間利用率比使用計(jì)算機(jī)主板測試DDR芯片高得多,所以可以極大地節(jié)約測試時(shí)間。
          • 關(guān)鍵字: Xilinx  FPGA  DDR  201109  

          Altera推出業(yè)界第一款Serial RapidIO Gen2解決方案

          • 2011年9月27號,北京——Altera公司 (NASDAQ: ALTR) 今天宣布,開始提供業(yè)界第一款基于Serial RapidIO Gen2 FPGA的解決方案,進(jìn)一步提高下一代3G和4G無線基站的帶寬,鏈路更加靈活。Altera成功的實(shí)現(xiàn)了Stratix IV GX FPGA中的RapidIO MegaCore 功能IP內(nèi)核與集成器件技術(shù)公司 (IDT) Serial RapidIO Gen 2交換機(jī)的互操作性。Altera成熟的Serial RapidIO Gen2解決方案為高性能通信系統(tǒng)中
          • 關(guān)鍵字: Altera  FPGA  

          基于FPGA的信號發(fā)生器設(shè)計(jì)

          • 基于FPGA的信號發(fā)生器設(shè)計(jì),以FPGA 芯片為載體, 通過QuartusII 的LPM_ROM 模塊和VHDL 語言為核心設(shè)計(jì)一個(gè)多功能信號發(fā)生器,根據(jù)輸入信號的選擇可以輸出遞增鋸齒波、遞減鋸齒波、三角波、階梯波和方波等5 種信號,通過QuartusII 軟件進(jìn)行波形仿
          • 關(guān)鍵字: 設(shè)計(jì)  信號發(fā)生器  FPGA  基于  

          LabVIEW FPGA模塊實(shí)現(xiàn)FIFO深度設(shè)定

          • 為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來的數(shù)據(jù)不連續(xù)問題,結(jié)合LabVIEWFPGA的編程特點(diǎn)和DMA FIFO的工作原理,提出了一種設(shè)定FIFO深度的方法。對FIFO不同深度的實(shí)驗(yàn)表明,采用該方法設(shè)定的FIFO深度能夠
          • 關(guān)鍵字: LabVIEW  FPGA  FIFO  模塊    

          FPGA與GPS_OEM板的UART設(shè)計(jì)

          • 本文提出了一種基于FPGA的嵌入式UART模塊化設(shè)計(jì)方法,通過UART實(shí)現(xiàn)了FPGA與GPS_OEM板之間的數(shù)據(jù)通信?;赩HDL語言,通過有限狀態(tài)機(jī),將UART模塊集成到FPGA上,給出了系統(tǒng)的功能仿真結(jié)果,驗(yàn)證了系統(tǒng)設(shè)計(jì)的正確性,增強(qiáng)了設(shè)計(jì)的靈活性。
          • 關(guān)鍵字: FPGA  UART  201109  
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