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基于ARM和WinSock的多人對戰(zhàn)游戲平臺設(shè)計

基于ARM和WinSock的多人對戰(zhàn)游戲平臺設(shè)計,摘要：具有多機互聯(lián)對戰(zhàn)功能的開放式便攜游戲機具有廣闊的應(yīng)用價值和深遠(yuǎn)的發(fā)展空間。以SAMSUNG公司基于ARM920T的處理器S3C2410為核心，嵌入WinCE 5．0操作系統(tǒng)，在VS2008開發(fā)環(huán)境下創(chuàng)建智能設(shè)備MFC工程，并將在Win3
關(guān)鍵字：平臺設(shè)計游戲多人 ARM WinSock 基于

基于FPGA的IP核8051上實現(xiàn)TCP/IP的設(shè)計

該便攜式接觸網(wǎng)故障信號分析儀采用圖形化程序設(shè)計語言LabVIEW開發(fā)設(shè)計, 可實現(xiàn)數(shù)據(jù)的高速實時采集、在線分析、自動存儲、顯示等功能。高速數(shù)字化儀NI PXI- 5112卡采樣速度高、性能穩(wěn)定可靠, 適宜對高速變化信號的實時監(jiān)測。將軟件安裝在PXI- 1042工控機上, 具有體積小、抗干擾能力強、攜帶方便等特點, 同時具有故障性質(zhì)判斷、故障定位功能。該系統(tǒng)目前已經(jīng)在石家莊變電所現(xiàn)場運行, 效果良好。
關(guān)鍵字： FPGA 8051 TCP IP

基于FPGA的智能變送器的設(shè)計與實現(xiàn)

摘要：根據(jù)工業(yè)應(yīng)用的實際需要以及網(wǎng)絡(luò)通信發(fā)展的功能要求，提出了基于FPGA智能變送器控制系統(tǒng)的總體方案，設(shè)計了以XILINX公司的Spartan3系列XC3S4005PO208C可編程邏輯器件為主控制器、DM9000A為以太網(wǎng)通信接口、SJA
關(guān)鍵字： FPGA 智能變送器

FPGA控制下面陣CCD時序發(fā)生器設(shè)計及硬件實現(xiàn)

摘要在分析Sony公司ICX098BQ面陣CCD圖像傳感器驅(qū)動時序的基礎(chǔ)上，對可調(diào)節(jié)曝光時間的CCD時序發(fā)生器及其硬件電路進行設(shè)計。選用FPGA器件作為硬件設(shè)計平臺，使用VHDL語言對時序關(guān)系進行了硬件描述。采用QuartusII 8.0
關(guān)鍵字： FPGA CCD 面陣發(fā)生器

符合中國移動標(biāo)準(zhǔn)協(xié)議轉(zhuǎn)換器中的HDLC協(xié)議的FPGA設(shè)計與實現(xiàn)

隨著通信與網(wǎng)絡(luò)技術(shù)的不斷發(fā)展，使我國用現(xiàn)有的E1資源來傳輸以太網(wǎng)業(yè)務(wù)成為廣泛的應(yīng)用。以太網(wǎng)數(shù)據(jù)要通過E1線路傳輸就必須對以太網(wǎng)凈荷數(shù)據(jù)進行幀封裝，才能從E1線路上恢復(fù)出以太網(wǎng)數(shù)據(jù)幀，完成以太網(wǎng)數(shù)據(jù)的交換。通常，以太網(wǎng)數(shù)據(jù)是通過HDLC協(xié)議或GFP協(xié)議來進行封裝的。本文介紹了中國移動標(biāo)準(zhǔn)協(xié)議轉(zhuǎn)換器中以太網(wǎng)到單路E1轉(zhuǎn)換器HDLC協(xié)議封裝的FPGA（現(xiàn)場可編程邏輯陣列）設(shè)計與實現(xiàn)。
關(guān)鍵字：中國移動 FPGA 201106

基于ARM Cortex-M3的MODBUS協(xié)議實現(xiàn)及其應(yīng)用

基于ARM Cortex-M3的MODBUS協(xié)議實現(xiàn)及其應(yīng)用,摘要針對變頻器通信應(yīng)用，介紹了MODBUS協(xié)議的特點及其組成；設(shè)計了RS485電路接口；并以ARMCortex-M3微控制器為核心，設(shè)計了MODBUS協(xié)議的實現(xiàn)方案。針對變頻器F2000-G開發(fā)了嵌入式系統(tǒng)．實現(xiàn)變頻調(diào)速功能，應(yīng)用于無損
關(guān)鍵字：實現(xiàn) 及其應(yīng)用協(xié)議 MODBUS ARM Cortex-M3 基于

基于FPGA的NAND Flash ECC校驗

摘要基于Flash存儲器的Hamming編碼原理，在Altera QuartusⅡ7．0開發(fā)環(huán)境下，實現(xiàn)ECC校驗功能。測試結(jié)果表明，該程序可實現(xiàn)每256 Byte數(shù)據(jù)生成3 Byte的ECC校驗數(shù)據(jù)，能夠檢測出1 bit錯誤和2 bit錯誤，對于1 bit錯誤
關(guān)鍵字： Flash FPGA NAND ECC

基于ARM的微伏信號在線監(jiān)測系統(tǒng)設(shè)計

基于ARM的微伏信號在線監(jiān)測系統(tǒng)設(shè)計,1　　引言　　在線監(jiān)測系統(tǒng)中，待測信號幅值在50mu;V左右，而背景噪聲幅值在50mV以上，用一般的采集和測量系統(tǒng)無法準(zhǔn)確檢測該信號。針對被背景噪聲覆蓋的微小信號，采用濾波降噪和差分放大手段，提高信噪比，保證待
關(guān)鍵字：系統(tǒng) 設(shè)計監(jiān)測在線 ARM 信號基于

ARM中斷處理的研究

ARM中斷處理的研究,在嵌入式系統(tǒng)中常用的RISC處理器是ARM核，它具有體積小、功耗低、成本低、性價比高的特點。然而，不管是哪種型號的ARM處理器，也無論該嵌入式系統(tǒng)中是否有操作系統(tǒng)，中斷處理，特別是IRQ中斷，始終是必須的，而中斷處
關(guān)鍵字：研究處理中斷 ARM

一種基于ARM 的FPGA可重構(gòu)配置方法的實現(xiàn)及應(yīng)用

隨著半導(dǎo)體工藝技術(shù)的迅猛發(fā)展，現(xiàn)場可編程邏輯器件FPGA的集成度迅速提高，已達(dá)到百萬門量級，與此同時，F(xiàn)PGA中的邏 ...
關(guān)鍵字： ARM FPGA 加載配置

IIR數(shù)字濾波器的Matlab和FPGA實現(xiàn)

摘要：提出一種通過兩個二階節(jié)級聯(lián)構(gòu)成四階IIR數(shù)字橢圓濾波器的設(shè)計方法，并利用Matlab仿真軟件設(shè)計了通帶內(nèi)波紋不大于0．1 dB，阻帶衰減不小于42 dB的IIR數(shù)字濾波器。論述了一種采用可編程邏輯器件，通過VHDL硬件描
關(guān)鍵字： Matlab FPGA IIR 數(shù)字濾波器

FPGA時鐘設(shè)計

摘要：在FPGA設(shè)計中，為了成功地操作，可靠的時鐘是非常關(guān)鍵的。設(shè)計不良的時鐘在極限的溫度、電壓下將導(dǎo)致錯誤的行為。在設(shè)計PLD／FPGA時通常采用如下四種類型時鐘：全局時鐘、門控時鐘、多級邏輯時鐘和波動式時鐘。
關(guān)鍵字： FPGA 時鐘設(shè)計

基于FPGA的自適應(yīng)波束形成算法實現(xiàn)

　1 引言　　在雷達(dá)及聲納信號處理系統(tǒng)中，波束形成算法通常采用DSP軟件編程實現(xiàn)，控制邏輯電路采用CPLD來完成，這種方法具有軟件編程靈活、功能易于擴展的優(yōu)點，但對于實時性能要求很高的系統(tǒng)，如雷達(dá)、聲納探測和
關(guān)鍵字： FPGA 自適應(yīng)波束算法

基于FPGA的實時中值濾波器硬件實現(xiàn)

針對高清圖像在中值濾波預(yù)處理過程中排序量多、速度慢的特點，提出適合鄰域圖像并行處理機的分塊存儲方法。在流水線結(jié)構(gòu)下，1個時鐘周期可以并行處理32個3×3鄰域的中值濾波運算，實現(xiàn)了高速、實時的1 920×1 080灰度圖像中值濾波器。
關(guān)鍵字： FPGA 中值濾波硬件實現(xiàn)

基于ARM和DSP架構(gòu)的多處理器高速通訊協(xié)議設(shè)計

　　目前，建立在寬帶網(wǎng)絡(luò)的多媒體應(yīng)用日漸增多，高性能的DSP也不斷推陳出新，由于DSP具備非常靈活的編程運算能力 ...
關(guān)鍵字： ARM DSP架構(gòu) 多處理器高速通訊

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利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設(shè)計的方法
基于FPGA的機載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計與實現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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