fpga+arm 文章進(jìn)入fpga+arm技術(shù)社區(qū)

基于ARM的FPGA加載配置實(shí)現(xiàn)

引言基于SRAM工藝FPGA在每次上電后需要進(jìn)行配置，通常情況下FPGA的配置文件由片外專用的EPROM來(lái)加載。這種傳統(tǒng)配置方式是在FPGA的功能相對(duì)穩(wěn)定的情況下采用的。在系統(tǒng)設(shè)計(jì)要求配置速度高、容量大、以及遠(yuǎn)程升級(jí)時(shí)，這種方法就顯得很不實(shí)際也不方便。本文介紹了通過(guò)ＡＲＭ對(duì)可編程器件進(jìn)行配置的的設(shè)計(jì)和實(shí)現(xiàn)。 1 配置原理與方式 1.1 配置原理在FPGA正常工作時(shí)，配置數(shù)據(jù)存儲(chǔ)在SRAM單元中，這個(gè)SRAM單元也被稱為配置存儲(chǔ)（Configuration RAM）。由于SRAM是易失性的存
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基于SYSTEM C的FPGA設(shè)計(jì)方法

一、概述隨著VLSI的集成度越來(lái)越高，設(shè)計(jì)也越趨復(fù)雜。一個(gè)系統(tǒng)的設(shè)計(jì)往往不僅需要硬件設(shè)計(jì)人員的參與，也需要有軟件設(shè)計(jì)人員的參與。軟件設(shè)計(jì)人員與硬件設(shè)計(jì)人員之間的相互協(xié)調(diào)就變的格外重要，它直接關(guān)系到工作的效率以及整個(gè)系統(tǒng)設(shè)計(jì)的成敗。傳統(tǒng)的設(shè)計(jì)方法沒(méi)有使軟件設(shè)計(jì)工作與硬件設(shè)計(jì)工作協(xié)調(diào)一致，而是將兩者的工作割裂開(kāi)來(lái)。軟件算法的設(shè)計(jì)人員在系統(tǒng)設(shè)計(jì)后期不能為硬件設(shè)計(jì)人員的設(shè)計(jì)提供任何的幫助。同時(shí)現(xiàn)在有些大規(guī)模集成電路設(shè)計(jì)中往往帶有DSP Core或其它CPU Core。這些都使得單
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基于ARM智能交通信號(hào)機(jī)控制板開(kāi)發(fā)

信號(hào)機(jī)是一個(gè)典刑的嵌入式系統(tǒng)，嵌入式系統(tǒng)是以應(yīng)用為中心來(lái)設(shè)計(jì)，對(duì)功能、性能、可靠性、成本、功耗、體積等有嚴(yán)格的要求，既要滿足智能交通系統(tǒng)對(duì)信號(hào)機(jī)智能化、多功能的要求，又要最大化信號(hào)機(jī)的性價(jià)比，因此本設(shè)計(jì)選擇基于ARM核的32位嵌入式RISC處理器——AT91RM9200來(lái)完成智能交通信號(hào)機(jī)控制板的硬件設(shè)計(jì)，以達(dá)到使信號(hào)機(jī)在交通系統(tǒng)中成為收集與處理交通流量數(shù)據(jù)、通信聯(lián)網(wǎng)以及區(qū)域協(xié)調(diào)控制平臺(tái)的設(shè)計(jì)目標(biāo)。 1 引言 &
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基于DSP+FPGA結(jié)構(gòu)的小波圖像處理系統(tǒng)設(shè)計(jì)

介紹了一種基于DSP+FPGA結(jié)構(gòu)的小波圖像處理系統(tǒng)設(shè)計(jì)方案，以高性能數(shù)字信號(hào)處理器ADSP—BF535作為核心，結(jié)合現(xiàn)場(chǎng)可編程門(mén)陣列FPGA，實(shí)現(xiàn)了實(shí)時(shí)數(shù)字圖像處理。　　小波分析是近年迅速發(fā)展起來(lái)的新興學(xué)科，與Fourier分析和Gabor變換相比，小波變換是時(shí)間(空間)頻率的局部化分析，它通過(guò)伸縮平移運(yùn)算對(duì)信號(hào)逐步進(jìn)行多尺度細(xì)化，最終達(dá)到高頻處時(shí)間細(xì)分和低頻處頻率細(xì)分，能自動(dòng)適應(yīng)時(shí)頻信號(hào)分析的要求，從而可聚焦到信號(hào)的任意細(xì)節(jié)．解決了Fourier分
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FPGA在智能儀表中的應(yīng)用

隨著微電子技術(shù)的發(fā)展，采用現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)進(jìn)行數(shù)字信號(hào)處理得到了飛速發(fā)展。由于FPGA具有現(xiàn)場(chǎng)可編程的特點(diǎn)，可以實(shí)現(xiàn)專用集成電路，因此越來(lái)越受到硬件電路設(shè)計(jì)工程師們的青睞。目前，在自動(dòng)化監(jiān)測(cè)與控制儀器和裝置中，大多以8位或16位MCU為核心部件。然而伴隨著生產(chǎn)技術(shù)的進(jìn)步和發(fā)展，對(duì)監(jiān)測(cè)與控制的要求也在不斷提高，面對(duì)日益復(fù)雜的監(jiān)測(cè)對(duì)象和控制算法，傳統(tǒng)的MCU往往不堪重負(fù)。把FPGA運(yùn)用到這些儀表和設(shè)備中，可以減少這些儀器、設(shè)備的開(kāi)發(fā)周期，大幅度提升這些儀器的性能，減少總成本和體積。在低阻值
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億道國(guó)內(nèi)率先推出基于WinCE6.0的ARM開(kāi)發(fā)平臺(tái)

Windows Embedded Seminar全球系列研討會(huì)在深圳圣廷苑酒店三層錦繡廳首站告捷后勢(shì)不可擋再度出擊，微軟OEM全球技術(shù)盛典—Windows Embedded Seminar研討會(huì)上海分會(huì)于2007年4月17日早上九點(diǎn)半在上海揚(yáng)子江萬(wàn)麗大酒店三層碧華殿再次成功召開(kāi)。眾多相關(guān)領(lǐng)域的決策者、開(kāi)發(fā)者、商業(yè)決策者都前來(lái)出席這次會(huì)議，整個(gè)現(xiàn)場(chǎng)人頭攢動(dòng)熱鬧非凡。上海億道電子技術(shù)有限公司也以嶄新的姿態(tài)出席了此次盛會(huì)，并
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FPGA在衛(wèi)星數(shù)字電視碼流轉(zhuǎn)發(fā)器設(shè)計(jì)中的應(yīng)用

1 引言由于數(shù)字電視能提供更清晰的圖像、更逼真的聲音、更大的屏幕，以及數(shù)字化傳輸方式所特有的高效數(shù)據(jù)傳輸率，可以在有限的傳輸頻帶內(nèi)傳送更多的電視節(jié)目，正成為數(shù)字化視聽(tīng)技術(shù)發(fā)展的一個(gè)新方向。作為數(shù)字電視前端設(shè)備中的衛(wèi)星數(shù)字電視碼流轉(zhuǎn)發(fā)器，簡(jiǎn)稱為碼流機(jī)，其主要功能就是接收頻率為950～2 150 MHz的國(guó)內(nèi)外數(shù)字衛(wèi)星節(jié)目信號(hào)進(jìn)行QPSK解調(diào)，并轉(zhuǎn)換成ASI格式的MPEG-2傳輸流，輸出給TS流復(fù)用器、QAM調(diào)制器等前端設(shè)備處理后發(fā)射到數(shù)字電視終端用戶，即相當(dāng)于有線電視臺(tái)轉(zhuǎn)播節(jié)目的信號(hào)源；同時(shí)他還輸出
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IEC 61131-3標(biāo)準(zhǔn)與ARM嵌入式控制系統(tǒng)

IEC 61131-3標(biāo)準(zhǔn)與ARM嵌入式控制系統(tǒng),介紹IEC 61131-3國(guó)際標(biāo)準(zhǔn)、ARM微處理器和嵌入式系統(tǒng)；研究基于AT91M55800A微處理器和IEC6113l-3標(biāo)準(zhǔn)的嵌入式實(shí)時(shí)控制系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)技術(shù)，并給出詳細(xì)的串口通信程序。
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Altera宣布基于FPGA的加速器支持Intel前端總線

　　Altera公司宣布，XtremeData在其XD2000i可插入式FPGA協(xié)處理器模塊中選用了高性能Stratix® III FPGA，該模塊支持Intel的前端總線(FSB)。基于Intel Xeon處理器的服務(wù)器采用這一高性能計(jì)算方案后，能夠進(jìn)一步增強(qiáng)處理能力。該模塊可直接插入雙插槽或者四插槽服務(wù)器的處理插槽中。與單個(gè)處理器相比，其加速性能提高了10倍到100倍，同時(shí)降低了系統(tǒng)總功耗。　　XtremeData公司CEO Ravi Chandran評(píng)論說(shuō)：“在高性能計(jì)算市場(chǎng)應(yīng)用中，St
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ARM筆記-寄存器以及模式特點(diǎn)

ARM微處理器支持7種運(yùn)行模式，分別為：1.用戶模式（usr）：ARM處理器正常的程序執(zhí)行狀態(tài)；2. 快速中斷模式（fiq）：用于高速數(shù)據(jù)傳輸或通道管理；3. 外部中斷模式（irq）：用于通用的中斷處理；4. 管理模式（svc）：操作系統(tǒng)使用的保護(hù)模式；5. 數(shù)據(jù)訪問(wèn)終止模式（abt）：當(dāng)數(shù)據(jù)或指令預(yù)取終止時(shí)進(jìn)入該模式，用于虛擬存儲(chǔ)及存儲(chǔ)保護(hù)；6. 系統(tǒng)模式（sy
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ARM中斷處理流程

1．寄存器R16用作CPSR(Current Program Status Register，當(dāng)前程序狀態(tài)寄存器)，CPSR可在任何運(yùn)行模式下被訪問(wèn)，它包括條件標(biāo)志位、中斷禁止位、當(dāng)前處理器模式標(biāo)志位，以及其他一些相關(guān)的控制和狀態(tài)位。每一種運(yùn)行模式下又都有一個(gè)專用的物理狀態(tài)寄存器，稱為SPSR（Saved Program Status Register，備份的程序狀態(tài)寄存器），當(dāng)異常發(fā)生時(shí)，SPSR用于保存CPSR的當(dāng)前值，從異常退出時(shí)則可由SPSR來(lái)恢復(fù)CPSR。由于用戶模式和系統(tǒng)模式不屬于
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利用Altera增強(qiáng)型配置片實(shí)現(xiàn)FPGA動(dòng)態(tài)配置

1. 引言在當(dāng)今復(fù)雜數(shù)字電路設(shè)計(jì)中，大多采用以"嵌入式微控制器+FPGA"為核心的體系結(jié)構(gòu)此體系結(jié)構(gòu)中FPGA配置效率和靈活性的差異影響了產(chǎn)品的開(kāi)周期和產(chǎn)品升級(jí)的易施性。傳統(tǒng)的FPGA配置方案(例如調(diào)試階段的專用下載電纜方式。成品階段的專用配置片方式)在成本、效率、靈活性方面都存在著明顯不足。針對(duì)這樣的實(shí)際問(wèn)題，基于嵌入式微控制器與FPGA廣泛共存于復(fù)雜數(shù)字系統(tǒng)的背景，借鑒軟件無(wú)線電"一機(jī)多能"的思想，提出了一種對(duì)現(xiàn)有傳統(tǒng)FPGA配置方案硬件電路稍做調(diào)整并增加部分軟件功能。即可實(shí)現(xiàn)FPGA動(dòng)態(tài)配置的方
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JPEG2000中嵌入式塊編碼的FPGA設(shè)計(jì)

隨著多媒體市場(chǎng)的迅猛發(fā)展，百萬(wàn)像素的數(shù)碼相機(jī)、各種功能強(qiáng)大的彩屏手機(jī)等數(shù)字消費(fèi)產(chǎn)品逐漸普及。這些多媒體應(yīng)用均需要處理高質(zhì)量、高分辨率的大圖像，這對(duì)存儲(chǔ)介質(zhì)的容量和傳輸信道的帶寬都提出了新要求。圖像壓縮的國(guó)際標(biāo)準(zhǔn)JPEG已不能滿足這些新的要求，而且它在低碼率時(shí)還存在著方塊效率。因此，從1997年開(kāi)始，JPEG委員會(huì)就致力于開(kāi)發(fā)新的靜態(tài)圖像壓縮標(biāo)準(zhǔn)JPEG2000,并在2000年8月形成了最終經(jīng)濟(jì)核草案，在2000年12月使其成為了國(guó)標(biāo)標(biāo)準(zhǔn)。 JPEG2000相比JPE
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異質(zhì)多處理器芯片中的數(shù)據(jù)流核心設(shè)計(jì)

異質(zhì)多處理器系統(tǒng)(Heterogeneous Multiprocessor)是將兩種以上不同工作性質(zhì)的處理器核心整合為一的處理器系統(tǒng)。它通常包含了一般用途處理器(General Purpose Processor)和特殊用途處理器(Specific Purpose Processor)。隨著片上系統(tǒng)SoC(System on Chip)及相關(guān)技術(shù)的成熟，已經(jīng)可以將不同的處理器整合到一個(gè)芯片里，成為多處理器芯片。以多媒體應(yīng)用為例，比較著名的異質(zhì)多處理芯片有德州儀器公司的TMS320DSC25、TMS320D
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賽靈思在中國(guó)IDF上展示全球性能最高的FPGA 加速模塊

　　賽靈思公司今天宣布將在本周舉辦的中國(guó)英特爾信息技術(shù)峰會(huì)（ Intel Developer Forum China）上展示全球性能最高的FPGA加速模塊。賽靈思計(jì)算加速平臺(tái)（ACP）采用基于FPGA的加速模塊滿足Intel基于FPGA的前端總線(FSB) 的要求并且展示了完全支持FSB的可插入Intel Xeon CPU插槽的Virtex-5 FPGA 模塊。　　賽靈思將展示通過(guò)Intel FSB總線在系統(tǒng)存儲(chǔ)器和最新的65nm Virtex&n
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