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基于FPGA的同步測周期高精度數(shù)字頻率計的設計
- 摘 要:本文介紹了一種同步測周期計數(shù)器的設計,并基于該計數(shù)器設計了一個高精度的數(shù)字頻率計。文中給出了計數(shù)器的VHDL編碼,并對頻率計的FPGA實現(xiàn)進行了仿真驗證,給出了測試結果。關鍵詞:頻率計;VHDL;FPGA;周期測量 在現(xiàn)代數(shù)字電路設計中,采用FPGA結合硬件描述語言VHDL可以設計出各種復雜的時序和邏輯電路,具有設計靈活、可編程、高性能等優(yōu)點。本文將介紹一種基于FPGA,采用同步測周期的方法來實現(xiàn)寬頻段高精度數(shù)字頻率計的設計。 圖1 同步測周期計數(shù)器
- 關鍵字: FPGA VHDL 頻率計 周期測量
數(shù)字頻率合成器的FPGA實現(xiàn)
- 介紹了DDFS的原理和Altera公司的FPGA器件ACEX 1K的主要特點,給出了用ACEX 1K系列器件EP1K10TC144-1實現(xiàn)數(shù)字頻率合成器的工作原理、設計思路、電路結構和仿真結果。
- 關鍵字: FPGA 數(shù)字頻率合成器
基于MicroBlaze軟核的FPGA片上系統(tǒng)設計
- 分析軟處理器MicroBlaze的體系結構,給出MicroBlaze內核在軟件無線電系統(tǒng)中的應用,實現(xiàn)SOPC(可編程系統(tǒng)芯片)。
- 關鍵字: MicroBlaze FPGA 軟核 片上系統(tǒng)
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