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采用高性能SRAM提高DSP密集型應(yīng)用的性能
- 軍事與國防應(yīng)用極大地受益于數(shù)字信號處理器(DSP)，其廣泛應(yīng)用于雷達、軟件無線電(SDR)、靈巧彈藥與目標探測系統(tǒng)、電子戰(zhàn)應(yīng)用、飛機成像以及眾多其它應(yīng)用。DSP借助其完美架構(gòu)提供的精確處理能力可以顯著提高性能。關(guān)鍵DSP功能包括實時信號處理、超高吞吐量與可重編程功能。本文介紹了如何采用高性能四倍數(shù)據(jù)速率(QDR)SRAM而使整體DSP系統(tǒng)性能至少提高兩倍(與使用SDRAM的傳統(tǒng)方法相比)的方法?！ ?shù)字信號處理 數(shù)字信號處理包含把信號轉(zhuǎn)換成數(shù)字形式后對其進行處理的方法，如：雷達處理。雷達系統(tǒng)基本上是
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基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設(shè)計
- 隨著嵌入式技術(shù)的飛速發(fā)展，對嵌入式系統(tǒng)的應(yīng)用需求也呈現(xiàn)出不斷增長的態(tài)勢，因此，嵌入式技術(shù)也相應(yīng)地取得了重要的進展，系統(tǒng)設(shè)備不斷向高速化、集成化、低功耗的方向發(fā)展?，F(xiàn)場可編程門陣列FPGA經(jīng)過近20年的發(fā)展，到目前已成為實現(xiàn)數(shù)字系統(tǒng)的主流平臺之一。 FPGA具有單片機和DSP無法比擬的優(yōu)勢，相對于單片機和DSP工作需要依靠其上運行的軟件進行，F(xiàn)PGA全部的控制邏輯是由延時更小的硬件來完成的。 通用串行總線(USB)是現(xiàn)代數(shù)據(jù)傳輸?shù)陌l(fā)展趨勢，是解決計算機與外設(shè)連接瓶頸的有效手段，USB2.O版本在原先的版本
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京微雅格推出國內(nèi)首款低功耗FPGA芯片CME-HR（黃河）系列
- 日前，京微雅格(北京)科技有限公司宣布適時推出了黃河系列CAP(可編程應(yīng)用平臺)HR系列，以迎合低功耗，小封裝及靈活的應(yīng)用場景需求?！ ?jù)京微雅格產(chǎn)品市場總監(jiān)竇祥峰介紹，其產(chǎn)品特點如下： CME-HR系列低功耗FPGA采用40納米臺聯(lián)電低功耗工藝，靜態(tài)最低功耗可達35.2uW，最小封裝WLCSP16僅1.5mm*1.5mm。 該系列產(chǎn)品主要面向手持類或其它移動便攜式終端與設(shè)備的相關(guān)應(yīng)用領(lǐng)域，該領(lǐng)域要求具備遠程升級、動態(tài)配置和功耗管理等功能，滿足LTE及未來的5G智能手機、便攜式智能終端(Tablet
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TI超低功耗DSP成高耗電音頻和視頻分析匹配產(chǎn)品
- 日前，德州儀器 (TI) 推出名為 TMS320C5517 (C5517) 的新一代超低功耗 DSP(屬于 TI 的可擴展性 TMS320C5000? 器件組合)。這款全新的 DSP 功耗很低，卻可提供頻率高達 200MHz 的性能，從而實現(xiàn)更快的數(shù)據(jù)處理，適用于要求極高的應(yīng)用，如音頻和視頻、生物辨識和其它特定分析應(yīng)用。這些應(yīng)用開啟了一個充滿無限可能的世界，可為新一代智能產(chǎn)品添加人臉檢測、目標跟蹤和語音識別等功能。此外，隨著性能的提高，C5517 DSP 還可提供低待機功率和低有功功率的魅
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一種基于DSP與FPGA的高速通信接口設(shè)計方案
- 在雷達信號處理、數(shù)字圖像處理等領(lǐng)域中，信號處理的實時性至關(guān)重要。由于FPGA芯片在大數(shù)據(jù)量的底層算法處理上的優(yōu)勢及DSP芯片在復雜算法處理上的優(yōu)勢，DSP+FPGA的實時信號處理系統(tǒng)的應(yīng)用越來越廣泛。ADI公司的TigerSHARC系列DSP芯片浮點處理性能優(yōu)越，故基于這類。DSP的DSP+FPGA處理系統(tǒng)正廣泛應(yīng)用于復雜的信號處理領(lǐng)域。同時在這類實時處理系統(tǒng)中，F(xiàn)PGA與DSP芯片之間數(shù)據(jù)的實時通信至關(guān)重要。 TigerSHARC系列DSP芯片與外部進行數(shù)據(jù)通信主要有兩種方式：總線方式和鏈路口方式。鏈
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一款基于DSP和CPLD的低壓斷路器智能控制器設(shè)計
- 0 引言 智能電網(wǎng)的發(fā)展，對低壓電器的智能化提出了較高的要求，目前國內(nèi)使用較多的小型斷路器的智能化穩(wěn)定性不夠，在于其體積較小，將信號采集電路、動作執(zhí)行和智能脫扣器都安裝在本體內(nèi)，開關(guān)內(nèi)的強電場產(chǎn)生的電磁干擾和高溫，使得斷路器可靠性降低。本文介紹的智能控制器脫離于斷路器本體，并且能夠連接多個斷路器，實現(xiàn)對多個斷路器的監(jiān)控。 1 控制器的總體結(jié)構(gòu) 群組智能控制器的核心采用DSP 芯片，輔以CPLD EPM3128芯片來實現(xiàn)鍵盤和液晶的時序邏輯，減少擴展芯片帶來的體積問題，外圍電路主要包括信號調(diào)理電路和脫
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CEVA發(fā)布用于CEVA-TeakLite-4 DSP的藍牙方案
- 全球領(lǐng)先的硅產(chǎn)品知識產(chǎn)權(quán)(SIP)平臺解決方案和數(shù)字信號處理器(DSP)內(nèi)核授權(quán)廠商CEVA公司宣布CEVA-TeakLite-4 DSP內(nèi)核繼音頻、語音和感測技術(shù)后，現(xiàn)在還可處理藍牙工作負載，從而顯著降低智能手機、物聯(lián)網(wǎng)(Internet of Things, IoT)、可穿戴產(chǎn)品和無線音頻裝置的芯片設(shè)計的成本、復雜性和功耗。通過利用最近發(fā)布的多功能CEVA-TeakLite-4 v2架構(gòu)的新增指令和接口，這款DSP現(xiàn)在可運行 CEVA-藍牙連接性(經(jīng)典或低功耗)，以及廣泛的音頻和語音軟件包;語音觸
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一種基于CPLD的DSP人機接口模塊設(shè)計
- CPLD(Complex programmable Logic Device，復雜可編程邏輯器件)是在傳統(tǒng)的PAL、GAL基礎(chǔ)上發(fā)展而來的，具有多種工作方式和高集成、高速、高可靠性等明顯的特點。 在超高速領(lǐng)域和實時測控方面有非常廣泛的應(yīng)用，日前的CPLD普遍基于E2PROM和Flash電可擦除技術(shù)，可實現(xiàn)100次以上擦寫循環(huán)。 CPLD選擇及其擴展模塊的設(shè)計 由于A是3.3v電平供電的，所以CPLD我們也選擇3.3v電平供電的XL型號。XC95144XL是Xilinx公司 XC9500系列的一種。它
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基于FPGA的自適應(yīng)均衡器算法實現(xiàn)
- 摘要：近年來，自適應(yīng)均衡技術(shù)在通信系統(tǒng)中的應(yīng)用日益廣泛，利用自適應(yīng)均衡技術(shù)在多徑環(huán)境中可以有效地提高數(shù)字接收機的性能。為了適應(yīng)寬帶數(shù)字接收機的高速率特點，本文闡述了自適應(yīng)均衡器的原理并對其進行改進。最后使用FPGA芯片和Verilog HDL設(shè)計實現(xiàn)了自適應(yīng)均衡器并仿真驗證了新方法的有效性。 信道均衡技術(shù)(Channel equalization)是指為了提高衰落信道中的通信系統(tǒng)的傳輸性能而采取的一種抗衰落措施。它主要是減小信道的多徑時延帶來的碼間串擾(ISI)問題。其原理是對信道或整個傳輸系統(tǒng)特性進行
- 關(guān)鍵字： FPGA LMS
在云端，還好嗎？
- 十四個月之前，我參加了一次Plunify的媒體沙龍活動，寫了一篇名為《云時代才剛剛開始》的文章，談了一點我對把芯片設(shè)計結(jié)合云計算和對Plunify這家創(chuàng)業(yè)公司的看法。那時候，Plunify主推的業(yè)務(wù)是租用亞馬遜的服務(wù)器資源，搭建一個FPGA開發(fā)的云端平臺，讓設(shè)計公司可以把設(shè)計方案上傳到云端來仿真，以節(jié)省大量的時間，同時也避開了自建云的昂貴成本?！ ∫荒赀^去了，我終于又有機會和Plunify做一次更加深入的交流，看看Plunify在中國大陸市場的深水里摸了一年石頭后，到底有沒有摸到魚?！ lunify
- 關(guān)鍵字： Plunify 云端 FPGA InTime
逐夢十年賽靈思
- 時間都去哪了?當公司全球上下熱烈慶祝成立30周年的時候， 回首我在賽靈思竟然也已有十載。從上海到北京，從新天地到盤古大觀，從北京最開始幾個人的小辦事處到今天數(shù)十人數(shù)千規(guī)模的北京公司，我有幸見證了賽靈思在中國的巨大發(fā)展和變遷，但不變的是這份工作帶來的強大吸引力和提供給大家的實現(xiàn)夢想的舞臺。 賽靈思是我的第一份工作，一做就做了十年。很多周圍的同學朋友都已經(jīng)換了多家公司，也有很多在高校都成了學術(shù)帶頭人，教授， 也不停地有獵頭和朋友追問我為什么不愿意動一動。 我清楚我的執(zhí)著和堅守來源于公司人性化和平等的
- 關(guān)鍵字： 賽靈思 FPGA PAE
基于VHDL和QuartusⅡ的數(shù)字電子鐘設(shè)計與實現(xiàn)
- 摘要：采用FPGA進行的數(shù)字電路設(shè)計具有更大的靈活性和通用性，已成為目前數(shù)字電路設(shè)計的主流方法之一。本文給出一種基于FPGA的數(shù)字鐘設(shè)計方案。該方案采用VHDL設(shè)計底層模塊，采用電路原理圖設(shè)計頂層系統(tǒng)。整個系統(tǒng)在QuartusⅡ開發(fā)平臺上完成設(shè)計、編譯和仿真，并在FPGA硬件實驗箱上進行測試。測試結(jié)果表明該設(shè)計方案切實可行。 EDA(Electronic Design Automation)又名電子設(shè)計自動化，其基本特征是：以超大規(guī)?？删幊踢壿嬈骷?，如FPGA，為設(shè)計載體，以硬件描述語言，如VHDL，為
- 關(guān)鍵字： FPGA QuartusⅡ
All Programmable平臺讓FPGA市場大有可為
- 曾有句話這樣說到：“當你認為設(shè)計完美的時候，不是因為沒有什么可以加，而是你不能再去除什么?！边@話用在FPGA上是再合適不過了。從簡單的邏輯集成到現(xiàn)在集成ARM核、DSP、模擬電路、存儲器等無所不包的系統(tǒng)級集成，從純硬件開發(fā)到可以用C、C++或System C來開發(fā)，從此前價格高昂到現(xiàn)在低成本低功耗，從工藝的跟隨到成為先進工藝的引領(lǐng)和3D IC的成功，從傳統(tǒng)的通信、工業(yè)和軍工等應(yīng)用向消費電子、醫(yī)療電子、汽車電子、嵌入式市場等擴展，F(xiàn)PGA成為擴充我們想像力的“先鋒”。
- 關(guān)鍵字： 賽靈思 FPGA All Programmable
fpga+dsp介紹
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