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fpga+dsp 文章進(jìn)入fpga+dsp技術(shù)社區(qū)

Altera推出最新IP內(nèi)核產(chǎn)品

Altera公司(NASDAQ: ALTR)日前宣布，推出40-Gbps以太網(wǎng)(40GbE)和100-Gbps以太網(wǎng)(100GbE)知識(shí)產(chǎn)權(quán)(IP)內(nèi)核產(chǎn)品。這些內(nèi)核能夠高效的構(gòu)建需要大吞吐量標(biāo)準(zhǔn)以太網(wǎng)連接的系統(tǒng)，包括，芯片至光模塊、芯片至芯片以及背板應(yīng)用等。
關(guān)鍵字： Altera FPGA

如何采用FPGA方案實(shí)現(xiàn)數(shù)字顯示系統(tǒng)設(shè)計(jì)

系統(tǒng)級(jí)芯片(SoC)解決方案被譽(yù)為半導(dǎo)體業(yè)最重要的發(fā)展之一，目前，從數(shù)字手機(jī)和數(shù)字電視等消費(fèi)類電子產(chǎn)品到高端通信LAN/WAN設(shè)備中，這一器件隨處可見(jiàn)。過(guò)去，為了創(chuàng)建此類嵌入式系統(tǒng)，設(shè)計(jì)工程師不得不在處理器、邏輯
關(guān)鍵字： FPGA 方案數(shù)字顯示系統(tǒng)設(shè)計(jì)

FPGA為車用微控制器提升設(shè)計(jì)靈活性

在汽車電子中廣為采用的微控制器(MCU)正快速面臨時(shí)間和成本的壓力。使用MCU的主要優(yōu)勢(shì)一直以來(lái)都是lsquo;創(chuàng)造具有高性價(jià)比的高階系統(tǒng)整合rsquo;。然而，在此一優(yōu)勢(shì)之下，有一些與元件本身相關(guān)的潛在成本是超乎于其
關(guān)鍵字： FPGA 車用微控制器

DSP設(shè)計(jì)中的流水線數(shù)據(jù)相關(guān)問(wèn)題及解決辦法

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字： DSP 流水線數(shù)據(jù) 浮點(diǎn)通用數(shù)字信號(hào)處理器

基于TMS320C64x DSP/BIOSⅡ的嵌入式語(yǔ)音采集與盲分離系統(tǒng)設(shè)計(jì)方案

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關(guān)鍵字： DSP BIOS BSS TMS320C6416

基于DSP的振鏡掃描式激光標(biāo)記系統(tǒng)分析

0 引言

振鏡掃描式激光標(biāo)記技術(shù)就是通過(guò)控制兩片高速振鏡的偏轉(zhuǎn)角, 改變激光的傳播方向, 經(jīng)過(guò)F-Theata透鏡在工件表面的聚焦, 在工件表面作標(biāo)記。與傳統(tǒng)的標(biāo)記技術(shù)相比, 它具有適用面廣(對(duì)不同材料、形狀的加工表面
關(guān)鍵字：系統(tǒng) 分析標(biāo)記激光 DSP 掃描基于

基于DSP和ADS8364的高速數(shù)據(jù)采集處理系統(tǒng)設(shè)計(jì)

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關(guān)鍵字： DSP ADS8364 數(shù)據(jù)采集

基于DSP CCS2.2實(shí)現(xiàn)指紋識(shí)別預(yù)處理系統(tǒng)設(shè)計(jì)

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關(guān)鍵字： DSP 指紋識(shí)別預(yù)處理系統(tǒng)

TMS320C6000系列DSP維特比譯碼程序優(yōu)化設(shè)計(jì)方案

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關(guān)鍵字： TMS320C6000 DSP 維特比譯碼程序

ARM+DSP、AVR與C51的比較

ARM+DSP、AVR與C51的比較,摘要：ARM+DSP與AVR作為現(xiàn)代CPU設(shè)計(jì)范例，從現(xiàn)代眼光來(lái)看，都是非常先進(jìn)的設(shè)計(jì)。最重要的是吸取了C51體系所顯露出來(lái)的問(wèn)題，在原有系列的基礎(chǔ)上，擁有高性能、高速度，甚至是更低的功耗。
關(guān)鍵詞：ARM、AVR、DSP、C
關(guān)鍵字：比較 C51 AVR DSP ARM

基于FPGA分布式算法的低通FIR濾波器的設(shè)計(jì)與實(shí)現(xiàn)

0 引言

傳統(tǒng)數(shù)字濾波器硬件的實(shí)現(xiàn)主要采用專用集成電路(ASIC)和數(shù)字信號(hào)處理器(DSP)來(lái)實(shí)現(xiàn)。FPGA內(nèi)部的功能塊中采用了SRAM的查找表(lo-ok up table，LUT)結(jié)構(gòu)，這種結(jié)構(gòu)特別適用于并行處理結(jié)構(gòu)，相對(duì)于傳統(tǒng)方法來(lái)
關(guān)鍵字： FPGA FIR 分布式算法低通

基于FPGA的數(shù)字頻率合成器設(shè)計(jì)與實(shí)現(xiàn)

摘要：為了產(chǎn)生穩(wěn)定激勵(lì)信號(hào)的目的，采用Verilog硬件語(yǔ)言在FPGA上實(shí)現(xiàn)了數(shù)字頻率合成器的設(shè)計(jì)，該設(shè)計(jì)包括累加器、波形存儲(chǔ)器、AD轉(zhuǎn)換、低通濾波器等；對(duì)累加器、波形存儲(chǔ)器都進(jìn)行了仿真，并下載到FPGA中，經(jīng)A／D轉(zhuǎn)換
關(guān)鍵字： FPGA 數(shù)字頻率合成器

基于FPGA的自適應(yīng)數(shù)字傳感器設(shè)計(jì)

摘要：高量程加速度傳感器在小信號(hào)的激勵(lì)下輸出在10 mV以內(nèi)，傳統(tǒng)測(cè)試系統(tǒng)的噪聲可能覆蓋如此小的電壓信號(hào)，使高量程的加速度傳感器無(wú)法測(cè)試小的加速度信號(hào)。針對(duì)這一問(wèn)題提出了基于自動(dòng)增益切換控制理論的自適應(yīng)數(shù)字
關(guān)鍵字： FPGA 數(shù)字傳感器設(shè)計(jì)

基于LabVIEW的FPGA模塊FIFO深度設(shè)定實(shí)現(xiàn)

為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來(lái)的數(shù)據(jù)不連續(xù)問(wèn)題，結(jié)合LabVIEWFPGA的編程特點(diǎn)和DMA FIFO的工作原理，提出了一種設(shè)定FIFO深度的方法。對(duì)FIFO不同深度的實(shí)驗(yàn)表明，采用該方法設(shè)定的FIFO深度能夠
關(guān)鍵字： LabVIEW FPGA FIFO 模塊

基于DSP的衛(wèi)星測(cè)控多波束系統(tǒng)

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字： DSP 衛(wèi)星測(cè)控多波束

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fpga+dsp介紹

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fpga+dsp電路

利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開(kāi)關(guān)電源設(shè)計(jì)的方法
一種基于DSP和USB的指紋識(shí)別系統(tǒng)設(shè)計(jì)
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計(jì)與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)

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