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fpga+dsp 文章進(jìn)入fpga+dsp技術(shù)社區(qū)

基于Xilinx軟件的FPGA系統(tǒng)設(shè)計(jì)方法介紹

基于Xilinx軟件的FPGA系統(tǒng)設(shè)計(jì)方法介紹,Solution:在對(duì)FPGA設(shè)計(jì)進(jìn)行最初步的系統(tǒng)規(guī)劃的時(shí)候，需要進(jìn)行模塊劃分，模塊接口定義等工作。通常，我們只能在紙上進(jìn)行設(shè)計(jì)。雖然在紙上我們可以很隨意地書寫，而用紙畫的不方便就在于，如果對(duì)某一個(gè)模塊進(jìn)行較大改動(dòng)
關(guān)鍵字：設(shè)計(jì) 方法介紹系統(tǒng) FPGA Xilinx 軟件基于

基于MATLAB 的DSP 應(yīng)用程序調(diào)試方法

基于MATLAB 的DSP 應(yīng)用程序調(diào)試方法,本文結(jié)合具體例證，介紹基于MATLAB 的DSP 應(yīng)用程序調(diào)試方法。 MATLAB 具有強(qiáng)大的分析、計(jì)算和可視化功能，利用MATLAB 提供的數(shù)十個(gè)專業(yè)工具箱，可以方便、靈活地實(shí)現(xiàn)對(duì)自動(dòng)控制、信號(hào)處理、通信系統(tǒng)等的算法分析和仿
關(guān)鍵字：調(diào)試方法應(yīng)用程序 DSP MATLAB 基于

Xilinx FPGA開發(fā)環(huán)境的安裝方法

Xilinx FPGA開發(fā)環(huán)境的安裝方法,一、計(jì)算機(jī)硬件環(huán)境要求：
1、操作系統(tǒng)：
Microsoft Windows XP Home Edition SP2
2、基本配置：
A、處理器：Intel CPU T2050 1.6GHz
B、內(nèi)存：512MB
C、硬盤：60GB(其中軟件安裝的空問需要3GB)補(bǔ)充
關(guān)鍵字：安裝方法環(huán)境開發(fā) FPGA Xilinx

DSP控制電機(jī)中減少電磁干擾的幾項(xiàng)技術(shù)

　電磁干擾在工業(yè)控制中越來越成為一個(gè)嚴(yán)重的問題。在使用TMS320C24X DSP控制器來控制數(shù)字電機(jī)的應(yīng)用中，如何減少電磁干擾也是一個(gè)重要的問題。在電機(jī)控制中，一方面，要在電路設(shè)計(jì)上盡量減少電磁干擾的產(chǎn)生，另一方
關(guān)鍵字：干擾技術(shù) 電磁減少控制電機(jī) DSP

淺析基于DSP的數(shù)字式科氏質(zhì)量流量變送器的設(shè)計(jì)

引言科里奧利質(zhì)量流量計(jì)(簡(jiǎn)稱科氏流量計(jì))可以直接測(cè)量流體的質(zhì)量流量，同時(shí)還可測(cè)體積流量、密度、溫度，測(cè)量精度高，可測(cè)量流體范圍廣，具有廣闊的應(yīng)用前景。目前，國(guó)內(nèi)科氏流量計(jì)大都采用基于模擬電路的信號(hào)處理方
關(guān)鍵字：流量變送器設(shè)計(jì) 質(zhì)量數(shù)字式基于 DSP 淺析

一種交織器和解交織器的FPGA電路實(shí)現(xiàn)

交織和解交織是組合信道糾錯(cuò)系統(tǒng)的一個(gè)重要環(huán)節(jié)，交織器和解交織器的實(shí)現(xiàn)方法有多種。本文利用Altera公司開發(fā)的Quartus軟件平臺(tái)和仿真環(huán)境，設(shè)計(jì)一種交織器和解交織器FPGA電路單倍實(shí)現(xiàn)的方法，并分析該電路實(shí)現(xiàn)的特點(diǎn)
關(guān)鍵字： FPGA 交織器電路實(shí)現(xiàn)

基于DSP與CPLD的輸電線路局部氣象監(jiān)測(cè)裝置設(shè)計(jì)

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字： DSP 氣象監(jiān)測(cè) CPLD

基于FPGA與ADSP TS201的總線接口設(shè)計(jì)方案

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字： FPGA ADSP TS201總線

基于DSP與VxWorks操作系統(tǒng)的RTOS視頻網(wǎng)絡(luò)檢測(cè)系統(tǒng)

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字： DSP VxWorks 操作系統(tǒng) RTOS 視頻網(wǎng)絡(luò)檢測(cè)系統(tǒng)

基于DSP的大功率數(shù)字開關(guān)電源設(shè)計(jì)

基于DSP的大功率數(shù)字開關(guān)電源設(shè)計(jì),摘要：結(jié)合電力電子技術(shù)和嵌入式技術(shù)，設(shè)計(jì)了以全橋隔離式PWM變換器為核心，基于DSP處理器TMS320F2812的高精度大功率數(shù)字開關(guān)電源。完成了系統(tǒng)硬件電路設(shè)計(jì)及軟件數(shù)字PID算法，實(shí)現(xiàn)數(shù)字化采樣、運(yùn)算、控制輸出、系統(tǒng)
關(guān)鍵字：開關(guān)電源設(shè)計(jì) 數(shù)字大功率 DSP 基于

IIR數(shù)字濾波器設(shè)計(jì)-在FPGA上實(shí)現(xiàn)任意階IIR數(shù)字濾波

IIR數(shù)字濾波器設(shè)計(jì)-在FPGA上實(shí)現(xiàn)任意階IIR數(shù)字濾波器摘要：本文介紹了一種采用級(jí)聯(lián)結(jié)構(gòu)在FPGA上實(shí)現(xiàn)任意階IIR數(shù)字濾波器的方法。此設(shè)計(jì)擴(kuò)展性好，便于調(diào)節(jié)濾波器的性能，可以根據(jù)不同的要求在不同規(guī)模的FPGA上加以實(shí)
關(guān)鍵字： IIR FPGA 數(shù)字濾波器設(shè)計(jì)

基于FPGA的循環(huán)冗余校驗(yàn)實(shí)驗(yàn)系統(tǒng)的實(shí)現(xiàn)

摘要：文章首先分析了循環(huán)冗余校驗(yàn)碼的功能，在此基礎(chǔ)上提出了基于FPGA的實(shí)現(xiàn)方法，詳細(xì)闡述了CRC校驗(yàn)編解碼的實(shí)現(xiàn)方法，并提出了基于現(xiàn)有的實(shí)驗(yàn)箱設(shè)備實(shí)現(xiàn)小型的CRC校驗(yàn)系統(tǒng)的總體設(shè)計(jì)框架和設(shè)計(jì)思路，完成了CRC校驗(yàn)
關(guān)鍵字： FPGA 循環(huán)冗余校驗(yàn) 實(shí)驗(yàn)系統(tǒng)

FPGA與外部存儲(chǔ)設(shè)備的接口實(shí)現(xiàn)

引言當(dāng)今社會(huì)是數(shù)字化的社會(huì)，隨著微電子技術(shù)的發(fā)展，設(shè)計(jì)與制造集成電路的任務(wù)已不完全由半導(dǎo)體廠商來獨(dú)立承擔(dān)...
關(guān)鍵字： FPGA 存儲(chǔ)設(shè)備

基于FPGA和單片機(jī)的串行通信接口設(shè)計(jì)

基于FPGA和單片機(jī)的串行通信接口設(shè)計(jì),摘要：本文針對(duì)由FPGA構(gòu)成的高速數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問題，提出FPGA與單片機(jī)實(shí)現(xiàn)數(shù)據(jù)串行通信的解決方案。在通信過程中完全遵守RS232協(xié)議，具有較強(qiáng)的通用性和推廣價(jià)值。1 前言
現(xiàn)場(chǎng)可編程邏輯器件（F
關(guān)鍵字：接口設(shè)計(jì) 通信串行 FPGA 單片機(jī) 基于

FPGA DCM時(shí)鐘管理單元原理簡(jiǎn)介

FPGA DCM時(shí)鐘管理單元原理簡(jiǎn)介,DCM概述
DCM內(nèi)部是DLL(Delay Lock Loop(?)結(jié)構(gòu),對(duì)時(shí)鐘偏移量的調(diào)節(jié)是通過長(zhǎng)的延時(shí)線形成的。DCM的參數(shù)里有一個(gè)PHASESHIFT（相移）,可以從0變到255。所以我們可以假設(shè)內(nèi)部結(jié)構(gòu)里從clkin到clk_1x之間應(yīng)該有256根延
關(guān)鍵字：原理簡(jiǎn)介單元管理 DCM 時(shí)鐘 FPGA

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fpga+dsp介紹

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利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計(jì)的方法
一種基于DSP和USB的指紋識(shí)別系統(tǒng)設(shè)計(jì)
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計(jì)與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)

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