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目標設計平臺使基于FPGA的系統(tǒng)開發(fā)易如反
- 賽靈思公司在正式發(fā)布新一代旗艦產品高性能Virtex-6和低成本Spartan-6 FPGA時，首次提出了“目標設計平臺”的新概念。賽靈思目標設計平臺包含五個關鍵部分：Virtex-6和Spartan-6 FPGA器件、支持和集成業(yè)界成熟設計方法的設計環(huán)境、采用業(yè)界標準FPGA多層連接器的可擴展板和套件、提供接口的IP內核和強大的參考設計。
- 關鍵字： 目標設計平臺 系統(tǒng)開發(fā) FPGA Virtex-6 Spartan-6
mcu,DSP,PLD/EDA的介紹/比較/分析
- 當今,數字時代的核心動力便是單片機,DSP ,PLD/ EDA ,以其各自的特點滿足了各種需要,推動著信息技術的快速發(fā)展。這里將對這三類電子產品分別加以介紹,并作比較和分析。
- 關鍵字： 單片機(Single-chipMicrocomputer) 數字信號處理(DSP) 可編程邏輯器件(PLD)/電子設計自動化(EDA)
基于FPGA的線陣CCD驅動時序及模擬信號處理的設計
- 基于FPGA設計的驅動電路是可再編程的，與傳統(tǒng)的方法相比，其優(yōu)點是集成度高、速度快、可靠性好。若要改變驅動電路的時序，增減某些功能，僅需要對器件重新編程即可，在不改變任何硬件的情況下，即可實現(xiàn)驅動電路的更新?lián)Q代。通過對TCDl50lD輸出圖像信號特征的簡要分析，分別闡述了內、外2種除噪方法，并給出了相應的時序，再利用Quartus II 7．2軟件平臺對TCDl501D CCD驅動時序及AD9826的采樣時序進行了設計及結果仿真，使CCD的驅動變得簡單且易于處理，這是傳統(tǒng)邏輯電路無法比擬的，對其他CCD時
- 關鍵字： CCD驅動時序 模擬信號處理 FPGA
用FPGA在數字電視系統(tǒng)中進行級聯(lián)編碼
- 本文介紹了串型級聯(lián)編碼的原理，以及它在數字電視地面?zhèn)鬏斚到y(tǒng)中的應用，通過FPGA設計電路實現(xiàn)編碼過程，最后說明串型級聯(lián)編碼的應用優(yōu)越性。
- 關鍵字： FPGA；編碼；串型級聯(lián)編碼；數字電視地面?zhèn)鬏斚到y(tǒng)
MAX706S在DSP系統(tǒng)中的應用
- 對于實際的DSP應用系統(tǒng)特別是產品化的DSP系統(tǒng)而言，可靠性是一個不容忽視的問題。由于DSP系統(tǒng)的時鐘頻率比較高，因此在運行時極有可能發(fā)生干擾和被干擾的現(xiàn)象，嚴重時系統(tǒng)可能會出現(xiàn)死機。為了克服這種情況，除了在軟件上作一些保護措施外，硬件上也必須作相應的處理。硬件上最有效的保護措施就是采用具有監(jiān)視(Watchdog)功能的自動復位電路。各大公司生產了多種微處理器監(jiān)控器，用來監(jiān)測微處理器的運行狀態(tài)，一旦微處理器失控就強行復位微處理器，引導程序重新運行。
- 關鍵字： MAX706S DSP 監(jiān)控電路
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