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基于VHDL和發(fā)接復(fù)用器的SDH系統(tǒng)設(shè)計(jì)及FPGA仿真
- 基于VHDL和發(fā)接復(fù)用器的SDH系統(tǒng)設(shè)計(jì)及FPGA仿真, 針對(duì)目前國(guó)內(nèi)SDH系統(tǒng)中還沒有一個(gè)專門的E1分接復(fù)用芯征，本文介紹一種用高級(jí)硬件描述語(yǔ)言VHDL及狀態(tài)轉(zhuǎn)移圖完成該發(fā)接復(fù)用器的設(shè)計(jì)的新型設(shè)計(jì)方法及其FPGA實(shí)現(xiàn)。并給出了用Xilinx FoundaTIon tools EDA軟件設(shè)計(jì)的
- 關(guān)鍵字： 設(shè)計(jì) FPGA 仿真 系統(tǒng) SDH VHDL 復(fù)用器 基于
用FPGA+DSP實(shí)現(xiàn)HDLC(高級(jí)數(shù)據(jù)鏈路控制)功能
- 用FPGA+DSP實(shí)現(xiàn)HDLC(高級(jí)數(shù)據(jù)鏈路控制)功能, 引言 HDLC的ASIC芯片使用簡(jiǎn)易，功能針對(duì)性強(qiáng)，性能可靠，適合應(yīng)用于特定用途的大批量產(chǎn)品中。但由于HDLC標(biāo)準(zhǔn)的文本較多，ASIC芯片出于專用性的目的難以通用于不同版本，缺乏應(yīng)用靈活性。有的芯片公司還有自己
- 關(guān)鍵字： 鏈路 控制 功能 數(shù)據(jù) 高級(jí) DSP 實(shí)現(xiàn) HDLC FPGA
基于FPGA的圖像調(diào)焦系統(tǒng)研究
- 摘要：采用基于圖像技術(shù)的自動(dòng)調(diào)焦方法，根據(jù)圖像分析出圖形的質(zhì)量，完成圖像預(yù)處理、清晰度判別，獲得當(dāng)前的成像狀況。通過控制電機(jī)，完成調(diào)焦操作。其中核心技術(shù)是分析圖像質(zhì)量評(píng)價(jià)函數(shù)。針對(duì)調(diào)焦算法計(jì)算量大、計(jì)
- 關(guān)鍵字： FPGA 圖像調(diào)焦 系統(tǒng)研究
飛思卡爾S12P：用8位的價(jià)格做16位MCU
- 作為嵌入式半導(dǎo)體行業(yè)的構(gòu)想者和架構(gòu)師，飛思卡爾一直致力并推動(dòng)創(chuàng)新科技發(fā)展。8月24日，將舉辦一年一度的盛會(huì)——飛思卡爾技術(shù)論壇(FTF)，屆時(shí)大會(huì)將設(shè)置多場(chǎng)專題研討會(huì)，就汽車信息娛樂市場(chǎng)、汽車新能源等未來發(fā)展趨勢(shì)進(jìn)行深入討論。 在汽車電子領(lǐng)域，對(duì)于MCU性能的要求高于其他拭擦很難過，但是16位，32位MCU還是在逐漸取代8位MCU市場(chǎng)份額。作為汽車電子領(lǐng)域的領(lǐng)軍企業(yè)，近年來，飛思卡爾也在積極的拓展MCU產(chǎn)品鏈路，并不斷改進(jìn)它們的性能。S12P就是其中典型的一款。S12P是
- 關(guān)鍵字： 飛思卡爾 MCU S12P
基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù)
- 基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù),LatticeXP2器件包括基于查找表（LUT）的 FPGA以及非易失閃存單元（flexiFLASH）。LatticeXP2系列器件的LUT從5K到40K，分布是RAM從10K到83Kb，EBR SRAM從166Kb到885Kb，EBR SRAM區(qū)塊從9到48個(gè)，sysDSP從3個(gè)到8個(gè)，18x
- 關(guān)鍵字： 評(píng)估 技術(shù) 標(biāo)準(zhǔn) FPGA LatticeXP2 設(shè)計(jì) 基于
基于FPGA的彩色圖像增強(qiáng)系統(tǒng)
- 提高顯示器的視覺效果，提出增強(qiáng)比度擴(kuò)展和色飽和度兩種算法，來對(duì)彩色圖像進(jìn)行增強(qiáng)處理，為滿足視頻信號(hào)的實(shí)時(shí)性要求，應(yīng)用FPGA構(gòu)造高速圖像處理系統(tǒng)。實(shí)驗(yàn)結(jié)果表明，本方法能提高圖像的層次感，增強(qiáng)色彩飽和度，達(dá)到顯著提升視覺感受的效果。
- 關(guān)鍵字： FPGA 彩色 圖像增強(qiáng) 系統(tǒng)
基于PIC24F16KA102 XLP設(shè)計(jì)的16位MCU開發(fā)技術(shù)
- PIC24F16KA102是極低16位MCU，采用改進(jìn)型哈佛架構(gòu)，32MHz時(shí)高達(dá)16MIPS，帶4x PLL選擇和多個(gè)除法選擇的8MHz振蕩器，17位x17位單周期硬件乘法器，32位x16位硬件除法器，16位x16位工作寄存器陣列，C編譯器，運(yùn)行模式的功
- 關(guān)鍵字： MCU 開發(fā)技術(shù) 16位 設(shè)計(jì) PIC24F16KA102 XLP 基于
基于雙DSP的雷場(chǎng)偵察圖像實(shí)時(shí)壓縮存儲(chǔ)方法
- 1引言以直升機(jī)(有人機(jī)或無人機(jī))為平臺(tái)，利用可見光成像和紅外成像傳感器技術(shù)，可以晝夜進(jìn)行遠(yuǎn)距離、...
- 關(guān)鍵字： FPGA DSP 實(shí)時(shí)壓縮
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