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出租車計(jì)價(jià)器的FPGA設(shè)計(jì)

O 引言
FPGA(Field Programmable Gate Array，現(xiàn)場(chǎng)可編程門陣列)是一種高密度可編程邏輯器件，它支持系統(tǒng)可編程，通過(guò)寫(xiě)入不同的配置數(shù)據(jù)就可以實(shí)現(xiàn)不同的邏輯功能。使用FPGA來(lái)設(shè)計(jì)電子系統(tǒng)，具有設(shè)計(jì)周期短
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基于FPGA的高斯白噪聲發(fā)生器設(shè)計(jì)

0 引言
現(xiàn)代通訊電子設(shè)備的抗干擾測(cè)試已經(jīng)成為必須的測(cè)試項(xiàng)目，主要的干擾類型為噪聲干擾。在通信信道測(cè)試和電子對(duì)抗領(lǐng)域里，噪聲始終是最基本、最常用的干擾源之一。如何產(chǎn)生穩(wěn)定和精確的噪聲信號(hào)已經(jīng)成為一
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MPEG-2復(fù)用器PSI信息分析部分的FPGA實(shí)現(xiàn)

復(fù)用器是數(shù)字電視前端平臺(tái)的關(guān)鍵設(shè)備，它的主要功能是完成對(duì)輸入多路傳輸流(Transport Stream，TS)的復(fù)用工作，它的性能穩(wěn)定性直接影響前端平臺(tái)的運(yùn)行。而復(fù)用器對(duì)傳輸流中節(jié)目特殊信息(Program Spe-cial Info
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基于0.13微米CMOS工藝下平臺(tái)式FPGA中可重構(gòu)RAM模塊的一種設(shè)計(jì)方法

基于0.13微米CMOS工藝下平臺(tái)式FPGA中可重構(gòu)RAM模塊的一種設(shè)計(jì)方法,1. 引言

對(duì)于需要大的片上存儲(chǔ)器的各種不同的應(yīng)用，F(xiàn)PGA 需要提供可重構(gòu)且可串聯(lián)的存儲(chǔ)器陣列。通過(guò)不同的配置選擇，嵌入式存儲(chǔ)器陣列可以被合并從而達(dá)到位寬或字深的擴(kuò)展并且可以作為單端口，雙端口
關(guān)鍵字： RAM 重構(gòu) 模塊設(shè)計(jì) 方法 FPGA 平臺(tái) 0.13 微米 CMOS 工藝

日立高科與瑞薩科技就出讓其半導(dǎo)體生產(chǎn)設(shè)備業(yè)務(wù)達(dá)成協(xié)議

　　2009年12月22日，日立高科公司(以下簡(jiǎn)稱日立高科)和瑞薩科技公司(以下簡(jiǎn)稱瑞薩)共同宣布，就瑞薩將其100%子公司----總部設(shè)在山梨縣的株式會(huì)社瑞薩東日本半導(dǎo)體公司轉(zhuǎn)讓給日立高科的全資子公司株式會(huì)社日立高科設(shè)備有限公司一事，達(dá)成吸收其企業(yè)的剝離協(xié)議。兩家公司以及日立高科和瑞薩同時(shí)還簽署了業(yè)務(wù)轉(zhuǎn)讓方面的最終協(xié)議。這是日立高科和瑞薩于2009年10月28日所發(fā)表的就“日立高科將從瑞薩科技收購(gòu)其半導(dǎo)體生產(chǎn)設(shè)備業(yè)務(wù)”事宜的最新更新信息?，F(xiàn)將業(yè)務(wù)轉(zhuǎn)讓方法、背景和日期分述如下：
關(guān)鍵字：瑞薩 MCU

基于DSP的調(diào)幅廣播信號(hào)監(jiān)測(cè)系統(tǒng)的設(shè)計(jì)

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基于FPGA的防盜定位追蹤系統(tǒng)

1 系統(tǒng)方案　　GSM(Global System for Mobile Communications)為全球移動(dòng)通訊系統(tǒng)，是一種起源于歐洲的移動(dòng)通信技術(shù)標(biāo)準(zhǔn)，其開(kāi)發(fā)目的是讓全球各地可以共同使用一個(gè)移動(dòng)電話網(wǎng)絡(luò)標(biāo)準(zhǔn)，讓用戶使用一部手機(jī)就能行遍全球
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基于FPGA的提取位同步時(shí)鐘DPLL設(shè)計(jì)

在數(shù)字通信系統(tǒng)中，同步技術(shù)是非常重要的，而位同步是最基本的同步。位同步時(shí)鐘信號(hào)不僅用于監(jiān)測(cè)輸入碼元信號(hào)，確保收發(fā)同步，而且在獲取幀同步及對(duì)接收的數(shù)字碼元進(jìn)行各種處理的過(guò)程中也為系統(tǒng)提供了一個(gè)基準(zhǔn)
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FPGA中SPI復(fù)用配置的編程方法

FPGA中SPI復(fù)用配置的編程方法, SPI(Serial Peripheral Interface，串行外圍設(shè)備接口)是一種高速、全雙工、同步的通信總線，在芯片的引腳上只占用4根線，不僅節(jié)約了芯片的引腳，同時(shí)在PCB的布局上還節(jié)省空間。正是出于這種簡(jiǎn)單、易用的特性，
關(guān)鍵字：編程方法配置復(fù)用 SPI FPGA

FPGA的時(shí)鐘頻率同步設(shè)計(jì)

FPGA的時(shí)鐘頻率同步設(shè)計(jì),引言
網(wǎng)絡(luò)化運(yùn)動(dòng)控制是未來(lái)運(yùn)動(dòng)控制的發(fā)展趨勢(shì)，隨著高速加工技術(shù)的發(fā)展，對(duì)網(wǎng)絡(luò)節(jié)點(diǎn)間的時(shí)間同步精度提出了更高的要求。如造紙機(jī)械，運(yùn)行速度為1 500～1 800m／min，同步運(yùn)行的電機(jī)之間1μs的時(shí)間同步誤差將
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FPGA單芯片四核二乘二取二的安全系統(tǒng)

FPGA單芯片四核二乘二取二的安全系統(tǒng),引言
二乘二取二系統(tǒng)的兩套計(jì)算機(jī)系統(tǒng)各有兩個(gè)CPU，并且所有結(jié)構(gòu)和配件完全相同。兩套系統(tǒng)之間采取雙機(jī)熱備份，大幅提高了系統(tǒng)可靠性，在一些領(lǐng)域得到了廣泛應(yīng)用。基于二乘二取二容錯(cuò)結(jié)構(gòu)的計(jì)算機(jī)聯(lián)鎖系統(tǒng)在國(guó)
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通過(guò)USB接口實(shí)現(xiàn)FPGA的SelectMap配置

1.引言
FPGA器件結(jié)合了 ASIC的高性能和微處理器的靈活，不僅擁有豐富的邏輯資源，而且可以進(jìn)行方便靈活的配置。主動(dòng)配置方式盡管配置速度快、實(shí)現(xiàn)簡(jiǎn)單，但并未發(fā)揮 FPGA配置靈活的特點(diǎn)，適合于 FPGA用作單一應(yīng)用的場(chǎng)
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一種基于FPGA的AGWN信號(hào)生成器的設(shè)計(jì)

在通信系統(tǒng)中分析計(jì)算系統(tǒng)抗噪聲性能時(shí)，經(jīng)常假定信道噪聲為加性高斯型白噪聲(AGWN)。本文就是通過(guò)分析AG...
關(guān)鍵字： FPGA AGWN 信號(hào)生成器

基于FPGA的數(shù)據(jù)采集控制模塊設(shè)計(jì)

0 引言
數(shù)據(jù)采集和控制系統(tǒng)是對(duì)生產(chǎn)過(guò)程或科學(xué)實(shí)驗(yàn)中各種物理量進(jìn)行實(shí)時(shí)采集、測(cè)試和反饋控制的閉環(huán)控制，它在工業(yè)控制、軍事電子設(shè)備、醫(yī)學(xué)監(jiān)護(hù)等許多領(lǐng)域發(fā)揮著重要作用。其中，數(shù)據(jù)采集部分尤為重要，而傳統(tǒng)
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瑞薩2009釋放沉淀，穩(wěn)步革新

　　2009年，全球經(jīng)濟(jì)危機(jī)所帶來(lái)的負(fù)面影響波及世界各個(gè)角落。中國(guó)的半導(dǎo)體市場(chǎng)規(guī)模下降至682億美元，較去年下滑6.8%。相對(duì)于過(guò)去幾年保持強(qiáng)勁增長(zhǎng)的中國(guó)半導(dǎo)體市場(chǎng)來(lái)說(shuō)，這是很大的降幅。然而正是在這樣嚴(yán)峻的挑戰(zhàn)面前，瑞薩科技(以下簡(jiǎn)稱瑞薩)卻以其一貫穩(wěn)扎穩(wěn)打的經(jīng)營(yíng)策略，依舊在消費(fèi)電子、汽車電子等領(lǐng)域保持著穩(wěn)步增長(zhǎng)的態(tài)勢(shì)。通過(guò)與中國(guó)所有電子廠商及研究機(jī)構(gòu)的密切合作，長(zhǎng)期與中國(guó)企業(yè)共同成長(zhǎng)的戰(zhàn)略，正在奏效。完善的戰(zhàn)略布局與領(lǐng)先的產(chǎn)品技術(shù)讓沉淀多年的瑞薩，進(jìn)一步釋放出強(qiáng)大的能量。　　體制變革，強(qiáng)化策略　
關(guān)鍵字：瑞薩 MCU M16C