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一種基于FPGA的數(shù)字秒表設(shè)計(jì)方法
- 摘要：文中介紹了一種基于FPGA的數(shù)字秒表設(shè)計(jì)方法。采用VHDL硬件描述語言，運(yùn)用ModelSim等EDA仿真工具。該設(shè)計(jì)具有外圍電路少、集成度高、可靠性強(qiáng)等優(yōu)點(diǎn)。最后經(jīng)實(shí)驗(yàn)驗(yàn)證，該數(shù)字秒表計(jì)時(shí)準(zhǔn)確，輸入信號(hào)能準(zhǔn)確控制秒
- 關(guān)鍵字： FPGA 數(shù)字秒表 設(shè)計(jì)方法
賽靈思宣布業(yè)界首款28nm FPGA開始量產(chǎn)
- 全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc.(NASDAQ: XLNX))今日宣布行業(yè)第一個(gè)28nm FPGA器件已經(jīng)針對主要客戶開始量產(chǎn)， 該發(fā)布再次為行業(yè)樹起了另一個(gè)重要里程碑。Kintex?-7 FPGA的正式量產(chǎn)，是賽靈思以可編程邏輯器件(PLD)行業(yè)歷史最快速度交付新產(chǎn)品的出色執(zhí)行中， 繼已成功交付數(shù)以千計(jì)的最新7系列產(chǎn)品樣片之后， 再次邁出的嶄新一步。這一成就使賽靈思的客戶能夠比以往任何時(shí)候都更快地開始投產(chǎn)他們自己的產(chǎn)品， 同時(shí)也能比以往任何時(shí)候更快地滿足他們客戶的需求。
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FPGA/CPLD常用的四種設(shè)計(jì)方法
- FPGA/CPLD常用的四種設(shè)計(jì)方法,FPGA/CPLD的設(shè)計(jì)思想與技巧是一個(gè)非常大的話題，本文僅介紹一些常用的設(shè)計(jì)思想與技巧，包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識(shí)地利用這些原則指導(dǎo)日
- 關(guān)鍵字： 方法 設(shè)計(jì) 常用 FPGA/CPLD
中頻軟件無線電系統(tǒng)的FPGA實(shí)現(xiàn)方案
- 一、 引言 現(xiàn)代通信技術(shù)、微電子技術(shù)和計(jì)算機(jī)技術(shù)的飛速發(fā)展，促進(jìn)了無線通信技術(shù)從數(shù)字化走向軟件化。軟件無線電的出現(xiàn)掀起了無線通信技術(shù)的又一次革命，它已經(jīng)成為目前通信領(lǐng)域中最為重要的研究方向之一
- 關(guān)鍵字： FPGA 軟件無線電 系統(tǒng) 實(shí)現(xiàn)方案
基于FPGA+DSP架構(gòu)的高速通信接口設(shè)計(jì)與實(shí)現(xiàn)
- 開關(guān)電源已普遍運(yùn)用在當(dāng)前的各類電子設(shè)備上,其單位功率密度也在不斷地提高.高功率密度的定義從1991年的25w/...
- 關(guān)鍵字： FPGA DSP架構(gòu) 高速通信
基于FPGA的乒乓球游戲的設(shè)計(jì)與實(shí)現(xiàn)
- 0引言FPGA(FieldProgrammableGateArray)，現(xiàn)場可編程門陣列。它是繼PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的成果。它作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路，既解決了定制電路的不足，又克服了原有可
- 關(guān)鍵字： FPGA
Altera首次演示FPGA與100Gbps光模塊的互操作性
- Altera公司(NASDAQ:ALTR)今天宣布，使用28-nm Stratix? V GT FPGA成功演示了與100-Gbps光模塊的互操作性，從而支持實(shí)現(xiàn)下一代100-Gbps網(wǎng)絡(luò)。這是業(yè)界第一次演示FPGA與100-Gbps光模塊的互操作性，表明了Altera?致力于幫助系統(tǒng)工程師和生產(chǎn)商開發(fā)高密度、低功耗光網(wǎng)絡(luò)。在發(fā)布今天的新聞之前，Altera還于2011年9月宣布，Gennum和Altera為下一代100Gb/s網(wǎng)絡(luò)演示了4x25Gb/s IC。這些解決方案相結(jié)合，增強(qiáng)
- 關(guān)鍵字： Altera FPGA
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