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賽靈思推出Virtex-5 FXT FPGA ML510 嵌入式開發(fā)平臺
- 賽靈思公司日前宣布推出 Virtex-5 FXT FPGA ML510 嵌入式開發(fā)平臺，用于開發(fā)支持雙處理器的高性能嵌入式系統(tǒng)。這一新的開發(fā)平臺基于集成雙 Power PC? 440處理器的 Virtex-5 FXT FPGA，并且可以支持 Linux和VxWorks 操作系統(tǒng)，為軟件和硬件設計團隊提供了無與倫比的靈活性和計算能力。 結(jié)合豐富的參考設計和由屢獲殊榮的開發(fā)工具、配置向?qū)Ш?IP 組成的賽靈思嵌入式開發(fā)套件（EDK），ML510 嵌入式開發(fā)平臺為構(gòu)建利用雙處理器完成專用分配功
- 關鍵字： xilinx FPGA WiMAX
基于單片機和FPGA的簡易數(shù)字存儲示波器設計
- l 引言 與傳統(tǒng)模擬示波器相比．數(shù)字存儲示波器不僅具有可存儲波形、體積小、功耗低，使用方便等優(yōu)點，而且還具有強大的信號實時處理分析功能。在電子測量領域，數(shù)字存儲示波器正在逐漸取代模擬示波器。但目前我國使用高性能數(shù)字存儲示波器主要依靠國外產(chǎn)品，而且價格昂貴。因此研究數(shù)字存儲示波器具有重要價值。借于此，提出了一種簡易數(shù)字存儲示波器的設計方案，經(jīng)測試，性能優(yōu)良。 2 數(shù)字存儲示波器基本工作原理 數(shù)字存儲示波器與模擬示波器不同在于信號進入示波器后立刻通過高速A／D轉(zhuǎn)換器將模擬信號前端快速采樣，存儲其
- 關鍵字： 單片機 FPGA 放大器 示波器
基于FPGA的低成本虛擬測試系統(tǒng)實現(xiàn)
- 1 引言 傳統(tǒng)測試測量儀存在價格昂貴、體積龐大、數(shù)據(jù)傳輸速率低、存儲顯示困難等問題，本文選用FPGA實現(xiàn)數(shù)據(jù)處理、邏輯控制，充分利用PC機，結(jié)合Labwindows圖形化上層應用軟件界面生成的虛擬測試系統(tǒng)具有較強的競爭力。本系統(tǒng)在FPGA單板單片主控器件控制下，實現(xiàn)兩路獨立、幅值可控的信號發(fā)生器，一路虛擬存儲示波器，具有外部觸發(fā)信號和采樣時鐘的16路高速邏輯分析儀。 2硬件設計 2.1硬件系統(tǒng)框圖 硬件系統(tǒng)設計是以并行處理能力強、可重配置的低端FPGA單片EP1C6為主控器件。圖1所示為硬
- 關鍵字： 虛擬測試 FPGA
3-DES算法的FPGA實現(xiàn)
- 引言從技術(shù)角度講，網(wǎng)絡安全除了依賴安全的網(wǎng)絡通信協(xié)議及應用協(xié)議外，更多地取決于網(wǎng)絡設備如交換機...
- 關鍵字： FPGA 算法 3-DES 網(wǎng)絡安全
Altera在Convergence 2008上展示其車內(nèi)信息娛樂開發(fā)平臺
- 2008年10月21號，北京——Altera公司(NASDAQ: ALTR)今天宣布，為開發(fā)信息娛樂、導航、舒適和便捷、輔助駕駛系統(tǒng)的汽車設計人員和OEM提供平臺ASSP替換信息娛樂系統(tǒng)(P.A.R.I.S.)。與Gleichmann電子研究股份有限公司聯(lián)合開發(fā)，P.A.R.I.S.平臺實現(xiàn)了完整的開發(fā)環(huán)境，包括工具、知識產(chǎn)權(quán)(IP)和軟件，大大簡化了車內(nèi)系統(tǒng)的開發(fā)。10月20至22號在密歇根州底特律Cobo中心舉行的Convergence 2008展會上，Altera將在62
- 關鍵字： Altera OEM FPGA 汽車系
采用FPGA實現(xiàn)視頻和圖像處理設計
- 視頻和圖像處理發(fā)展趨勢 以視頻和圖像處理為核心的HDTV和數(shù)字影院等創(chuàng)新技術(shù)的進展非常迅速，其推動力量在于圖像采集和顯示分辨率、高級壓縮方法以及視頻智能的跨越式發(fā)展。 在過去幾年中，分辨率的發(fā)展最為顯著，表1列出了不同終端設備上目前能夠達到的最高分辨率。從標準清晰度(SD)過渡到高清晰度(HD)，需要處理的數(shù)據(jù)量提高了6倍。視頻監(jiān)控也從普通中間格式(CIF)(352×288)轉(zhuǎn)向標準要求的D1格式(704×576)，某些工業(yè)攝像機甚至達到1280×720HD
- 關鍵字： FPGA
基于FPGA的數(shù)字秒表的設計
- 應用VHDL語言設計數(shù)字系統(tǒng)，很多設計工作可以在計算機上完成，從而縮短了系統(tǒng)的開發(fā)時間，提高了工作效率。本文介紹一種以FPGA為核心，以VHDL為開發(fā)工具的數(shù)字秒表，并給出源程序和仿真結(jié)果。 1 系統(tǒng)設計方案 1.1 系統(tǒng)總體框圖 數(shù)字秒表主要有分頻器、計數(shù)模塊、功能控制模塊、勢能控制模塊和顯示輸出模塊組成。系統(tǒng)框圖如圖1所示。 ? 本次的設計仿真選用以EP1C6Q240芯片為核心的FPGA開發(fā)板，該開發(fā)板提供了較完善的外圍周邊電路和信號接口，并提供了一塊4位7段數(shù)碼管的擴
- 關鍵字： FPGA
基于FPGA的超高速雷達實時采集存儲系統(tǒng)
- 摘要：采用服務器作為采集主控設備，利用多個硬盤組成磁盤陣列作為存儲設備，并制作了一塊基于FPGA的超高速雷達...
- 關鍵字： FPGA 超高速 實時 數(shù)據(jù)采集 數(shù)據(jù)存儲
基于FPGA的多路模擬數(shù)字采集與處理系統(tǒng)
- 摘要：提出一種基于FPGA技術(shù)的多路模擬量、數(shù)字量采集與處理系統(tǒng)的設計方案，分析整個系統(tǒng)的結(jié)構(gòu)，并討論FPGA內(nèi)部...
- 關鍵字： FPGA A/D采集 數(shù)字量采集 VHDL語言設計
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