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實現(xiàn)基于USB3.0技術的高清攝像頭系統(tǒng)設計
- 高清圖像質(zhì)量已經(jīng)快速成為現(xiàn)代家庭中多媒體產(chǎn)品的標準配置。在該領域之外的許多應用中，更高的分辨率、更好的對比度、更大的色深和更快的幀率也都越來越受歡迎，這些應用包括安保、醫(yī)療成像和工廠生產(chǎn)線檢測系統(tǒng)等等。當然，盡管增強型成像技術在不久的將來更加流行似乎是板上釘釘?shù)氖虑椋@將取決于支持更高數(shù)據(jù)傳輸能力的先進半導體技術的發(fā)展。本文將以實例闡述半導體技術所取得的進展。 雖然USB連接標準開始并沒有引起太多關注，但從上世紀90年代中期第一次脫穎而出已經(jīng)改變了很多，它現(xiàn)在已經(jīng)遠遠不只是為低數(shù)據(jù)速率的鼠標和
- 關鍵字： USB FIFO 緩沖器 FPGA 顯示器
駿龍科技最新物聯(lián)網(wǎng)開發(fā)套件和電機驅(qū)動方案擴展Altera MAX 10 FPGA的應用
- 領先的技術分銷商駿龍科技有限公司發(fā)布了基于Altera MAX® 10的“Mpression Odyssey(奧德賽)”物聯(lián)網(wǎng)開發(fā)套件和電機驅(qū)動方案。Altera的MAX® 10 FPGA在低成本、單芯片、瞬時上電的可編程邏輯器件中提供了先進的處理能力，駿龍科技推出的產(chǎn)品進一步驗證了MAX® 10 FPGA的卓越性能，并進一步豐富了Altera公司的工業(yè)解決方案。 “Mpression Odyssey(奧德賽)”開發(fā)套件是一
- 關鍵字： 駿龍科技 物聯(lián)網(wǎng) FPGA
利用FPGA和分解器數(shù)字轉(zhuǎn)換器簡化角度測量
- 1 編碼器和分解器的類型 編碼器分為增量和絕對兩個基本類別。增量編碼器可以監(jiān)控輪軸上的兩個位置，可以在輪軸每次經(jīng)過這兩個位置時產(chǎn)生A或B脈沖。獨立的外部電動計數(shù)器然后從這些脈沖解讀出轉(zhuǎn)速和旋轉(zhuǎn)方向。雖然適用于眾多應用，但是增量式計數(shù)器確實存在某些不足。例如，在輪軸停轉(zhuǎn)情況下，增量編碼器在開始運行之前必須首先通過調(diào)回到某個指定校準點來實現(xiàn)自身校準。另外，增量式計數(shù)器易受到電氣干擾的影響，導致發(fā)送到系統(tǒng)的脈沖不準確，進而造成旋轉(zhuǎn)計數(shù)錯誤。不僅如此，許多增量編碼器屬于光電器件，如果對目標應用有影響，則
- 關鍵字： 編碼器 分解器 RDC FPGA 脈沖
Tcl在Vivado中的應用
- Xilinx的新一代設計套件 Vivado 相比上一代產(chǎn)品 ISE， 在運行速度、算法優(yōu)化和功能整合等很多方面都有了顯著地改進。 但是對初學者來說，新的約束語言 XDC 以及腳本語言 Tcl 的引入則成為了快速掌握 Vivado 使用技巧的最大障礙，以至于兩年多后的今天，仍有很多用戶缺乏升級到 Vivado 的信心。 本文介紹了 Tcl 在 Vivado 中的基礎應用，希望起到拋磚引玉的作用，指引使用者在短時間內(nèi)快速掌握相關技巧，更好地發(fā)揮 Vivado 在 FPGA 設計中的優(yōu)勢。 1
- 關鍵字： Xilinx VivadoTcl FPGA cells
Altera: FPGA集成硬核浮點DSP
- 1 FPGA浮點運算推陳出新 以往FPGA在進行浮點運算時，為符合IEEE 754標準，每次運算都需要去歸一化和歸一化步驟，導致了極大的性能瓶頸。因為這些歸一化和去歸一化步驟一般通過FPGA中的大規(guī)模桶形移位寄存器實現(xiàn)，需要大量的邏輯和布線資源。通常一個單精度浮點加法器需要500個查找表(LUT)，單精度浮點要占用30%的LUT，指數(shù)和自然對數(shù)等更復雜的數(shù)學函數(shù)需要大約1000個LUT。因此隨著DSP算法越來越復雜，F(xiàn)PGA性能會明顯劣化，對占用80%～90%邏輯資源的FPGA會造成嚴重的布線擁
- 關鍵字： Altera FPGA LUT DSP 數(shù)據(jù)通路
三相SPWM波形發(fā)生器的設計與仿真
- 本文提出了一種采用VHDL硬件描述語言設計新型三相正弦脈寬調(diào)制（SPWM）波形發(fā)生器的方法。該方法以直接數(shù)字頻率合成技術(DDS)為核心產(chǎn)生三相SPWM信號。并且利用VHDL設計了死區(qū)時間可調(diào)的死區(qū)時間控制器，解決了傳統(tǒng)的模塊電路等待方法很難產(chǎn)生帶精確死區(qū)時間控制的SPWM信號的問題。該方法在Quartus II 9.1環(huán)境平臺下進行了仿真驗證，并將設計程序下載到DE2-70實驗板進行實驗測試，用示波器測試得到了死區(qū)時間可控制的SPWM波形。
- 關鍵字： VHDL SPWM DDS 死區(qū)時間 FPGA 201505
聲納圖像動態(tài)范圍擴展與FPGA實現(xiàn)
- 本文針對成像聲納擴展圖像動態(tài)范圍和增強圖像細節(jié)的需求，提出了一種基于開方運算的動態(tài)范圍擴展方法?；谡n題組研制的多波束成像聲納原理樣機的研制，分析了數(shù)據(jù)動態(tài)范圍壓縮導致圖像細節(jié)丟失的原因及其對成像質(zhì)量的影響，采用JPL快速平方根近似算法改善了開方運算FPGA實現(xiàn)過程的資源占用和系統(tǒng)延時。最后，對改進設計方案進行了實驗驗證，通過多波束成像聲納系統(tǒng)的消聲水池實驗證明了本文動態(tài)范圍擴展方法的有效性和可行性，系統(tǒng)成像質(zhì)量改善明顯，達到優(yōu)化設計的預期目標。
- 關鍵字： 成像聲納 動態(tài)范圍 平方根 FPGA 波束成像 201505
基于FPGA的LZO實時無損壓縮的硬件設計
- 本文通過對多種壓縮算法作進一步研究對比后發(fā)現(xiàn)，LZO壓縮算法是一種被稱為實時無損壓縮的算法，LZO壓縮算法在保證實時壓縮速率的優(yōu)點的同時提供適中的壓縮率。如圖1(A)給出了Linux操作系統(tǒng)下常見開源壓縮算法的壓縮速率的測試結(jié)果，LZO壓縮算法速率極快;如圖1(B)給出了Gzip壓縮算法和LZO壓縮算法的壓縮率測試結(jié)構(gòu)，從圖中可以看出，LZO壓縮算法可以提供平均約50%的壓縮率。 1 LZO壓縮算法基本原理分析 1.1 LZO壓縮算法壓縮原理 LZO壓縮算法采用(重復長度L，指回
- 關鍵字： LZO FPGA LZSS RAM 壓縮算法
使用FPGA實現(xiàn)靈活的USB Type-C接口控制
- 1 USB Type-C接口介紹 二十年前，第一代通用串行總線(Universal Serial Bus, USB 1.0)的出現(xiàn)，為各自為政的電子行業(yè)通信標準注入了互通性。而最新發(fā)布的USB Type-C接口規(guī)范將USB技術提升到了一個新的高度，能夠滿足21世紀電子行業(yè)的需求，同時也將再一次改變計算機、消費類電子產(chǎn)品以及移動設備之間的互連方式。輕薄、堅固、無需區(qū)分插頭方向的USB Type-C連接器拓展了由USB 3.1超速(SuperSpeed+)規(guī)范定義的各項功能，采用雙通道實現(xiàn)高達20
- 關鍵字： FPGA USB Type-C 充電器 嵌入式
基于FPGA的高可靠全自動加樣器
- 1 系統(tǒng)方案 智能加樣器系統(tǒng)以FPGA為控制核心，通過控制步進電機的運動，結(jié)合到位傳感器，控制整個設備機械平臺的正常運轉(zhuǎn);通過處理液位傳感器信號和控制泵閥一體模塊，實現(xiàn)加樣功能;同時，采用無線網(wǎng)絡與安卓手機通訊，將安卓手機作為無線控制終端和數(shù)據(jù)顯示平臺。系統(tǒng)的設計方案如圖1所示。 為了提高系統(tǒng)加樣速率與效率，設計了以試管架作為加樣單位的加樣方式。如圖2所示，系統(tǒng)由步進電機帶動機械推臂和行車，實現(xiàn)試管架在進樣倉、加樣區(qū)與出樣倉之間的推動轉(zhuǎn)移，并在加樣區(qū)實現(xiàn)對試管的依次加樣。這種新型的加樣
- 關鍵字： FPGA 傳感器 液位探測 注射器 單片機
結(jié)合FPGA與DSP的仿人假手控制系統(tǒng)設計
- 仿人假手作為肢殘患者重獲人手功能的主要對象，具有重大的社會需求。理想的假手應具有人手的仿生特征，主要體現(xiàn)在假手構(gòu)造、控制方式與環(huán)境感知3個方面，但由于其有限的體積和復雜的傳感器系統(tǒng)，對控制系統(tǒng)提出了更高的要求。 現(xiàn)有的控制系統(tǒng)有外置式和內(nèi)置式兩種。外置式控制系統(tǒng)多用于研究型假手，如Cyber Hand，Tokyo Hand，Vanderbilt Hand等，這種控制系統(tǒng)主要用于算法、方案的驗證，在殘疾人應用上推廣意義較小。內(nèi)置式控制系統(tǒng)在研究型假手和商業(yè)型假手上均有應用，其中研究型假手控制系統(tǒng)，
- 關鍵字： FPGA DSP
一種基于FPGA的OLED顯示系統(tǒng)
- 針對LCD顯示屏溫度適應性差、可視角度小、LCD的通用驅(qū)動電路實現(xiàn)的對比度較低等缺點,采用OLED作為顯示器件,設計并實現(xiàn)了一種使用FPGA驅(qū)動OLED的顯示系統(tǒng)。采用PIC16F690單片機作為微處理器控制整機時序,利用FPGA進行視頻信號處理,完成格式轉(zhuǎn)換、色空間處理以及隔行轉(zhuǎn)逐行操作,最終實現(xiàn)驅(qū)動顯示。系統(tǒng)的測試結(jié)果表明,該方案不僅能顯著提高畫面對比度,而且能穩(wěn)定顯示監(jiān)控圖像,為后繼功能的拓展提供了平臺。 一種基于FPGA的OLED顯示系統(tǒng).pdf
- 關鍵字： FPGA OLED
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