- FPGA的低功耗設計分析,FPGA的功耗高度依賴于用戶的設計，沒有哪種單一的方法能夠實現這種功耗的降低，在進行低功耗器件的設計時，人們必須仔細權衡性能、易用性、成本、密度以及功率等諸多指標?！ ”M管基于90nm工藝的FPGA的功耗已低于先
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分析 設計 功耗 FPGA
- 基于Flash構架的模數混合的FPGA在心電監(jiān)控儀上的應用設計,Fution系列的FPGA是世界上首個基于Flash構架的模數混合的FPGA，即在數字FPGA的基礎上加入了模擬電路部分，解決了傳統(tǒng)模擬電路和FPGA分離給設計帶來的諸多問題，降低了PCB板的制作難度，縮小了產品的體積。FPGA的可編
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心電 監(jiān)控 應用 設計 FPGA 混合 Flash 構架 模數 基于
- 怎樣在FPGA中處理開關控制信號,本系統(tǒng)設計利用FPGA間接控制2塊MAX4312選通所需要的視頻通道，實現各個視頻通道間相互切換。根據開關控制信號的設計思想在FPGA中對撥動開關輸入信號做去抖動處理，然后對不同的開關操作進行編碼，最后將信號送給DSP進
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控制 信號 開關 處理 FPGA 怎樣
- 可編程邏輯芯片設計商 Altera公司本周一宣布將使用臺積電公司的28nm LP(低功耗)制程技術制造其廉價型中端FPGA芯片產品。今年4月份，Altera公司曾宣布他們將使用臺積電的高性能(HP)28nm工藝制作其高端 Statix V FPGA產品，因此這次用同樣來自臺積電的28nm低功耗制程對應其中端產品自然是順理成章。
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Altera FPGA
- 摘 要： 設計并實現了一個基于Nios II的語音加密傳輸系統(tǒng)。介紹了進行語音信號處理的功能模塊，包括語音采集回放模塊、基于G.729A的語音壓縮與解壓縮模塊和基于AES的數據加解密模塊。在控制模塊的協調下，使得語音
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傳輸系統(tǒng) 設計 加密 語音 Nios II 基于
- 摘要：基于ICX229AK CCD芯片組設計了具有VGA接口的一體化攝像機。采用DSP+FPGA+ASIC的構架，完成了視頻信號的采集和多格式顯示。在FPGA中實現了自動聚 焦、自動光圈等功能，并擴展了鼠標驅動及劃線、OSD顯示等實用功
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DSP FPGA 視頻 采集 CCD 傳感器 A／D
- 摘要：在深入研究Nios自定制指令的軟硬件接口的基礎上，利用 Matlab／DSP Builder建立快速傅里葉變換FFT核心運算指令基本模型，然后用Altera公司提供的Singacompiler工具對其進行編譯，產生 QuartusⅡ能夠識別的VHDL
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Nios FFT 算法 軟硬件
- 摘要：在儀器儀表電路中，人機交互界面是必不可少的環(huán)節(jié)。為了解決單純采用單片機制作的系統(tǒng)功耗高、速度慢、電路結構繁瑣的問題，同時為了 發(fā)揮出單片機的靈活性和FPGA的高速性，系統(tǒng)采用C805lF020單片機和CycloneⅡ
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FPGA 單片機 人機交互系統(tǒng)
- 美國國家標準與技術局(NationalInstituteofStandardandTechnology，NIST)于1997年1月提出發(fā)展AES(Ad...
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FPGA AES算法 S-box
- 基于DSP和FPGA的衛(wèi)星測控多波束系統(tǒng)設計,一、引言
衛(wèi)星測控多波束系統(tǒng)主要針對衛(wèi)星信號實施測控，它包括兩個方面：信號波達方向(DOA)的估計和數字波束合成。波達方向的估計是對空間信號的方向分布進行超分辨估計，提取空間源信號的參數如方位角、仰
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系統(tǒng) 設計 衛(wèi)星 FPGA DSP 基于
- 針對現有的 RFID 閱讀器具有體積大和不容易升級的缺點，依據 FPGA具有開發(fā)簡單，靜態(tài)可重復編程和動態(tài)在系統(tǒng)編程的特點，研究了基于 FPGA 的 RFID 閱讀器，該種閱讀器具有結構靈活，體積小，升級容易和方便實現不同的外設接口等優(yōu)點，閱讀器以 FGPA 芯片為核心，實現了 RFID 閱讀器的各種設備接口，采用串口 中斷服務程序接收標簽的數據信息，LCD 顯示標簽的數據信息。在 FPGA 集成開發(fā)環(huán)境中編譯，調試和綜合， 使用專用下載線將程序下載到 FPGA 芯片中實現其功能。實驗結果表明：FPGA
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FPGA RFID 閱讀器
- 本文面向實時圖像采集和處理，采用模塊化設計思想，以TMS320DM642、SAA7115、OSD FPGA等實現了視頻圖像采集和處理系統(tǒng)的硬件電路，該系統(tǒng)電路簡單、結構緊湊、調節(jié)靈活、可靠性高、實時性強的特點，通過驗證，滿足設計的應用要求，可為今后視頻圖像采集和處理的進一步研發(fā)提供參考。
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FPGA 320 642 CCD
- 摘要：為了改變人工神經網絡的研究僅僅局限于算法，只是在通用的串行或并行計算機上模擬實現的現狀，針對函數逼近問題，將BP神經網絡的結構分為3個模塊，采用VHDL語言完成對各個模塊的硬件描述，并使用Altera公司的Q
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FPGA 人工神經 網絡系統(tǒng) 實現方法
- 摘要：利用鎖相環(huán)進行載波跟蹤是獲取本地載波的一種重要方法，針對鎖相環(huán)的噪聲性能和跟蹤速度不能同時達到最優(yōu)的限制，在鎖相環(huán)PLL中引入自適應模塊，根據環(huán)路所處的環(huán)境自適應對PLL環(huán)路參數做出調整。設計中利用仿
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FPGA 鎖相環(huán)
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