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          低碼率語音編碼MELP聲碼器的SOPC實現(xiàn)

          • 摘要:討論了低碼率語音編碼MELP的編解碼過程,有效降低了語音編碼碼率并能使說話者個人語音特征減弱,特...
          • 關(guān)鍵字: SOPC  MELP  語音編碼  FPGA  NiosII  

          SignalTapII ELA的FPGA在線調(diào)試技術(shù)

          • 通過對FPGA內(nèi)部信號的捕獲測試,可以實現(xiàn)對系統(tǒng)設(shè)計缺陷的實時分析和修正。與外部測試設(shè)備相比,可以總結(jié)出SignalTapII ELA的幾點優(yōu)越性:不占用額外的I/O引腳,不占用PCB上的空間,不破壞信號的時序和完整性,不需額外費用;從多方面證實,該測試手段可以減少調(diào)試時間,縮短設(shè)計周期。
          • 關(guān)鍵字: SignalTapII  FPGA  ELA  在線調(diào)試    

          誰會在代工投資“盛宴”中缺席?

          •   在前3年之前全球代工總是在看前4大的動向,包括臺積電、聯(lián)電、中芯國際及特許。然而,臺積電一家獨大,聯(lián)電居老二似乎也相安無事。   自AMD分出Globalfoundries,及ATIC又兼并特許,再把Globalfoundries與特許合并在一起。表面上看少了一個特許,實際上由于Globalfoundries在其金主支持下積極建新廠,在代工業(yè)界引發(fā)了波浪,至少誰將成為老二成為話題。   加上存儲器大享三星近期開始投資代工,放言要接高通的手機(jī)芯片訂單;加上fabless大廠Xilinx改變策略,把2
          • 關(guān)鍵字: 臺積電  FPGA  28nm  

          基于FPGA的RS485接口誤碼測試儀的設(shè)計和實現(xiàn)

          • 介紹了一種基于FPGA的誤碼測試儀的設(shè)計原理、實現(xiàn)過程及調(diào)試經(jīng)驗。該誤碼測試系統(tǒng)使用RS485接口,具有原理簡單、接口獨特、功能豐富等特點,系統(tǒng)具有較好的可擴(kuò)展性。
          • 關(guān)鍵字: FPGA  485  RS  接口    

          子帶分解的自適應(yīng)濾波器的FPGA實現(xiàn)

          • 基于子帶分解的自適應(yīng)濾波器在提高收斂性能的同時又可以節(jié)省一定的計算量。采用Altera公司的仿真軟件Altera DSP Builder和QuartusⅡ7.2進(jìn)行子帶分解的NLMS算法的自適應(yīng)濾波器現(xiàn)場可編程門陣列設(shè)計,利用Simulink和ModelSim對設(shè)計方案進(jìn)行了模型仿真和功能仿真,達(dá)到較好的效果。
          • 關(guān)鍵字: FPGA  分解  自適應(yīng)濾波器    

          常用FPGA/CPLD四種設(shè)計技巧

          • 常用FPGA/CPLD四種設(shè)計技巧,FPGA/CPLD的設(shè)計思想與技巧是一個非常大的話題,本文僅介紹一些常用的設(shè)計思想與技巧,包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意,如果能有意識地利用這些原則指導(dǎo)日
          • 關(guān)鍵字: 技巧  設(shè)計  FPGA/CPLD  常用  

          AEMB軟核處理器的SoC系統(tǒng)驗證平臺的構(gòu)建

          • SoC芯片的規(guī)模一般遠(yuǎn)大于普通的ASIC,同時深亞微米工藝帶來的設(shè)計困難等使得SoC設(shè)計的復(fù)雜度大大提高。仿...
          • 關(guān)鍵字: FPGA  SoC  系統(tǒng)驗證平臺  AEMB  軟核處理器  

          基于FPGA的RS485接口誤碼測試儀的設(shè)計

          • 摘要:介紹了一種基于FPGA的誤碼測試儀的設(shè)計原理、實現(xiàn)過程及調(diào)試經(jīng)驗。該誤碼測試系統(tǒng)使用RS485接口...
          • 關(guān)鍵字: FPGA  RS485  誤碼測試儀  

          可實現(xiàn)快速鎖定的FPGA片內(nèi)延時鎖相環(huán)設(shè)計

          • 摘要:延時鎖相環(huán)(DLL)是一種基于數(shù)字電路實現(xiàn)的時鐘管理技術(shù)。DLL可用以消除時鐘偏斜,對輸入時鐘進(jìn)行分頻、倍頻、移相等操作。文中介紹了FPGA芯片內(nèi)DLL的結(jié)構(gòu)和設(shè)計方案,在其基礎(chǔ)上提出可實現(xiàn)快速鎖定的延時鎖相環(huán)
          • 關(guān)鍵字: FPGA  延時  鎖相環(huán)    

          使用SignalTap II邏輯分析儀調(diào)試FPGA

          • 摘 要 :本文介紹了可編程邏輯器件開發(fā)工具Quartus II 中SingalTap II 嵌入式邏輯分析器的使用,并給出一個具體的設(shè)計實例,詳細(xì)介紹使用SignalTap II對FPGA調(diào)試的具體方法和步驟。
            關(guān)鍵字 : SignalTap;硬件調(diào)試
          • 關(guān)鍵字: SignalTap  FPGA  邏輯分析儀  調(diào)試    

          復(fù)用器重構(gòu)降低FPGA成本

          • 摘 要: 本文介紹了一種新的復(fù)用器重構(gòu)算法,能夠降低FPGA實際設(shè)計20%的成本。該算法通過減少復(fù)用器所需查找表(LUT)的數(shù)量來實現(xiàn)。算法以效率更高的4:1復(fù)用器替代2:1復(fù)用器樹。算法性能的關(guān)鍵在于尋找總線上出現(xiàn)的
          • 關(guān)鍵字: FPGA  復(fù)用器    

          利用FPGA和CPLD數(shù)字邏輯實現(xiàn)ADC

          • 數(shù)字系統(tǒng)的設(shè)計人員擅長在其印制電路板上用FPGA和CPLD將各種處理器、存儲器和標(biāo)準(zhǔn)的功能元件粘合在一起來實現(xiàn)數(shù)字設(shè)計。除了這些數(shù)字功能之外,F(xiàn)PGA和CPLD還可以使用LVDS輸入、簡單的電阻電容(RC)電路和一些FPGA或CP
          • 關(guān)鍵字: FPGA  CPLD  ADC  數(shù)字邏輯    

          基于Actel FPGA的VGA顯示控制方案

          •   目前無論是工控產(chǎn)品還是消費產(chǎn)品,在需要用到大屏幕的場合最常使用的是基于VGA接口的顯示器。VGA接口的顯示器具有顯示分辨率大、顯示圖像細(xì)膩、彩色效果突出等特點。正是由于這些優(yōu)點,VGA接口的控制器廣泛應(yīng)用于各種終端設(shè)備、醫(yī)療儀器、汽車電子、消費電子等領(lǐng)域。   1.VGA簡介   VGA是視頻圖形陣列(Video Graphics Array)的簡稱,是IBM于1987年提出的一個使用模擬信號的圖形顯示標(biāo)準(zhǔn)。最初的VGA標(biāo)準(zhǔn)最大只能支持640*480分辨率的顯示器,而為了適應(yīng)大屏幕的應(yīng)用,視頻
          • 關(guān)鍵字: Actel  FPGA  VGA接口  201005  

          可編程和自營業(yè)務(wù)是提升利潤的竅門

          •   在芯片市場,很多廠商在追逐著摩爾定律,例如CPU、存儲器、FPGA等產(chǎn)品靠工藝的進(jìn)步來降低單位成本,靠大批量通用產(chǎn)品來獲利。除此之外,另一種可取的方法是做高附加價值產(chǎn)品。不久前,Cypress公司市場傳訊部高級總監(jiān)Joseph L. McCarthy向本刊介紹了該公司這幾年的戰(zhàn)略轉(zhuǎn)型:該公司正從做通用產(chǎn)品轉(zhuǎn)為可編程器件和自營產(chǎn)品上來(圖1),2009年可編程和自營產(chǎn)品比例已達(dá)到81%。這兩部分可使產(chǎn)品的單價上升,產(chǎn)生更高的利潤。   PSoC/觸控可編程戰(zhàn)略   為了實施可編程戰(zhàn)略,2003年
          • 關(guān)鍵字: Cypress  摩爾定律  CPU  存儲器  FPGA  201005  

          半導(dǎo)體訂單增長背后的隱患

          •   DSP 漲價、FPGA漲價、放大器漲價,沒有一個不漲價的半導(dǎo)體器件。而據(jù)筆者調(diào)查,目前,很多客戶由于持續(xù)延長的訂貨周期,不得不采取雙重訂貨方式,近期華爾街分析師指出,目前可編程邏輯商賽靈思正在面臨著這種風(fēng)險。   JP摩根的分析師ChristopherDanely在5月18日的一份報告中指出,部分Virtex-5的供貨周期由4至6周已延長至10周以上。   實際上不少華爾街的分析師近幾周來紛紛發(fā)表報告,稱擔(dān)心FPGA供應(yīng)商Xilinx及Altera的庫存情況,不過某些人士卻認(rèn)為不必為此擔(dān)心。賽靈思
          • 關(guān)鍵字: 半導(dǎo)體  FPGA  
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