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用FPGA構(gòu)建邊緣AI推理應(yīng)用很難？這樣做，變簡單！
- 對于希望在邊緣的推理處理器上實施人工智能 (AI) 算法的設(shè)計人員來說，他們正不斷面臨著降低功耗并縮短開發(fā)時間的壓力，即使在處理需求不斷增加的情況下也是如此?，F(xiàn)場可編程門陣列 (FPGA) 為實施邊緣AI所需的神經(jīng)網(wǎng)絡(luò) (NN) 推理引擎提供了特別有效的速度和效率效率組合。然而，對于不熟悉 FPGA 的開發(fā)人員來說，傳統(tǒng)FPGA的開發(fā)方法可能相當(dāng)復(fù)雜，往往導(dǎo)致他們?nèi)ミx擇不太理想的解決方案。本文將介紹來自Microchip Technology的一種比較簡單的方法。通過這種方法，開發(fā)人員可以使用FPGA和軟
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實驗15：環(huán)形計數(shù)器
- 實驗?zāi)康模?）熟悉和掌握FPGA開發(fā)流程和Lattice Diamond軟件使用方法；（2）通過實驗理解和掌握環(huán)形計數(shù)器原理；（3）學(xué)習(xí)用Verilog HDL行為級描述時序邏輯電路。實驗任務(wù)設(shè)計一個4位右循環(huán)一個1的環(huán)形計數(shù)器。實驗原理將移位寄存器的輸出q0連接到觸發(fā)器q3的輸入，并且在這4個觸發(fā)器中只有一個輸出為1，另外3個為0，這樣就構(gòu)成了一個環(huán)形計數(shù)器。初始化復(fù)位時，給q0一個置位信號，則唯一的1將在環(huán)形計數(shù)器中循環(huán)移位，每4個時鐘同期輸出一個高電平脈沖。Verilog HDL建模描述用行為級描述
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實驗14：移位寄存器
- 實驗?zāi)康模?）熟悉和掌握FPGA開發(fā)流程和Lattice Diamond軟件使用方法；（2）通過實驗理解和掌握移位寄存器原理；（3）學(xué)習(xí)用Verilog HDL行為級描述時序邏輯電路。實驗任務(wù)本實驗的任務(wù)是設(shè)計一個7位右移并行輸入、串行輸出的移位寄存器。實驗原理如果將多個觸發(fā)器級聯(lián)就構(gòu)成一個多位的移位寄存器，如下圖所示，是以4位移位寄存器為例的邏輯電路圖，其中的LD/SHIFT是一個置數(shù)/移位控制信號。當(dāng)LD/SHIFT為1時，在CP作用下，從輸入端A、B、C、D并行接收數(shù)據(jù)；當(dāng)LD/SHIFT為0時，在
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實驗13：JK觸發(fā)器
- 實驗?zāi)康模?）熟悉和掌握FPGA開發(fā)流程和Lattice Diamond軟件使用方法；（2）通過實驗理解和掌握J(rèn)K觸發(fā)器原理；（3）學(xué)習(xí)用Verilog HDL語言行為機(jī)描述方法描述JK觸發(fā)器電路。實驗任務(wù)本實驗的任務(wù)是設(shè)計一個JK觸發(fā)器實驗原理帶使能端RS鎖存器的輸入端R=S=1時，鎖存器的次態(tài)不確定，這一因素限制了其應(yīng)用。為了解決這個問題，根據(jù)雙穩(wěn)態(tài)元件兩個輸出端互補(bǔ)的特點，用Q和非Q反饋控制輸入信號，并用J代替S,用K代替R,構(gòu)成了J-K鎖存器。Verilog HDL建模描述用行為級描述實現(xiàn)的帶異步
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實驗12：邊沿觸發(fā)的D觸發(fā)器
- 實驗?zāi)康模?）熟悉和掌握FPGA開發(fā)流程和Lattice Diamond軟件使用方法；（2）通過實驗理解和掌握D觸發(fā)器原理；（3）學(xué)習(xí)用Verilog HDL語言行為機(jī)描述方法描述D觸發(fā)器電路。實驗任務(wù)本實驗的任務(wù)是描述一個帶有邊沿觸發(fā)的同步D觸發(fā)器電路，并通過STEP FPGA開發(fā)板的12MHz晶振作為觸發(fā)器時鐘信號clk，撥碼開關(guān)的狀態(tài)作為觸發(fā)器輸入信號d，觸發(fā)器的輸出信號q和~q，用來分別驅(qū)動開發(fā)板上的LED，在clk上升沿的驅(qū)動下，當(dāng)撥碼開關(guān)狀態(tài)變化時LED狀態(tài)發(fā)生相應(yīng)變化。實驗原理從D觸發(fā)器的特
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實驗11：RS觸發(fā)器
- 實驗?zāi)康模?）熟悉和掌握FPGA開發(fā)流程和Lattice Diamond軟件使用方法；（2）通過實驗理解和掌握RS觸發(fā)器原理；（3）學(xué)習(xí)用Verilog HDL語言行為級描述方法描述RS觸發(fā)器電路。實驗任務(wù)本實驗的任務(wù)是描述一個RS觸發(fā)器電路，并通過STEP FPGA開發(fā)板的12MHz晶振作為觸發(fā)器時鐘信號clk，撥碼開關(guān)的狀態(tài)作為觸發(fā)器輸入信號S,R，觸發(fā)器的輸出信號Q和非Q，用來分別驅(qū)動開發(fā)板上的LED，在clk上升沿的驅(qū)動下，當(dāng)撥碼開關(guān)狀態(tài)變化時LED狀態(tài)發(fā)生相應(yīng)變化。實驗原理基本RS觸發(fā)器可以由兩
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實驗10：七段數(shù)碼管
- 1. 實驗?zāi)康模?）熟悉和掌握FPGA開發(fā)流程和Lattice Diamond軟件使用方法；（2）通過實驗理解和掌握數(shù)碼管驅(qū)動；（3）學(xué)習(xí)用Verilog HDL描述數(shù)碼管驅(qū)動電路。2. 實驗任務(wù)在數(shù)碼管上顯示數(shù)字。3. 實驗原理數(shù)碼管是工程設(shè)計中使用很廣的一種顯示輸出器件。一個7段數(shù)碼管（如果包括右下的小點可以認(rèn)為是8段）分別由a、b、c、d、e、f、g位段和表示小數(shù)點的dp位段組成。實際是由8個LED燈組成的，控制每個LED的點亮或熄滅實現(xiàn)數(shù)字顯示。通常數(shù)碼管分為共陽極數(shù)碼管和共陰極數(shù)碼管，結(jié)構(gòu)如下圖
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Microchip FPGA采用量身定制的PolarFire FPGA和SoC解決方案協(xié)議棧
- 為智能邊緣設(shè)計系統(tǒng)正面臨前所未有的困難。市場窗口在縮小，新設(shè)計的成本和風(fēng)險在上升，溫度限制和可靠性成為雙重優(yōu)先事項，而對全生命周期安全性的需求也在不斷增長。要滿足這些同時出現(xiàn)的需求，需要即時掌握特殊技術(shù)和垂直市場的專業(yè)知識。沒有時間從頭開始。Microchip Technology Inc.（美國微芯科技公司）今日宣布在其不斷增長的中端FPGA和片上系統(tǒng)（SoC）支持系列產(chǎn)品中增加了九個新的技術(shù)和特定應(yīng)用解決方案協(xié)議棧，涵蓋工業(yè)邊緣、智能嵌入式視覺和邊緣通信。Microchip FPGA業(yè)務(wù)部戰(zhàn)略副總裁S
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英特爾計劃將可編程解決方案事業(yè)部作為獨(dú)立業(yè)務(wù)運(yùn)營
- 英特爾公司宣布計劃拆分旗下的可編程解決方案事業(yè)部（PSG），將其作為獨(dú)立業(yè)務(wù)運(yùn)營。這一決定將賦予PSG所需的自主性和靈活性，以全面加速其發(fā)展，并更有力地參與FPGA行業(yè)的競爭，并廣泛服務(wù)于包括數(shù)據(jù)中心、通信、工業(yè)、汽車和航空航天等領(lǐng)域在內(nèi)的多個市場。英特爾還宣布，英特爾執(zhí)行副總裁Sandra Rivera將擔(dān)任PSG部門的首席執(zhí)行官，同時Shannon Poulin將擔(dān)任首席運(yùn)營官。在英特爾的持續(xù)支持下，PSG部門的獨(dú)立運(yùn)營預(yù)計將于2024年1月1日開始。英特爾預(yù)計在發(fā)布2024年第一季度財報時，將PSG
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AMD Kria K24 SOM加速工業(yè)及商業(yè)電機(jī)控制應(yīng)用創(chuàng)新
- 電機(jī)控制系統(tǒng)無處不在，據(jù)統(tǒng)計電機(jī)控制消耗了全球工業(yè)能源總用量的70%。隨著電機(jī)系統(tǒng)變得更加精密復(fù)雜，提供各種速度能力，并且越來越多采用新材料設(shè)計，包括碳化硅和氮化鎵來提升效率與性能，同時還能夠降低能耗。新的現(xiàn)代電機(jī)需要先進(jìn)的電機(jī)驅(qū)動系統(tǒng)來控制這些電機(jī)，這樣才能使其扭矩、速度以及應(yīng)變速達(dá)到最大，同時還能使能耗降到最低。電機(jī)驅(qū)動系統(tǒng)主要是有三個要素，第一是驅(qū)動器，第二是供電部分，第三是電機(jī)本身。因此專家也表示，提高電機(jī)的效率將對全球用電量產(chǎn)生顯著的積極影響。提高這些應(yīng)用的效率夠使能耗降低15%到40%。所以，
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英特爾宣布分拆FPGA業(yè)務(wù)，目標(biāo)2-3年后獨(dú)立IPO！
- 英特爾今天通過官網(wǎng)正式宣布，將負(fù)責(zé)開發(fā)英特爾的 Agilex、Stratix 和其他 FPGA 產(chǎn)品的可編程解決方案部門（PSG）剝離，作為獨(dú)立業(yè)務(wù)運(yùn)營，目標(biāo)是在兩到三年后 IPO中出售部分業(yè)務(wù)。英特爾宣布將PSG獨(dú)立，并推向IPO2015年5月底，英特爾宣布以167億美元完成了對Altera的收購，成為了其后來的PSG部門，這也是英特爾史上規(guī)模最大的一筆收購。Altera在20年前發(fā)明了世界上第一個可編程邏輯器件，尤以FPGA芯片著稱。隨后在2020年，英特爾的競爭對手AMD也宣布以350億美元的估值收
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打造強(qiáng)大產(chǎn)品陣容,英特爾FPGA產(chǎn)品系列再添新成員
- 為滿足客戶不斷增長的需求，英特爾近日宣布將進(jìn)一步擴(kuò)大英特爾Agilex? FPGA產(chǎn)品系列的陣容，并繼續(xù)擴(kuò)展可編程解決方案事業(yè)部（PSG）的產(chǎn)品供應(yīng)范圍，以滿足日益增長的定制化工作負(fù)載（包括增強(qiáng)的AI功能）的需求，同時提供更低的總體擁有成本（TCO）和更完整的解決方案。在9月18日的英特爾FPGA技術(shù)日（IFTD）期間，英特爾將重點介紹這些新產(chǎn)品和技術(shù)，屆時硬件工程師、軟件開發(fā)人員和系統(tǒng)架構(gòu)師將與英特爾及合作伙伴專家進(jìn)行深入交流和互動。?“今年1月，我們宣布對Agilex產(chǎn)品系列進(jìn)行擴(kuò)容，以便讓
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離線 PFC－PWM 組合控制器
- 本應(yīng)用說明解決了電力公司廣泛使用的變壓器和其他電源效率質(zhì)量低下的原因。接下來是建議的離線 PFC-PWM 組合控制器架構(gòu)，該架構(gòu)可以極大地幫助緩解功率轉(zhuǎn)換器內(nèi)電流線路中高諧波含量的困境。此外，還評估了該設(shè)計架構(gòu)，以了解其對系統(tǒng)整體效率的影響。本應(yīng)用說明解決了電力公司廣泛使用的變壓器和其他電源效率質(zhì)量低下的原因。接下來是建議的離線 PFC-PWM 組合控制器架構(gòu)，該架構(gòu)可以極大地幫助緩解功率轉(zhuǎn)換器內(nèi)電流線路中高諧波含量的困境。此外，還評估了該設(shè)計架構(gòu)，以了解其對系統(tǒng)整體效率的影響。
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