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COOLMOS器件在開關(guān)電源中的應(yīng)用研究
- 關(guān)鍵字： COOLMOS PWM 開關(guān)電源 功率器件
基于FPGA的太陽跟蹤器的設(shè)計(jì)及實(shí)現(xiàn)
- 在簡(jiǎn)要介紹地日運(yùn)行規(guī)律的基礎(chǔ)上，確定了視日運(yùn)動(dòng)跟蹤法的計(jì)算模型及跟蹤裝置的機(jī)械結(jié)構(gòu)。采用FPGA芯片XC3S1500為處理器，以步進(jìn)電機(jī)為執(zhí)行機(jī)構(gòu)，采用Verilog語言設(shè)計(jì)實(shí)現(xiàn)了高度角一方位角太陽跟蹤系統(tǒng)。根據(jù)系統(tǒng)的要求建立了計(jì)時(shí)模塊、太陽高度角方位角計(jì)算模塊、日出日落時(shí)間計(jì)算模塊和步進(jìn)電機(jī)脈沖控制模塊。通過實(shí)驗(yàn)測(cè)試該系統(tǒng)能夠達(dá)到預(yù)期的性能指標(biāo)，對(duì)提高太陽能的利用率具有重要的現(xiàn)實(shí)意義。
- 關(guān)鍵字： FPGA 跟蹤器
基于FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)
- 基于FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng),本系統(tǒng)立足于利用Intemet實(shí)現(xiàn)核環(huán)境信息的遠(yuǎn)程采集。在實(shí)現(xiàn)上，采用了基于SOPC技術(shù)的嵌入式解決方案，通過在FPGA中嵌入NioslI軟核處理器和所需外設(shè)的IP Core(硅知識(shí)產(chǎn)權(quán)核)，然后再配備相應(yīng)的網(wǎng)絡(luò)接口，實(shí)現(xiàn)利用互聯(lián)
- 關(guān)鍵字： 系統(tǒng) 監(jiān)控系統(tǒng) 遠(yuǎn)程 嵌入式 基于 FPGA
基于FPGA的SoC和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)
- 本系統(tǒng)立足于利用Intemet實(shí)現(xiàn)核環(huán)境信息的遠(yuǎn)程采集。在實(shí)現(xiàn)上，采用了基于SOPC技術(shù)的嵌入式解決方案，通過...
- 關(guān)鍵字： 遠(yuǎn)程監(jiān)控 SoC 嵌入式 FPGA
基于FPGA和頻率合成器的GPS信號(hào)源的設(shè)計(jì)
- 頻率合成器是發(fā)射系統(tǒng)和接收系統(tǒng)中的核心器件，采用相位負(fù)反饋頻率控制技術(shù)，具有良好的窄帶載波跟蹤性能和...
- 關(guān)鍵字： ADF4360-4 FPGA 頻率合成器 GPS信號(hào)源
FPGA/EPLD的自上而下設(shè)計(jì)方法
- FPGA/EPLD的自上而下設(shè)計(jì)方法,FPGA/EPLD的自上而下(Top-Down)設(shè)計(jì)方法： 傳統(tǒng)的設(shè)計(jì)手段是采用原理圖輸入的方式進(jìn)行的，如圖1所示。通過調(diào)用FPGA/EPLD廠商所提供的相應(yīng)物理元件庫，在電路原理圖中繪制所設(shè)計(jì)的系統(tǒng)，然后通過網(wǎng)表轉(zhuǎn)換產(chǎn)生某一特
- 關(guān)鍵字： 方法 設(shè)計(jì) 自上而下 FPGA/EPLD
基于FPGA與SRAM的大容量數(shù)據(jù)存儲(chǔ)的設(shè)計(jì)
- 基于FPGA與SRAM的大容量數(shù)據(jù)存儲(chǔ)的設(shè)計(jì), 1 前言 針對(duì)FPGA中內(nèi)部BlockRAM有限的缺點(diǎn)，提出了將FPGA與外部SRAM相結(jié)合來改進(jìn)設(shè)計(jì)的方法，并給出了部分VHDL程序?！ ? 硬件設(shè)計(jì) 這里將主要討論以Xilinx公司的FPGA(XC2S600E-6fg456)和ISSI公司的SRAM(IS61
- 關(guān)鍵字： 存儲(chǔ) 設(shè)計(jì) 數(shù)據(jù) 大容量 FPGA SRAM 基于
Altera展示25-Gbps收發(fā)器，樹立滿足業(yè)界帶寬需求關(guān)鍵里程碑
- Altera公司(NASDAQ: ALTR)今天宣布，公司率先在可編程邏輯中成功演示25-Gbps收發(fā)器性能，在收發(fā)器技術(shù)上樹立了關(guān)鍵里程碑。Altera在28-nm收發(fā)器測(cè)試芯片上實(shí)現(xiàn)了這一具有里程碑意義的技術(shù)，該芯片是Altera用于在28-nm FPGA上成功實(shí)現(xiàn)28-Gbps收發(fā)器的原型開發(fā)平臺(tái)。實(shí)現(xiàn)25-Gbps里程碑，使目前已有FPGA解決方案的性能提高兩倍多，并在功能上優(yōu)于競(jìng)爭(zhēng)ASSP產(chǎn)品。您可以在Altera網(wǎng)站上觀看28-nm收發(fā)器測(cè)試芯片的視頻演示。 Altera 28-nm
- 關(guān)鍵字： Altera 收發(fā)器 FPGA
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