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采用FPGA的低功耗系統(tǒng)設(shè)計
- 結(jié)合采用低功耗元件和低功耗設(shè)計技術(shù)在目前比以往任何時候都更有價值。隨著元件集成更多功能，并越來越小型化，對低功耗的要求持續(xù)增長。當(dāng)把可編程邏輯器件用于低功耗應(yīng)用時，限制設(shè)計的低功耗非常重要。本文將討論減小動態(tài)和靜態(tài)功耗的各種方法，并且給出一些例子說明如何使功耗最小化。 功耗的三個主要來源是啟動、待機(jī)和動態(tài)功耗。器件上電時產(chǎn)生的相關(guān)電流即是啟動電流；待機(jī)功耗又稱作靜態(tài)功耗，是電源開啟但I(xiàn)/O上沒有開關(guān)活動時器件的功耗；動態(tài)功耗是指器件正常工作時的功耗。 啟動電流因器件而異
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PWM 至線性信號轉(zhuǎn)換電路
- 本文介紹了一種將PWM 信號轉(zhuǎn)換成放大、緩沖后的線性信號的電路，適用于風(fēng)扇速度控制，允許在3.3V 輸入時提供12V 風(fēng)扇的線性控制。 Maxim 提供各種PWM 輸出的風(fēng)扇速度控制器，使風(fēng)扇速度隨著溫度的變化而改變。通過周期性地控制風(fēng)扇電源的通、斷實現(xiàn)這一控制方案，風(fēng)扇速度由PWM 信號的占空比設(shè)置。這種方案的典型應(yīng)用電路對大多數(shù)情況是可以接受的。然而，有些情況下，由于風(fēng)扇調(diào)制能夠產(chǎn)生嘈雜的噪音，需要用固定電源為風(fēng)扇供電。。 如果給風(fēng)扇周期性供電產(chǎn)生較大的噪音，可以考慮采用圖1 所示電路。這種情況下
- 關(guān)鍵字： PWM 線性信號
基于MSP430 Timer_B的D/A轉(zhuǎn)換
- 摘 要：本文分析了利用MSP430的Timer_B在比較模式下輸出的脈寬調(diào)制(PWM)波，來實現(xiàn)D/A轉(zhuǎn)換的工作原理。介紹了利用MSP430F449的Timer_B的PWM輸出產(chǎn)生正弦波和直流電平的方法，并給出了對應(yīng)的硬件電路和C語言源程序。 關(guān)鍵詞：MSP430F449；脈寬調(diào)制；D/A轉(zhuǎn)換 D/A Conversion Based on MSP430 Timer_B Abstract：This paper analyses the principle of utilizing the PW
- 關(guān)鍵字： D/A轉(zhuǎn)換 MSP430 Timer_B PWM 嵌入式
高壓PWM電源控制器MAX5003
- 1. MAX5003的主要特性 MAX5003是Maxim公司新推出的電源控制器，該芯片可用于設(shè)計隔離或非隔離的高電壓反激或正激模式的DC－DC轉(zhuǎn)換器，主要特性如下： ●內(nèi)置高壓啟動電路，允許輸入電壓范圍為11～110V； ●工作頻率高達(dá)300kHz，外部可選用微型磁性元件和電容器； ●采用QSOP封裝，比SO－14封裝的同類芯片小43％； ●設(shè)計靈活簡單，可根據(jù)需要進(jìn)行設(shè)置： 電流限制、最大占空比、振蕩頻率、欠壓鎖存和軟啟動等； ●具有外同步工作模式； ●精密的內(nèi)部基準(zhǔn)可保證在全溫范圍內(nèi)精
- 關(guān)鍵字： 電源控制器 MAX5003 PWM 模擬IC 電源
PWM 應(yīng)用中的低電壓反饋
- PWM 應(yīng)用中的低電壓反饋 作者：德州儀器 (TI) 電源控制產(chǎn)品部 Steve Mappus 就低電壓高電流電源應(yīng)用而言，開關(guān)式電源門極驅(qū)動要求特別重要。由于幾個 MOSFET 器件通常并聯(lián)以滿足特定設(shè)計的高電流規(guī)范要求，因此單一集成電路控制器與驅(qū)動器解決方案的方便性就不再是可行的選擇。MOSFET 并聯(lián)可降低漏極到源極的導(dǎo)通電阻，并減少傳導(dǎo)損耗。但是，隨著并聯(lián)器件的增多，門極充電的要求也迅速提高。由于 MOSFET 的內(nèi)部阻抗大大低于驅(qū)動級，因此與驅(qū)動并聯(lián)組合相關(guān)的大多數(shù)功率損耗其形式都表現(xiàn)為
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基于FPGA的毫米波多目標(biāo)信號形成技術(shù)的研究
- 毫米波多目標(biāo)信號發(fā)生器通過模擬的方法產(chǎn)生多種類型高精度的雷達(dá)多目標(biāo)回波信號，在實際雷達(dá)系統(tǒng)前端不具備的條件下對雷達(dá)系統(tǒng)后級進(jìn)行調(diào)試，便于制導(dǎo)武器的性能測試，大大加快新武器的研制進(jìn)程。毫米波多目標(biāo)信號產(chǎn)生的關(guān)鍵是要求回波信號距離分辨率極高，常規(guī)的多目標(biāo)信號產(chǎn)生方法如使用數(shù)字延時線產(chǎn)生多目標(biāo)之間的延時，其控制不靈活，并且有些延時線需要接ECL電源，使用不方便也增加了設(shè)計的復(fù)雜度。使用分立元件實現(xiàn)延時則使電路元件過多，電路的穩(wěn)定性及延時的精確性也會大大降低。本文介紹一種新的產(chǎn)生毫米波雷達(dá)模擬器的多目標(biāo)信號的方法
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PWM 應(yīng)用中的低電壓反饋
- 就低電壓高電流電源應(yīng)用而言，開關(guān)式電源門極驅(qū)動要求特別重要。由于幾個 MOSFET 器件通常并聯(lián)以滿足特定設(shè)計的高電流規(guī)范要求，因此單一集成電路控制器與驅(qū)動器解決方案的方便性就不再是可行的選擇。MOSFET 并聯(lián)可降低漏極到源極的導(dǎo)通電阻，并減少傳導(dǎo)損耗。但是，隨著并聯(lián)器件的增多，門極充電的要求也迅速提高。由于 MOSFET 的內(nèi)部阻抗大大低于驅(qū)動級，因此與驅(qū)動并聯(lián)組合相關(guān)的大多數(shù)功率損耗其形式都表現(xiàn)為控制器集成電路的散熱。因此，許多單片解決方案的驅(qū)動級由于并聯(lián)組合的關(guān)系都無法有效地驅(qū)動更高的門極充電。
- 關(guān)鍵字： PWM
FPGA 設(shè)計的四種常用思想與技巧
- 本文討論的四種常用FPGA/CPLD設(shè)計思想與技巧：乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化，都是FPGA/CPLD 邏輯設(shè)計的內(nèi)在規(guī)律的體現(xiàn)，合理地采用這些設(shè)計思想能在FPGA/CPLD設(shè)計工作種取得事半功倍的效果。 FPGA/CPLD的設(shè)計思想與技巧是一個非常大的話題，由于篇幅所限，本文僅介紹一些常用的設(shè)計思想與技巧，包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識地利用這些原則指導(dǎo)日后的設(shè)計工作，將取得事半功倍的效果！ 乒乓操作
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大型設(shè)計中FPGA的多時鐘策略
- 利用FPGA 實現(xiàn)大型設(shè)計時，可能需要FPGA 具有以多個時鐘運行的多重數(shù)據(jù)通路，這種多時鐘FPGA 設(shè)計必須特別小心，需要注意最大時鐘速率、抖動、最大時鐘數(shù)、異步時鐘設(shè)計和時鐘/數(shù)據(jù)關(guān)系。設(shè)計過程中最重要的一步是確定要用多少個不同的時鐘，以及如何進(jìn)行布線，本文將對這些設(shè)計策略深入闡述。 FPGA 設(shè)計的第一步是決定需要什么樣的時鐘速率，設(shè)計中最快的時鐘將確定FPGA 必須能處理的時鐘速率。最快時鐘速率由設(shè)計中兩個觸發(fā)器之間一個信號的傳輸時間P 來決定，如果P 大于時鐘周期T，則當(dāng)信號在一個觸發(fā)
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自適應(yīng)算術(shù)編碼的FPGA實現(xiàn)
- 算術(shù)編碼是一種無失真的編碼方法，能有效地壓縮信源冗余度，屬于熵編碼的一種。算術(shù)編碼的一個重要特點就是可以按分?jǐn)?shù)比特逼近信源熵，突破了Haffman編碼每個符號只不過能按整數(shù)個比特逼近信源熵的限制。對信源進(jìn)行算術(shù)編碼，往往需要兩個過程，第一個過程是建立信源概率表，第二個過程是對信源發(fā)出的符號序列進(jìn)行掃描編碼。而自適應(yīng)算術(shù)編碼在對符號序列進(jìn)行掃描的過程中，可一次完成上述兩個過程，即根據(jù)恰當(dāng)?shù)母怕使烙嬆Ｐ秃彤?dāng)前符號序列中各符號出現(xiàn)的頻率，自適應(yīng)地調(diào)整各符號的概率估計值，同時完成編碼。盡管從編碼效率上看不如已
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