- 工程師在設計過程中，經常需要一定的創(chuàng)造力(你不妨稱之為數字管道膠帶)才能夠保證設計的順利完成。過去8年時間里，我曾經目睹許多優(yōu)秀工程師利用這一方法出色地完成了許多工作，而他們采用的最主要工具就是 FPGA Editor。
利用FPGA Editor，你可以察看完成的設計并確定是否在FPGA構造一級真正實現了設計意圖 – 而這對于任何工程師或現場應用工程師來說都是非常需要的。假設你拿到協作者的設計，需要對其進行修改，但他們的 HDL源代碼非常難于理解，或者根本沒有任何注釋或文檔。也許你
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Xilinx FPGA 設計工具
- 近幾年來，電線、電纜、光纖等產品的需求量大大增加，外徑尺寸的質量控制成為許多生產廠家急需解決的問題。傳統 ...
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ARM FPGA 線陣CCD測徑系統
- LSI接口終于要實現“光纖”化了。美國阿爾特拉(Altera)公布了在FPGA中導入光纖接口的計劃。預定在2011年內采用試制芯片進行演示，2012年以后產品化。產品主要面向高清視頻傳輸、云計算、三維游戲以及高性能視頻監(jiān)控等用途。在這些產品中，除了主板上的LSI間布線外，還可廣泛地用于機殼內布線等用途。
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Altera FPGA
- 摘要：基于提高速度和減少面積的理念，對傳統的FIR數字濾波器進行改良?？紤]到FPGA的實現特點，研究并設計了采用Radix-2的Booth算法乘法器以及結合了CSA加法器和樹型結構的快速加法器，并成功應用于FIR數字濾波器的設
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FPGA FIR 數字濾波器
- 過去，FPGA在系統設計中發(fā)揮了重要作用，但現在還需要新的性能，同時需要降低整個系統的構建和運營成本。功能豐富、低成本的FPGA實現了快速的產品上市時間與較短的投資回報周期，并且擁有能夠適應不斷發(fā)展的標準的靈活性和性能。系統/設計工程師現在還擁有了一個令人興奮的、改進的工具集來解決不斷演進的信號處理市場的挑戰(zhàn)。
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RapidIO FPGA 串行 低功耗
- FPGA在嵌入式系統中的開發(fā)方向,早期的嵌入式系統一般是以通用處理器或單片機為核心，在外圍電路中加入存儲器、功率驅動器、通信接口、顯示接口、人機輸入接口等外圍接口，再加上應用軟件，有些還加上了嵌入式操作系統，從而構成完整的系統?！ ‰S
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方向 開發(fā) 系統 嵌入式 FPGA
- 滿足設計的時序要求本身已非易事，而要實現某項設計的整體時序具有完全可重復性有時候卻是不可能的任務。幸運的是，設計人員可以借助有助于實現可重復時序結果的設計流程概念。影響最大的四個方面分別是 HDL 設計實踐、綜合優(yōu)化、平面布局和實施方案。
就獲得可重復結果而言，資源利用和頻率要求都很高的設計是最大的挑戰(zhàn)。它們也是可重復結果流程需求最高的設計。得到可重復結果的第一步是在 HDL設計階段運用設計合理的實踐。遵循出色的分層邊界實踐有助于保持邏輯整體性，而這在設計變更時有助于保持可重復結果。一條不錯的規(guī)
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Xilinx FPGA
- 功能強大的可編程邏輯平臺使得Prisma Engineering公司能夠針對所有蜂窩網絡提供可重配置無線測試設備。長期演進(LTE)是移動寬帶的最3GPP標準，它打破了現有蜂窩網絡的固有模式。LTE與前代UMTS和GSM標準相比，除采用高頻譜效率的射頻技術外，其架構還得到了大幅簡化。LTE系統的無線接入部分Node-B，是連接無線電和整個互聯網協議核心網絡之間的邊緣設備。這種架構無法監(jiān)測和測試等效于UMTS中間鏈路上的元件。必須通過無線電接口，才能有效地測試LTE網絡元件。
這正是Prisma
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Xilinx FPGA Virtex-5
- 設計人員時常需要通過增加計算能力或額外輸入（或兩者）延長現有的嵌入式系統的壽命。而可編程系統平臺在這里大有用武之地。我們曾經希望用安全網絡連接功能升級一套網絡可編程系統。安全網絡連接功能需要加密才能運行安全外殼 (SSH)、傳輸層安全 (TLS)、安全套接層(SSL) 或虛擬專用網 (VPN) 等協議。這種安全需求與把各種系統接入因特網的需求同步增長，例如，為了啟用遠程管理與分布式控制系統。
因該領域仍在發(fā)展并且標準尚未固定，因此成本主要取決于一次性工程費用。所以，FPGA 技術能實現最高價值。
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Xilinx FPGA
- ISE12.3增強PlanAhead 設計與分析控制臺，并進一步優(yōu)化功耗，標志著支持 AXI4 接口IP的推出，和即插即用FPGA 設計的實現
賽靈思公司（Xilinx, Inc. ）宣布推出 ISE® 12.3設計套件，這標志著這個FPGA 行業(yè)領導者針對片上系統設計的互聯功能模塊， 開始推出滿足AMBA® 4 AXI4 規(guī)范的IP核，以及用于提高生產力的 PlanAhead™ 設計和分析控制臺，同時還推出了用于降低了Spartan®-6 FPG
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Xilinx FPGA ISE
- 作為賽靈思用戶論壇的定期訪客，我注意到新用戶往往對時序收斂以及如何使用時序約束來達到時序收斂感到困惑。為幫助 FPGA設計新手實現時序收斂，讓我們來深入了解時序約束以及如何利用時序約束實現FPGA 設計的最優(yōu)結果。
何為時序約束？
為保證設計的成功，設計人員必須確保設計能在特定時限內完成指定任務。要實現這個目的，我們可將時序約束應用于連線中——從某 FPGA 元件到 FPGA 內部或 FPGA 所在 PCB 上后續(xù)元件輸入的一條或多條路徑。
在 FPGA 設計
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Xilinx FPGA 設計時序
- [組圖]FPGA器件的在線配置方法,引 言
??在當今變化的市場環(huán)境中，產品是否便于現場升級，是否便于靈活使用成為產品能否進入市場的關鍵因素。在這種背景下，Altera公司的基于SRAM LUT結構的FPGA器件得到了廣泛的應用。雖然這些器件應用廣泛，但由
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配置 方法 在線 器件 FPGA 組圖
- 摘要：設計了一種用于數字下變頻的256階分布式FIR濾波器。通過分析分布式FIR濾器結構給實現電路所需資源和...
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FPGA FIR濾波器 分布式算法
- 介紹了一種基于LXI總線數字化儀模塊的總體設計方案。該數字化儀模塊以FPGA和DSP作為采集控制和信號處理核心單元，兼容兩種標準頻率中頻信號的采集與數據處理，采用基于IEEE1588精密時鐘協議提供的時間基準進行精確定時觸發(fā)。軟件系統在Windows NT平臺上實現，開發(fā)了基于Lab Windows/CVI的虛擬儀器軟面板，保證了模塊運行的穩(wěn)定性和人機界面的友好。本數字化儀模塊的特點在于該模塊在高性能FPGA的控制下實現兩種中頻信號采集，最高采樣頻率可達130 MHz，可靠性、穩(wěn)定性好，具有較好的實用價值
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LXI總線 FPGA DSP IEEE1588 201104
- 本作品設計并實現了一種基于近紅外手背靜脈檢測生物特征的個人身份認證系統(VAS系統)，在Xilinx公司提供的NetFPGA開發(fā)平臺上完成了系統開發(fā)。實現了手背靜脈圖像的采集、處理、存儲和匹配驗證等功能，充分發(fā)揮了FPGA硬件功能，采用軟硬件協同思想，流水線策略和并行處理的方法，移植和優(yōu)化了軟件算法。同時對NetFPGA平臺進行了改造和擴展;還實現了靈活、友好的交互界面，安全級別高，擴展性強。
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嵌入式系統 FPGA 身份認證 生物特征 手背靜脈 201104
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