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DIY你的體感游戲：人體動(dòng)作識別系統(tǒng)的設(shè)計(jì)，提供軟硬件實(shí)現(xiàn)方案
- 本項(xiàng)目使用Virtex-5 OpenSPARC評估平臺，首先通過VGA解碼芯片，將PC機(jī)中的視頻流數(shù)據(jù)解碼出R、G、B信號值和場、行信號。然后使用OV7670數(shù)字?jǐn)z像頭，攝取人體的手部動(dòng)作，運(yùn)用一定的算法，對攝像頭數(shù)據(jù)進(jìn)行處理，判定此時(shí)的人體動(dòng)作，然后將其與RGB分量信號進(jìn)行疊加，通過配置DVI接口芯片，將疊加后的圖像送至顯示器顯示。
- 關(guān)鍵字： Virtex-5 動(dòng)作識別 DIY 數(shù)字?jǐn)z像頭 FPGA
大熱的麥克風(fēng)陣列語音識別系統(tǒng)的設(shè)計(jì)和輕松實(shí)現(xiàn)，提供軟硬件解決方案
- 本項(xiàng)目與傳統(tǒng)的麥克風(fēng)陣進(jìn)行語音識別的方法又有不同，它將語音接收端與語音識別部分組成一個(gè)反饋系統(tǒng)，通過優(yōu)化接收端濾波器的系數(shù)，使跟語音識別密切相關(guān)的倒譜域似然比最大，來提高語音識別準(zhǔn)確率。在進(jìn)行Matlab仿真之后，將算法應(yīng)用到FPGA中。FPGA開發(fā)板暫定為Xilinx公司的Nexys?3 Spartan-6 FPGA Board。
- 關(guān)鍵字： 麥克風(fēng)陣列語音識別 Nexys3 Spartan-6 延時(shí)求和 FIR濾波器
DIY小發(fā)明：打造你自己的流媒體播放器，解決方案、硬件框圖
- 主要內(nèi)容為利用Xilinx的Virtex-2 Pro FPGA 上豐富的邏輯資源來實(shí)現(xiàn)一個(gè)自定義的模塊，該模塊能作為流媒體播放過程中的一個(gè)功能部件。
- 關(guān)鍵字： DIY 流媒體播放器 Virtex-2Pro FPGA
基于FPGA的IIR數(shù)字濾波器的設(shè)計(jì)方案
- 用FPGA實(shí)現(xiàn)數(shù)字濾波器具有實(shí)時(shí)性強(qiáng)、靈活性高、處理速度快以及小批量生產(chǎn)成本低等優(yōu)點(diǎn)，所以得到了較為廣泛的應(yīng)用。本文以巴特沃思數(shù)字帶通濾波器為例，較為詳細(xì)地介紹了其設(shè)計(jì)和實(shí)現(xiàn)方法。給定巴特沃茲數(shù)字帶通濾波器的抽樣頻率為500Hz，上、下邊帶截止頻率分別為150Hz和30Hz。
- 關(guān)鍵字： IIR數(shù)字濾波器 雙線性變換法 FPGA matlab
14nm的FPGA需要什么樣的電源管理IC？
- 現(xiàn)在的FPGA不僅僅是一個(gè)邏輯器件，它現(xiàn)在更加像一個(gè)平臺，在一個(gè)FPGA中常常會(huì)包含有數(shù)字信號處理、嵌入式處理、高速串行和其他高端技術(shù)模塊。那么，這樣的FPGA需要什么樣的電源管理IC來與之配合呢？
- 關(guān)鍵字： 電源管理IC 14nm FPGA Enpirion CycloneVSoC
如何通過RTL分析、SDC約束和綜合向?qū)Ц焱瞥鯢PGA設(shè)計(jì)
- EDA 公司和 FPGA 廠商不斷開發(fā)新的工具和方法，推進(jìn)繁瑣任務(wù)的自動(dòng)化，幫助設(shè)計(jì)團(tuán)隊(duì)集中精力做好創(chuàng)造性工作。下面我們就來看看 FPGA 工具流程的演進(jìn)發(fā)展，了解一下現(xiàn)代 FPGA 團(tuán)隊(duì)是如何利用 RTL分析、約束生成和綜合導(dǎo)向來減少設(shè)計(jì)迭代的。
- 關(guān)鍵字： RTL SDC 綜合向?qū)?/a> FPGA
用智能的調(diào)試與綜合技術(shù)隔離FPGA設(shè)計(jì)中的錯(cuò)誤
- Synopsys公司的Synplify Premier 和Synplify Pro FPGA設(shè)計(jì)工具以及Identify RTLDebugger 等產(chǎn)品能幫助設(shè)計(jì)人員完成上述工作。這些工具的特性使得設(shè)計(jì)人員能快速隔離錯(cuò)誤，有效縮短運(yùn)行時(shí)間，并減少開發(fā)板啟動(dòng)所需的迭代次數(shù)。
- 關(guān)鍵字： 智能調(diào)試 SynplifyPremier FPGA SynplifyProFPGA
FPGA與多核CPU如何改變嵌入式設(shè)計(jì)
- 隨著嵌入式器件在過去數(shù)十年來的爆炸性成長，使得硬件組件及軟件工具都有顯著的改善。雖然有著這種成長與創(chuàng)新，但傳統(tǒng)嵌入式系統(tǒng)的設(shè)計(jì)方法卻少有進(jìn)步，并逐漸變成一種障礙。有鑒于新標(biāo)準(zhǔn)與協(xié)議的快速發(fā)展，以及對產(chǎn)品上市壓力的日益增加，嵌入式系統(tǒng)設(shè)計(jì)也即將發(fā)生顛覆性的典范改變。隨著硬件技術(shù)及軟件工具的進(jìn)步在加速成長，由整合所帶來的挑戰(zhàn)也
- 關(guān)鍵字： 多核CPU 嵌入式設(shè)計(jì) FPGA
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