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          讓電視節(jié)目從起居室進(jìn)入你的口袋

          • ——DVB-H 標(biāo)準(zhǔn)、市場(chǎng)及其解決方案的應(yīng)用
          • 關(guān)鍵字: DVB  DVB-H  

          DVB-T技術(shù)手冊(cè):DVB-T的擴(kuò)展DVB-H

          • DVB系列標(biāo)準(zhǔn)最早由DVB項(xiàng)目組在上世紀(jì)90年代初提出,其地面廣播版本DVB-T(Digital Video Broadcasting-Terrestrial) 是在90年代中期開(kāi)發(fā)的,并于1997年2月獲得ETSI (European Telecommunications Standards Institute ?C 歐洲電信標(biāo)準(zhǔn)委員會(huì))的認(rèn)可,成為歐洲地面數(shù)字電視廣播的標(biāo)準(zhǔn)
          • 關(guān)鍵字: DVB-H  

          我視頻編碼國(guó)家標(biāo)準(zhǔn)AVS與國(guó)際標(biāo)準(zhǔn)MPEG的比較

          • 本文從技術(shù)角度對(duì)MPEG-2的視頻標(biāo)準(zhǔn),MPEG-4AVC/H.264和AVS視頻三個(gè)視頻標(biāo)準(zhǔn)進(jìn)行對(duì)比,包括技術(shù)方案,主觀測(cè)食,客觀測(cè)試,復(fù)雜度等四個(gè)方面。
          • 關(guān)鍵字: MPEG-2  MPEG-4  H.264  AVS  

          H.264標(biāo)準(zhǔn)

          • 關(guān)鍵字: H.264  

          H.264中二進(jìn)制化編碼器的FPGA實(shí)現(xiàn)

          • 在對(duì)H.264標(biāo)準(zhǔn)中二進(jìn)制化部分研究和分析的基礎(chǔ)上,提出其FPGA電路結(jié)構(gòu),采用并行結(jié)構(gòu)及流水線方式設(shè)計(jì)電路。該結(jié)構(gòu)經(jīng)Spartan3 FPGA實(shí)現(xiàn),其吞吐量為每周期1 bit,最大時(shí)鐘頻率為100 MHz,能夠滿足H.264中第3級(jí)及其以上檔次實(shí)時(shí)視頻編碼的要求。
          • 關(guān)鍵字: H.264  二進(jìn)制化  編碼器  FPGA  

          FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計(jì)之:典型實(shí)例-整數(shù)DCT變換的設(shè)計(jì)與實(shí)現(xiàn)

          • 本節(jié)旨在設(shè)計(jì)實(shí)現(xiàn)了視頻壓縮標(biāo)準(zhǔn)H.264算法中的整數(shù)DCT變換部分,幫助讀者了解并行流水設(shè)計(jì)技巧在算法優(yōu)化中的作用。
          • 關(guān)鍵字: DSP  協(xié)同處理  FPGA  整數(shù)DCT變換  H.264  

          面向H.264視頻編碼器的SoC驗(yàn)證平臺(tái)

          • 構(gòu)建了面向H.264視頻編碼器的SoC驗(yàn)證平臺(tái),采用FPGA原型系統(tǒng)完成H.264編碼器驗(yàn)證。采用Wishbone總線連接32位微處理器OR1200以及其他的必要IP核構(gòu)建基本SoC平臺(tái),并在此基礎(chǔ)上集成H.264硬件編碼模塊;根據(jù)H.264編碼器的數(shù)據(jù)流要求,設(shè)計(jì)了逐行輸入/宏塊順序輸出的多端口SDRAM控制器;移植了μC/OSII實(shí)時(shí)
          • 關(guān)鍵字: H.264  視頻編碼器  SoC驗(yàn)證平臺(tái)  

          一種面向H.264視頻編碼器的SoC驗(yàn)證平臺(tái)

          • 構(gòu)建了面向H.264視頻編碼器的SoC驗(yàn)證平臺(tái),采用FPGA原型系統(tǒng)完成H.264編碼器驗(yàn)證。采用Wishbone總線連接32位微處理器OR1200以及其他的必要IP核構(gòu)建基本SoC平臺(tái),并在此基礎(chǔ)上集成H.264硬件編碼模塊;根據(jù)H.264編碼器的數(shù)據(jù)流要求,設(shè)計(jì)了逐行輸入/宏塊順序輸出的多端口SDRAM控制器;移植了μC/OSII實(shí)時(shí)
          • 關(guān)鍵字: H.264  視頻編碼  SoC驗(yàn)證平臺(tái)  軟硬件協(xié)同仿真  

          基于FPGA的H.264幀內(nèi)預(yù)測(cè)模塊設(shè)計(jì)

          • 提出一種能實(shí)時(shí)處理的H.264/AVC幀內(nèi)預(yù)測(cè)硬件結(jié)構(gòu)。通過(guò)對(duì)H.264/AVC各個(gè)預(yù)測(cè)模式的分析,設(shè)計(jì)了一個(gè)通用運(yùn)算單元,提高了硬件資源的可重用性。采用4個(gè)并行運(yùn)算單元計(jì)算預(yù)測(cè)值,對(duì)運(yùn)算比較復(fù)雜的plane模式預(yù)處理,并設(shè)計(jì)模式預(yù)測(cè)器,加快了系統(tǒng)處理速度。硬件電路結(jié)構(gòu)已通過(guò)RTL級(jí)仿真及綜合,并在Altera公司的Cyclone II FPGA平臺(tái)上進(jìn)行了驗(yàn)證和測(cè)試。
          • 關(guān)鍵字: H.264幀內(nèi)預(yù)測(cè)  視頻解碼器  FPGA  

          基于H.323 高性能MCU的設(shè)計(jì)與實(shí)現(xiàn)

          • 0 引 言隨著計(jì) 算機(jī)的 硬件, 特別 是 CPU 主 頻的不 斷提 升, 基于軟件的音、視頻編碼效率也越來(lái)越高, 因此考慮 到成本與各方面的因素, 軟件 MCU 必然成為以后的主 流方向。但現(xiàn)
          • 關(guān)鍵字: H.323  OpenH323  MCU  幀緩沖映射  軟交換  

          基于ARM的嵌入式無(wú)線視頻監(jiān)控系統(tǒng)

          • 介紹了一種基于ARM9高速嵌入式處理器和H.264高效壓縮算法的嵌入式3G無(wú)線視頻監(jiān)控系統(tǒng)。分析了系統(tǒng)的總體結(jié)構(gòu)、硬件結(jié)構(gòu),并重點(diǎn)闡述了系統(tǒng)軟件的設(shè)計(jì)與實(shí)現(xiàn)。實(shí)驗(yàn)結(jié)果表明,該系統(tǒng)可以達(dá)到25幀/秒CIF圖像(320×240),實(shí)現(xiàn)了視頻流暢傳輸。
          • 關(guān)鍵字: ARM9  H.264  視頻監(jiān)控  

          正確理解A/D轉(zhuǎn)換器的輸入

          • 正確理解A/D轉(zhuǎn)換器的輸入,許多嵌入式應(yīng)用都會(huì)用到A/D轉(zhuǎn)換器。然而,如果錯(cuò)誤連接了A/D轉(zhuǎn)換器輸入端的電路,就會(huì)無(wú)意識(shí)的破壞A/D轉(zhuǎn)換的測(cè)量。
          • 關(guān)鍵字: A/D  轉(zhuǎn)換器  S/H  

          視頻編碼講壇之H.264前世今生

          • 隨著HDTV等高清資源的興起,H.264這個(gè)規(guī)范頻頻出現(xiàn)在我們眼前,HD-DVD和藍(lán)光DVD均計(jì)劃采用這一標(biāo)準(zhǔn)進(jìn)行節(jié)目制作。而且自2005年下半年以來(lái),無(wú)論是NVIDIA還是ATI都把支持H.264硬件解碼加速作為自己最值得夸耀的視頻技術(shù)。而數(shù)碼播放器領(lǐng)域也吹來(lái)了高清和H.264的風(fēng)潮,國(guó)內(nèi)外不少數(shù)碼播放器廠商都已經(jīng)開(kāi)始支持此類編碼的視頻文件,同時(shí)網(wǎng)絡(luò)資源的豐富程度也逐漸提升。那H.264到底是何方“神圣”呢?和傳統(tǒng)的RMVB等編碼相比,有什么先進(jìn)之處嗎?
          • 關(guān)鍵字: H.264  視頻編碼  DPCM  

          基于H.264視頻壓縮快速運(yùn)動(dòng)的估計(jì)算法

          • 運(yùn)動(dòng)估計(jì)是整個(gè)視頻編碼中運(yùn)算量最大的模塊,可占整個(gè)軟件編碼器運(yùn)算量的70%以上。因此視頻系統(tǒng)中編碼器的復(fù)雜部分取決于運(yùn)動(dòng)估計(jì)算法體系結(jié)構(gòu)的復(fù)雜性。
          • 關(guān)鍵字: H.264  視頻壓縮  DCS算法  視頻編碼  運(yùn)動(dòng)估計(jì)  

          Fraunhofer IIS解讀沉浸音頻新標(biāo)準(zhǔn),MPEG-H締造智慧視聽(tīng)新世界

          • 2017年3月24日,F(xiàn)raunhofer集成電路研究所(IIS)在2017年中國(guó)國(guó)際廣播電視信息網(wǎng)絡(luò)展覽會(huì)(CCBN)上展示了成功被ATSC3.0和DVB數(shù)字電視標(biāo)準(zhǔn)采納的MPEG-H電視音頻解決方案,以及為VR和移動(dòng)設(shè)備帶來(lái)沉浸式聲音體驗(yàn)的Fraunhofer Cingo技術(shù)和能夠顯著簡(jiǎn)化VR沉浸式聲音制作流程的Cingo Composer 軟件。
          • 關(guān)鍵字: MPEG-H  音頻  VR  
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