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          詳細講解Vivado設計套件帶來的益處
          
                                                            
                    
          
                
          
                                
          
                    
          IP 封裝器、集成器和目錄
          
                                                            
            
                    	
          • 賽靈思的工具架構(gòu)團隊把重點放在新套件專門的IP功能設計上，以便于IP的開發(fā)、集成與存檔。為此，賽靈思開發(fā)出了IP封裝器、IP集成器和可擴展IP目錄三種全新的IP功能。Feist表示：“今天很難找到不采用IP的IC設計
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          • 關鍵字：
                        IP  封裝器  集成  目錄                            
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          ARM程序優(yōu)化及其在嵌入式TCP/IP協(xié)議實現(xiàn)中的應用
          
                                                            
            
                    	
          • 隨著嵌入式技術的發(fā)展，人們對系統(tǒng)的智能化、小型化的要求也越來越高。基于ARM結(jié)構(gòu)的微處理器以其高性能、低功耗、低價格等方面的優(yōu)勢被廣泛應用于各種電子產(chǎn)品，特別是一些高端的嵌入式控制應用中，例如移動電話、工
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          • 關鍵字：
                        協(xié)議  實現(xiàn)  應用  TCP/IP  嵌入式  程序  優(yōu)化  及其  ARM                          
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          采用IP內(nèi)核的多業(yè)務分組平臺介紹
          
                                                            
                                        
            
                    	
          • 一、引言 　　

            隨著軟交換和未來3G業(yè)務的開展，現(xiàn)有網(wǎng)絡業(yè)務分組化的趨勢日益明顯。ITU-T也明確指出，下一代網(wǎng)絡NGN是基于分組承載的網(wǎng)絡。而現(xiàn)有的數(shù)據(jù)承載主要采用交換機光纖直聯(lián)方式或通過基于SDH的MSTP方式，
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          • 關鍵字：
                        平臺  介紹  分組  業(yè)務  IP  內(nèi)核  采用                          
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          quartus的IP仿真錯誤分析
          
                                                            
                                        
            
                    	
          • quartus的IP仿真錯誤分析,    大家都知道quartus的IP可以直接拿來用的，大大節(jié)省了開發(fā)時間，而且其代碼是絕對優(yōu)化的；所有的前奏都操作成功，設置沒什么問題，開始對生成的fft.vhd文件進行編譯，點擊Start Compilation，第一感覺：慢！編譯很
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          • 關鍵字：
                        分析  錯誤  仿真  IP  quartus                          
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          對數(shù)轉(zhuǎn)換電路--可獲得IP/十進位輸出
          
                                                            
            
                    	
          • 電路的功能為了把大范圍的信號電平壓縮顯示，可使用對數(shù)電路，通常稱對數(shù)放大器，在電氣電路中多使用以10為底的常用對數(shù)，本電路是1V/十進位、即10倍的變化引起1V變化輸出的電路。對數(shù)作為除法、乘法等運算電路的基本
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          • 關鍵字：
                        IP  對數(shù)  轉(zhuǎn)換電路                            
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          CDMA無線終端TCP／IP協(xié)議介紹
          
                                                            
                                        
            
                    	
          • CDMA是無線通信領域的后起之秀，采用頻分編碼技術，與基于時分復用的GSM相比具有明顯優(yōu)勢。CDMA能夠?qū)崿F(xiàn)從現(xiàn)有通信系統(tǒng)到下一代通信系統(tǒng)的平滑過渡，具有較強的功能伸縮性；可以支持先進的天線技術，通過增加小區(qū)覆蓋
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          • 關鍵字：
                        協(xié)議  介紹  IP  TCP  無線  終端  CDMA                          
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          IP4776CZ38構(gòu)成的HDMI接口技術
          
                                                            
            
                    	
          • 本文介紹了IP4776CZ38主要特性和優(yōu)勢, 功能方框圖, HDMI發(fā)送器和接收器應用框圖以及PCB布局方案框圖.NXP公司的IP4776CZ38是全集成的HDMI接口器件,集成了電平轉(zhuǎn)移,ESD和背驅(qū)保護等功能. IP4776CZ38和HDMI 1.3兼容,每路
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          • 關鍵字：
                        4776  HDMI  IP  38                            
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          利用FFT IP Core實現(xiàn)FFT算法
          
                                                            
            
                    	
          • 結(jié)合工程實踐，介紹了一種利用FFT IP Core實現(xiàn)FFT的方法，設計能同時對兩路實數(shù)序列進行256點FFT運算，并對轉(zhuǎn)換結(jié)果進行求模平方運算，且對數(shù)據(jù)具有連續(xù)處理的能力。設計采用低成本的FPGA實現(xiàn)，具有成本低、性能高、
            • 
                    	                        
          • 關鍵字：
                        FFT  Core  IP  算法                            
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          可以將第三方的IP(來自VHDL或Verilog)吸納到NI Fl
          
                                                            
            
                    	
          • 如果適配器模塊是由NI公司開發(fā)的，那么不需要任何VHDL或其他硬件描述語言的經(jīng)驗。所有的FPGA編程均通過NI LabVIEW FPGA模塊和NI-RIO驅(qū)動程序軟件以圖形化的方式完成。如果該適配器模塊是由第三方開發(fā)的，則或許提供定
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          • 關鍵字：
                        FlexRIO  Verilog  VHDL  IP                            
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          TCP/IP遠程網(wǎng)絡步進電機控制器
          
                                                            
            
                    	
          • 在計算機整合制造業(yè)(CIM)或工業(yè)自動化(IA)領域，許多控制設備進行長距離的數(shù)據(jù)傳送時有困難，抗干擾性能不好,多 ...
            • 
                    	                        
          • 關鍵字：
                        TCP  IP  遠程網(wǎng)絡  步進電機  控制器                          
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          基于FPGA的UPFC控制器IP設計
          
                                                            
                                        
            
                    	
          • 　0 引言 　　統(tǒng)一潮流控制器(Unified Power Flow Con-troller，簡稱UPFC)是一種可以較大范圍地控制電流使之按指定路經(jīng)流動的設備，它可在保證輸電線輸送容量接近熱穩(wěn)定極限的同時又不至于過負荷。控制系統(tǒng)是UPFC的核
            • 
                    	                        
          • 關鍵字：
                        IP  設計  控制器  UPFC  FPGA  基于                          
            • 
                   	
          
                    
          
                
          
                                
          
                    
          IP承載網(wǎng)絡規(guī)劃設計探討
          
                                                            
                                        
            
                    	
          • 毋庸置疑，現(xiàn)代通信網(wǎng)絡的發(fā)展，是由業(yè)務需求和市場需求來決定的，而不是技術的發(fā)展。我們回頭看看互聯(lián)網(wǎng)（IP網(wǎng)絡）的發(fā)展歷程，這其中市場推動的痕跡非常明顯：這一種六七十年代就已經(jīng)誕生的IP網(wǎng)絡技術，在九十年代
            • 
                    	                        
          • 關鍵字：
                        探討  規(guī)劃設計  網(wǎng)絡  承載  IP                          
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          基于Nios II步進電機控制器IP核的設計與實現(xiàn)
          
                                                            
                                        
            
                    	
          • 摘要 根據(jù)Nios II處理器的Avalon總線規(guī)范，設計了一款面向步進電機的控制器IP核。該定制IP核采用軟、硬件協(xié)同設計的方法，功能符合Avalon總線的讀寫傳輸時序，具有完備的步進電機驅(qū)動能力。仿真結(jié)果表明，該IP核具有
            • 
                    	                        
          • 關鍵字：
                        IP  設計  實現(xiàn)  控制器  電機  Nios  II  步進  基于                          
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          基于Nios II處理器的SVPWM IP Core設計
          
                                                            
            
                    	
          • 摘要 為降低FPGA實現(xiàn)3電平SVPWM算法的復雜性，減小SVPWM模塊所占用的資源，文中利用正弦函數(shù)和余弦函數(shù)的關系，采用小容量ROM提出了一種新的SVPWM控制算法。利用Verilog HDL實現(xiàn)了算法的硬件設計，并封裝成IP核以方便
            • 
                    	                        
          • 關鍵字：
                        SVPWM  Nios  Core  IP                            
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          ip-core介紹
          
      			
          
		      	
          
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