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基于FPGA的可編程定時器/計數(shù)器8253的設計與實現(xiàn)
- 摘 要:本文介紹了可編程定時器/計數(shù)器8253的基本功能,以及一種用VHDL語言設計可編程定時器/計數(shù)器8253的方法,詳述了其原理和設計思想,并利用Altera公司的FPGA器件ACEX 1K予以實現(xiàn)。關(guān)鍵詞:FPGA;IP;VHDL 引言在工程上及控制系統(tǒng)中,常常要求有一些實時時鐘,以實現(xiàn)定時或延時控制,如定時中斷,定時檢測,定時掃描等,還要求有計數(shù)器能對外部事件計數(shù)。要實現(xiàn)定時或延時控制,有三種主要方法:軟件定時、不可編程的硬件定時、可編程的硬件定時器。其中可編
- 關(guān)鍵字: FPGA IP VHDL
在TMS320VC5402上實現(xiàn)的嵌入式TCP/IP協(xié)議棧
- 實現(xiàn)一個運行在16位數(shù)字信號處理器TMS320VC5402上的小型嵌入式TCP/IP協(xié)議棧。對TCP/IP協(xié)議中的IP協(xié)議、ARP協(xié)議、UDP協(xié)議進行分析,完成基于TCP/IP協(xié)議的嵌入式網(wǎng)絡系統(tǒng)。
- 關(guān)鍵字: 協(xié)議 TCP/IP 嵌入式 實現(xiàn) TMS320VC5402
自由IP Core資源的利用
- 摘 要:本文介紹了與免費IP Core運作有關(guān)的問題以及免費資源的若干來源,然后通過對兩個不同來源的、免費的八位RISC CPU進行比較和分析,給出了若干選用免費核時應考慮的問題。關(guān)鍵詞:IP Core; CPU引言隨著集成電路單位面積晶體管數(shù)量的激增和人們對縮短設計周期的追求,設計重用已經(jīng)成為有效的應對方法,它不但適合于ASIC,也適合于CPLD/FPGA。在CPLD/FPGA的設計過程中,由于開發(fā)工具的通用性、設計語言的標準化,設計過程幾乎與所用器件的硬件結(jié)構(gòu)無關(guān),
- 關(guān)鍵字: CPU IP Core
TCP/IP協(xié)議棧在嵌入式異構(gòu)網(wǎng)絡互聯(lián)中的應用
- TCP/IP協(xié)議棧在嵌入式異構(gòu)網(wǎng)絡互聯(lián)中的應用,隨著測控技術(shù)與網(wǎng)絡技術(shù)日益緊密的結(jié)合,測控系統(tǒng)接入互聯(lián)網(wǎng)已經(jīng)成為大勢所趨
- 關(guān)鍵字: 應用 網(wǎng)絡互聯(lián) 嵌入式 協(xié)議 TCP/IP
2003年5月20日,ARM在中國開展大學計劃
- 2003年5月20日 ARM在中國開展大學計劃——東南大學獲得ARM IP授權(quán),推進國內(nèi)電子業(yè)片上系統(tǒng)研究進程。
- 關(guān)鍵字: ARM IP 片上系統(tǒng)
F5 發(fā)表IP應用切換器 提供高效能流量管理服務
- 為滿足當前與下一代的網(wǎng)頁服務及應用程式對流量管理工作的需求,F(xiàn)5 Networks於12日發(fā)表新款「IP(網(wǎng)際網(wǎng)路協(xié)定)應用切換器」:BIG-IP 5000。F5強調(diào)BIG-IP 5000的誕生將「網(wǎng)際網(wǎng)路流量管理」(ITM)帶進了新的時代,它可為企業(yè)與服務供應商提供更好的選擇,使其能夠建立高效能、高彈性、高獲利的IP網(wǎng)路
- 關(guān)鍵字: BIG-IP 網(wǎng)頁服務
ip-guard介紹
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