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CPLD對(duì)FPGA從并快速加載的解決方案
- 現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)作為專(zhuān)用集成電路(ASIC)領(lǐng)域的一種半定制電路,可以根據(jù)設(shè)計(jì)的需要靈活實(shí)現(xiàn)各種接口或者總線(xiàn)的輸出,在設(shè)備端的通信產(chǎn)品中已得到越來(lái)越廣泛的使用。FPGA是基于靜態(tài)隨機(jī)存儲(chǔ)器(SRAM)結(jié)構(gòu)的,斷電后程序丟失后的每次上電都需要重新加載程序。且隨著FPGA規(guī)模的升級(jí),加載程序的容量也越來(lái)越大,如Xilinx公司的Spartan - 6系列中的6SLX150T,其加載容量最大可以達(dá)到4.125 MB. 1 FPGA常用配置方式 FPGA的配置數(shù)據(jù)通常存放在系統(tǒng)中的存儲(chǔ)
- 關(guān)鍵字: CPLD FPGA modelsim
基于疊加訓(xùn)練序列光OFDM系統(tǒng)幀同步算法FPGA實(shí)現(xiàn)
- 光纖通信系統(tǒng)中引進(jìn)OFDM技術(shù)給O-OFDM系統(tǒng)帶來(lái)對(duì)同步、高峰均比等敏感問(wèn)題。疊加訓(xùn)練序列技術(shù)時(shí)IM/DDO-OFDM系統(tǒng)幀同步算法研究,設(shè)計(jì)了FPGA的算法實(shí)現(xiàn)結(jié)構(gòu),聯(lián)合Matlab,Modelsim等仿真工具驗(yàn)證算法開(kāi)發(fā)的有效性。實(shí)驗(yàn)結(jié)果表明,疊加的訓(xùn)練序列對(duì)數(shù)據(jù)影響較小,與傳統(tǒng)方法相比,具有更高的同步正確率,易于實(shí)現(xiàn),有較強(qiáng)的工程應(yīng)用前景。
- 關(guān)鍵字: 疊加訓(xùn)練序列技術(shù) OFDM 幀同步 Modelsim
易懂的modelsim學(xué)習(xí)筆記
- 1. 建一個(gè)總文件夾,如cnt2. 為源代碼,測(cè)試臺(tái)文件,仿真各建一文件夾。如src,tb,sim3. 編寫(xiě)源代碼,testbench。如c ...
- 關(guān)鍵字: modelsim
基于單片機(jī)軟硬件聯(lián)合仿真
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字: 單片機(jī) 聯(lián)合仿真 ModelSim ISS
ModelSim+Synplify+Quartus的Altera FPGA的仿真實(shí)現(xiàn)
- ModelSim+Synplify+Quartus的Altera FPGA的仿真實(shí)現(xiàn),工作內(nèi)容:
1、設(shè)計(jì)一個(gè)多路選擇器,利用ModelSimSE做功能仿真;
2、利用Synplify Pro進(jìn)行綜合,生成xxx.vqm文件;
3、利用Quartus II導(dǎo)入xxx.vqm進(jìn)行自動(dòng)布局布線(xiàn),并生成xxx.vo(Verilog
4、利用ModelSimSE做 - 關(guān)鍵字: 仿真 實(shí)現(xiàn) FPGA Altera Synplify Quartus ModelSim
modelsim介紹
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