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          基于FPGA NiosII的MPEG-4視頻播放器設(shè)計(jì)

          • 多媒體技術(shù)實(shí)用化的關(guān)鍵技術(shù)之一,就是解決視頻、音頻數(shù)字化以后數(shù)據(jù)量大,與數(shù)字存儲(chǔ)媒體、通信網(wǎng)容量小的矛盾,其解決途徑就是壓縮。為了支持低比特率視頻傳輸業(yè)務(wù),MPEG.
          • 關(guān)鍵字: NiosII  MPEG-4  FPGA  視頻播放器  

          基于FPGA的片上可編程系統(tǒng)(SOPC)設(shè)計(jì)之:典型實(shí)例-基于NIOS II處理器的數(shù)字鐘設(shè)計(jì)

          • 本節(jié)旨在通過(guò)給定的工程實(shí)例——“數(shù)字鐘”來(lái)熟悉Altera軟嵌入式系統(tǒng)的軟硬件設(shè)計(jì)方法。同時(shí)使用基于Altera FPGA的開(kāi)發(fā)板將該實(shí)例進(jìn)行下載驗(yàn)證,完成工程設(shè)計(jì)的硬件實(shí)現(xiàn)。在本節(jié)中,將主要講解以下知識(shí)點(diǎn)。
          • 關(guān)鍵字: SOPC  NiosII  FPGA  數(shù)字鐘  

          基于FPGA的片上可編程系統(tǒng)(SOPC)設(shè)計(jì)之:典型實(shí)例-基于NIOS II處理器的“Hello LED”程序設(shè)計(jì)

          • 本節(jié)旨在通過(guò)給定的工程實(shí)例——“Hello LED”來(lái)熟悉Altera軟嵌入式系統(tǒng)的軟硬件設(shè)計(jì)方法。同時(shí)使用基于Altera FPGA的開(kāi)發(fā)板將該實(shí)例進(jìn)行下載驗(yàn)證,完成工程設(shè)計(jì)的硬件實(shí)現(xiàn)。本節(jié)主要講解下面一些
          • 關(guān)鍵字: SOPC  NiosII  FPGA  

          基于FPGA的片上可編程系統(tǒng)(SOPC)設(shè)計(jì)之:基于NIOS II的開(kāi)發(fā)設(shè)計(jì)流程

          • NIOS II使用NIOS II IDE集成開(kāi)發(fā)環(huán)境來(lái)完成整個(gè)軟件工程的編輯、編譯、調(diào)試和下載。在采用NIOS處理器設(shè)計(jì)嵌入式系統(tǒng)時(shí),通常會(huì)按照以下步驟。
          • 關(guān)鍵字: 片上可編程系統(tǒng)  SOPC  FPGA  NiosII  

          基于FPGA的片上可編程系統(tǒng)(SOPC)設(shè)計(jì)之:Altera公司的NIOS II解決方案

          • NIOS II是一個(gè)用戶可配置的通用RISC嵌入式處理器。Altera推出的NIOS II系列嵌入式處理器擴(kuò)展了目前世界上最流行的軟核嵌入式處理器的性能。
          • 關(guān)鍵字: Altera  片上可編程系統(tǒng)  SOPC  FPGA  NiosII  

          FPGA最小系統(tǒng)之:最小系統(tǒng)的概念

          • FPGA最小系統(tǒng)是可以使FPGA正常工作的最簡(jiǎn)單的系統(tǒng)。它的外圍電路盡量最少,只包括FPGA必要的控制電路。一般所說(shuō)的FPGA的最小系統(tǒng)主要包括:FPGA芯片、下載電路、外部時(shí)鐘、復(fù)位電路和電源。如果需要使用NIOS II軟嵌入式處理器還要包括:SDRAM和Flash。一般以上這些組件是FPGA最小系統(tǒng)的組成部分。
          • 關(guān)鍵字: FPGA最小系統(tǒng)  Altera  NiosII  Flash  SDRAM  

          基于FPGA的嵌入式圖像監(jiān)控系統(tǒng)設(shè)計(jì)

          • 本文主要完成了嵌入式圖像監(jiān)控系統(tǒng)的設(shè)計(jì),該系統(tǒng)克服了模擬圖像監(jiān)控技術(shù)具有的弊端,在普通家庭、臨時(shí)性作業(yè)場(chǎng)所中具有很強(qiáng)的應(yīng)用前景。這些領(lǐng)域一般對(duì)視頻傳輸指標(biāo)的要求不一定很高,但要求便于攜帶,同時(shí)功耗較小(例如臨時(shí)性場(chǎng)合等),具有體積小、功耗低、成本低、速度快、穩(wěn)定性好等特點(diǎn),可以有效地克服傳統(tǒng)的基于計(jì)算機(jī)的監(jiān)控系統(tǒng)的缺點(diǎn)。系統(tǒng)可做為一個(gè)智能部件“嵌入”到各種應(yīng)用系統(tǒng)中,如將其配上網(wǎng)絡(luò)接口接上計(jì)算機(jī)系統(tǒng),即可構(gòu)成一個(gè)監(jiān)控網(wǎng)絡(luò)系統(tǒng),是一種相對(duì)獨(dú)立的OEM部件。
          • 關(guān)鍵字: 圖像監(jiān)控系統(tǒng)  NiosII  FPGA  

          基于ARM和FPGA的服務(wù)機(jī)器人運(yùn)動(dòng)控制系統(tǒng)研究

          • 介紹了一種基于ARM和FPGA的嵌入式控制系統(tǒng),該系統(tǒng)既能獨(dú)立運(yùn)行又能在計(jì)算機(jī)輔助下運(yùn)行,是一種兼具柔性和開(kāi)放性的系統(tǒng)。利用ARM的強(qiáng)大的數(shù)據(jù)流轉(zhuǎn)換功能和FPGA的快速配置能力,實(shí)現(xiàn)硬件可重構(gòu)。給出了系統(tǒng)的總體結(jié)構(gòu)、ARM和FPGA之間的通信設(shè)計(jì),重點(diǎn)給出了基于NiosII的嵌入式可重構(gòu)底層控制設(shè)計(jì),PWM功能模塊在FPGA上的實(shí)現(xiàn)。設(shè)計(jì)的系統(tǒng)集成度高、靈活。實(shí)驗(yàn)表明系統(tǒng)具有高可靠性,能滿足服務(wù)機(jī)器人外圍器件多樣性控制的要求。ARM和FPGA不僅可以并行運(yùn)行處理數(shù)據(jù),其之間又可以互相通信,實(shí)現(xiàn)了系統(tǒng)的擴(kuò)展
          • 關(guān)鍵字: 硬件可重構(gòu)  NiosII  FPGA  

          片上可編程系統(tǒng)在地震數(shù)據(jù)采集中的應(yīng)用

          • 通過(guò)靈活配置,采用包括NiosII CPU軟核、采集控制接口、通訊接口以及數(shù)據(jù)傳輸控制模塊等一些外圍接口,配合ADC采集芯片,組成了一個(gè)具有采集控制和傳輸功能的數(shù)據(jù)采集系統(tǒng)。通過(guò)測(cè)試和實(shí)驗(yàn),達(dá)到了預(yù)期的設(shè)計(jì)要求??s短了開(kāi)發(fā)周期,提高了研發(fā)的工作效率。
          • 關(guān)鍵字: NiosII  ADC  數(shù)據(jù)采集系統(tǒng)  

          基于NIOS II多處理機(jī)技術(shù)的的網(wǎng)絡(luò)數(shù)據(jù)處理研究

          • 隨著嵌入式網(wǎng)絡(luò)(網(wǎng)絡(luò)就是用物理鏈路將各個(gè)孤立的工作站或主機(jī)相連在一起,組成數(shù)據(jù)鏈路,從而達(dá)到資源共享和通信的目的)數(shù)據(jù)處理系統(tǒng)的廣泛應(yīng)用,網(wǎng)絡(luò)(網(wǎng)絡(luò)就是用物理鏈路將各個(gè)孤立的工作站或主機(jī)相連在一起,組成數(shù)據(jù)鏈路,從而達(dá)到資源共享和通信的目的)數(shù)據(jù)高速處理對(duì)嵌入式系統(tǒng)提出更高的要求,對(duì)于單處理器的網(wǎng)絡(luò)(網(wǎng)絡(luò)就是用物理鏈路將各個(gè)孤立的工作站或主機(jī)相連在一起,組成數(shù)據(jù)鏈路,從而達(dá)到資源共享和通信的目的)數(shù)據(jù)處理方式已無(wú)法滿足要求,為此,提出對(duì)于SOPC(System On Programmable Chip)的
          • 關(guān)鍵字: SOPC  NiosII  多處理機(jī)  

          基于NIOS Ⅱ軟核處理器的的UART通信的實(shí)現(xiàn)

          • NIOS ⅡI軟核處理器具有可裁減,配置靈活等優(yōu)點(diǎn)。在實(shí)際使用中,可根據(jù)需求,構(gòu)建最合適的處理器系統(tǒng)及外部接口而無(wú)需更改硬件電路或增加擴(kuò)展芯片。它提供完備的數(shù)據(jù)通信協(xié)議,用戶只需要使用相關(guān)的IP核即可得到所需的接口。針對(duì)這些特點(diǎn),本文介紹了基于NIOS II軟核處理器的異步串行通信的實(shí)現(xiàn)方法,講述了如何采用SOPC Builder定制UART(異步串行收發(fā)器)IP核,重點(diǎn)討論了在NIOS II集成開(kāi)發(fā)環(huán)境下的幾種編程方法。
          • 關(guān)鍵字: NiosII  IP核  SoPCBuilder  

          基于Nios II的掃描信號(hào)發(fā)生器IP核設(shè)計(jì)

          • 本文根據(jù)NiosII嵌入式系統(tǒng)的Avalon總線規(guī)范,提出了一種可控震源掃描信號(hào)發(fā)生器IP核設(shè)計(jì)的方法,并詳細(xì)介紹了IP核的硬件和軟件設(shè)計(jì)。該方法采用自定制組件的軟、硬件協(xié)同設(shè)計(jì),實(shí)現(xiàn)了起止頻率和掃描時(shí)長(zhǎng)可調(diào)的線性升降頻正弦掃描信號(hào)與頻率可調(diào)的偽隨機(jī)掃描信號(hào)發(fā)生器的IP核設(shè)計(jì)。通過(guò)對(duì)該IP核進(jìn)行驗(yàn)證,證明了其可行性和正確性。
          • 關(guān)鍵字: Avalon總線  IP核  NiosII  

          NIOS II開(kāi)發(fā)環(huán)境建立方法

          • 在20分鐘內(nèi)建立一個(gè)NIOS II開(kāi)發(fā)環(huán)境的方法。
          • 關(guān)鍵字: NiosII  QuartusII  管腳分配  

          基于NiosII的工程爆破振動(dòng)數(shù)據(jù)采集控制器設(shè)計(jì)

          • 介紹了一種在工程爆破振動(dòng)數(shù)據(jù)采集中應(yīng)用的控制器設(shè)計(jì)方案。系統(tǒng)采用Altera公司的FPGA作為主控制器芯片,其中集成控制邏輯單元與NiosII軟核嵌入式處理器二者結(jié)合成為單芯片控制器方案。
          • 關(guān)鍵字: NiosII  嵌入式處理器  FPGA  

          基于Nios II的MIII總線轉(zhuǎn)換板設(shè)計(jì)

          • 本文介紹的MIII總線轉(zhuǎn)換板的主要功能是將機(jī)載火控設(shè)備的MIII總線數(shù)據(jù)轉(zhuǎn)換成串口數(shù)據(jù),以方便實(shí)現(xiàn)與PC機(jī)的通信,這樣,PC機(jī)就可讀取機(jī)載設(shè)備數(shù)據(jù)或發(fā)送指令以操作總線設(shè)備。
          • 關(guān)鍵字: MIII總線  VerilogHDL  NiosII  
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