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          Avago于28nm CMOS工藝達(dá)成32Gbps的SerDes性能

          • Avago Technologies (Nasdaq: AVGO)為有線、無線和工業(yè)應(yīng)用模擬接口零組件領(lǐng)先供應(yīng)商宣布其28nm串行/解串器(SerDes)核心已經(jīng)達(dá)到32Gbps的性能,并且可以承受高達(dá)40dB的通道損耗,這個(gè)最新的SerDes核心不僅僅重新定義了芯片到芯片、連接端口和背板等接口可達(dá)到的數(shù)據(jù)率,并且反映了Avago為數(shù)據(jù)中心和企業(yè)應(yīng)用提供領(lǐng)先解決方案的持續(xù)承諾。
          • 關(guān)鍵字: Avago  CMOS  SerDes  

          優(yōu)化封裝以滿足SerDes應(yīng)用鍵合線封裝規(guī)范

          • 對(duì)于10Gbps及以上數(shù)據(jù)速率的SerDes,每個(gè)數(shù)據(jù)位的單位間隔是隨著近 20~30ps的信號(hào)上升/下降時(shí)間而縮短的。選擇合適的封裝互連結(jié)構(gòu),有效地傳輸這些信號(hào)已成為最大限度減少信號(hào)完整性問題的重要考慮因素,如串?dāng)_、阻
          • 關(guān)鍵字: SerDes  封裝  鍵合  封裝規(guī)范    

          基于GMSL SerDes的雙汽車電子控制單元的應(yīng)用

          • Maxim的吉比特(千兆)多媒體串行鏈路(GMSL)方案可以對(duì)數(shù)字視頻和音頻數(shù)據(jù)進(jìn)行串行轉(zhuǎn)換,然后通過一對(duì)雙絞線串行傳輸。另外,集成雙向控制通道可以使能單個(gè)微處理器(micro;C)對(duì)串行器、解串器和所有連接外設(shè)編程。在典
          • 關(guān)鍵字: SerDes  GMSL  汽車電子  控制單元    

          LatticeECP4高速配置SERDES

          • LatticeECP4? FPGA系列結(jié)合了高性能FPGA結(jié)構(gòu)、高性能I/O和多達(dá)16個(gè)通道的嵌入式SERDES,帶有相關(guān)的物理編碼子層(PCS)邏輯。每個(gè)PCS邏輯通道包含專用的發(fā)送和接收電路,用于高速、全雙工的串行數(shù)據(jù)傳輸,傳輸速率高達(dá)
          • 關(guān)鍵字: LatticeECP4  SERDES    

          GMSL SerDes在雙汽車電子控制單元(ECU)中的應(yīng)用

          • 摘要:Maxim的吉比特(千兆)多媒體串行鏈路(GMSL)方案可以對(duì)數(shù)字視頻和音頻數(shù)據(jù)進(jìn)行串行轉(zhuǎn)換,然后通過一對(duì)雙絞線串行傳輸。另外,集成雙向控制通道可以使能單個(gè)微處理器(micro;C)對(duì)串行器、解串器和所有連接外設(shè)編程
          • 關(guān)鍵字: SerDes  GMSL  ECU  汽車電子    

          優(yōu)化遠(yuǎn)程及遙測(cè)應(yīng)用的視頻SERDES電路

          • 優(yōu)化遠(yuǎn)程及遙測(cè)應(yīng)用的視頻SERDES電路,為了滿足視頻系統(tǒng)、工業(yè)和醫(yī)療顯示和視頻傳送等應(yīng)用消除較長連接電纜限制、提高數(shù)據(jù)速率,以及需要雙向傳輸輔助數(shù)據(jù)的要求。Intersil公司推出了一款采用雙向I2C接口的SERDESIC ISL34340,有助于各種應(yīng)用實(shí)現(xiàn)遠(yuǎn)程配置
          • 關(guān)鍵字: SERDES  遠(yuǎn)程  遙測(cè)  視頻    

          通過SerDes遠(yuǎn)端I2C接口訪問16位I2C外設(shè)寄存器地址

          • 摘要:本應(yīng)用筆記介紹如何通過吉比特多媒體串行鏈路(GMSL) SerDes的遠(yuǎn)端I2C接口訪問16位寄存器地址。引言Maxim吉比特多媒體串行鏈路(GMSL)串行器/解串器(SerDes)系列包括MAX9249、MAX9259、MAX9260、MAX9263和
          • 關(guān)鍵字: I2C  外設(shè)  寄存器  地址  16位  接口  SerDes  遠(yuǎn)端  通過  訪問  

          高性能SERDES及其在CPRI接口的應(yīng)用分析

          • 1引言
            隨著數(shù)據(jù)寬帶網(wǎng)絡(luò)的迅猛發(fā)展,需要不斷提高系統(tǒng)設(shè)備的業(yè)務(wù)容量。目前的趨勢(shì)是采用高速串行通信技術(shù),即采用串行解串器SERDES,把低速的并行數(shù)據(jù)轉(zhuǎn)換為高速串行數(shù)據(jù)連接。SERDES串行接口可在背板或電纜/光纖等
          • 關(guān)鍵字: 應(yīng)用  分析  接口  CPRI  SERDES  及其  高性能  

          SERDES的數(shù)字系統(tǒng)中高效時(shí)鐘設(shè)計(jì)方案

          • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
          • 關(guān)鍵字: SERDES  數(shù)字系統(tǒng)  高效時(shí)鐘  

          低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術(shù)

          • 低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術(shù),由于現(xiàn)代數(shù)字信號(hào)處理器(dsp)設(shè)計(jì)、半導(dǎo)體工藝、并行處理和互連與傳輸技術(shù)的進(jìn)步,現(xiàn)代高性能dsp的處理能力得到極大發(fā)展。但在移動(dòng)通信、雷達(dá)信號(hào)處理和實(shí)時(shí)圖像處理等復(fù)雜電子系統(tǒng)中,單片dsp的性能仍可能無法滿足需
          • 關(guān)鍵字: 數(shù)據(jù)傳輸  技術(shù)  分組  全雙工  差分  SerDes  低壓  

          第四代無線基礎(chǔ)架構(gòu)的離散式 SerDes 解決方案

          • 當(dāng)網(wǎng)絡(luò)設(shè)備制造商建置4G的基礎(chǔ)架構(gòu)時(shí),對(duì)于分布式基站架構(gòu)部署中無線電設(shè)備控制及無線電設(shè)備之間的高序列數(shù)據(jù)速率需求將大幅升高。要滿足如此需求,光纖纜線兩端的SerDeson必須發(fā)揮更高的效能。網(wǎng)絡(luò)設(shè)備制造商可將系統(tǒng)切割開來,便能使用同一個(gè)熟悉的FPGA平臺(tái)進(jìn)行邏輯層處理。
          • 關(guān)鍵字: SerDes  解決方案  離散  架構(gòu)  基礎(chǔ)  無線  

          高性能FPGA中的高速SERDES接口

          • 引言  串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)的帶寬不斷增加至多吉比特范圍,并行接口已經(jīng)被高速串行鏈接,或SERDES (串化器/ 解串器)所取代 。起初, SERDES是獨(dú)立的ASSP或ASIC器
          • 關(guān)鍵字: SERDES  FPGA  性能  接口    

          符合EMI/EMC標(biāo)準(zhǔn)的SerDes――基本測(cè)試策略和指南

          • 摘要:電磁干擾(EMI)和電磁兼容(EMC)測(cè)試是汽車應(yīng)用領(lǐng)域中串行器/解串器(SerDes)設(shè)計(jì)必須驗(yàn)證的參數(shù),需要在設(shè)計(jì)之初謹(jǐn)慎考慮EMI和EMC問題,避免不必要的設(shè)計(jì)修改。以下應(yīng)用筆記詳細(xì)介紹了如何在SerDes系統(tǒng)
          • 關(guān)鍵字: SerDes  EMI  EMC  標(biāo)準(zhǔn)    

          基于SERDES收發(fā)器和CPRI的電信系統(tǒng)低延遲變化設(shè)計(jì)

          • 基于SERDES收發(fā)器和CPRI的電信系統(tǒng)低延遲變化設(shè)計(jì),  本文討論利用帶嵌入式SERDES收發(fā)器和CPRI鏈路IP內(nèi)核的低成本FPGA,來實(shí)現(xiàn)電信系統(tǒng)低延遲變化設(shè)計(jì)的考慮因素。  無線電信設(shè)備制造商正受到以更小體積、更低功耗、更低制造成本來布署基站架構(gòu)的壓力。當(dāng)通過WiMa
          • 關(guān)鍵字: 延遲  變化  設(shè)計(jì)  系統(tǒng)  電信  SERDES  收發(fā)器  CPRI  基于  

          TI推出分立式雙通道串行器/解串器

          •   日前,德州儀器 (TI) 宣布推出業(yè)界首款 6 千兆位每秒 (Gbps) 的雙通道串行器-解串器 IC (SerDes),其可為無線應(yīng)用提供 高達(dá)470 兆位每秒 (Mbps) 至6.25 Gbps 的連續(xù)數(shù)據(jù)速率。該 TLK6002 支持從原有速度到最新更快速度的升級(jí),符合所有無線基站設(shè)計(jì)所需的 OBSAI 與 CPRI 標(biāo)準(zhǔn)要求。TLK6002 可用于各種無線基礎(chǔ)設(shè)施應(yīng)用,其中包括 WiMAX、TD-SCDMA、WCDMA 以及 CDMA2000 等。   最新 SerDes 使用統(tǒng)一 12
          • 關(guān)鍵字: TI  串行器  解串器  SerDes  
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