- 全球領先的可編程邏輯解決方案供應商賽靈思公司 (Xilinx, Inc. )宣布聯手中國電子行業(yè)領先的培訓機構中電網 (ChinaECNet)及賽靈思公司大中華授權培訓公司依元素科技公司(E-elements)， 共同推動中國國家級“國家信息技術緊缺人才培養(yǎng)工程”的“電子工程與集成電路技術培訓項目”，即日起推出國家信息技術緊缺人才培養(yǎng)工程“高級FPGA之嵌入式設計專業(yè)課程。” 通過該課程網絡及現場培訓并成績優(yōu)秀者，將獲
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Xilinx FPGA 嵌入式設計
- 全球可編程邏輯解決方案領導廠商賽靈思公司(Xilinx, Inc. (NASDAQ: XLNX))日前宣布，現場可編程門陣列 (FPGA) 首次實現對多通道杜比數碼專業(yè)編碼功能的支持。利用這種實施在賽靈思 Virtex®-5 器件中的編碼功能，廣播設備開發(fā)人員可針對快速變化的設計要求做出極其靈活的反應，充分滿足高性能、低功耗系統(tǒng)和精簡材料清單的需求，以降低開發(fā)成本。
賽靈思與業(yè)界領先的可重配置多媒體與通信IP 模塊供應商 Coreworks聯手協(xié)作，向 Virtex-5 FPGA 移植了
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Xilinx FPGA 編碼器
- 全球可編程邏輯解決方案領導廠商賽靈思公司(Xilinx, Inc. )日前在2009 年國際廣播電視博覽會 (IBC2009) 上展示了串行連接領域的最新開發(fā)成果，這些技術可顯著降低串行數字接口的成本和功耗，并有助于全新 DisplayPort 和 Ethernet AVB協(xié)議的快速采用。賽靈思廣播連接目標設計平臺是上述創(chuàng)新成果的核心，該平臺不僅可簡化全套廣播音視頻接口解決方案的開發(fā)，而且在同一可編程產品中能同時支持標清 (SD)、高清 (HD) 和 3G-SDI 等標準，從而有助于加速產品上市進程，
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Xilinx 串行連接 DisplayPort Ethernet Virtex
- 全球可編程邏輯解決方案領導廠商賽靈思公司 (Xilinx, Inc. ) 日前宣布推出 ISE® 設計套件11.3 版本軟件，為Virtex®-6 HXT FPGA 設計提供支持。Virtex®-6 HXT FPGA 專為40G/100G 有線通信和數據通信而優(yōu)化，為超高帶寬系統(tǒng)的設計人員提供線速超過 11Gbps的串行接口技術。ISE 設計套件 11.3 版本的推出，使設計人員得以利用涵蓋整個主流、高端以及超高端串行設計應用的所有連接領域內帶有串行收發(fā)器的 FPGA產品。
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Xilinx Virtex ISE 設計套件
- 我們已經聽到不少關于半導體制造成本攀升，以至于延后了技術節(jié)點進展的狀況。芯片業(yè)者紛紛改抱無晶圓廠(fabless)或輕晶圓廠(fab-lite)業(yè)務模式，借以將采購與維護資本設備的龐大成本轉嫁他人(不包括制程技術開發(fā))。
但就算仰賴晶圓代工廠，邁向下一個技術節(jié)點并沒有因此便宜多少;因此，看來會有越來越少的芯片業(yè)者能跟上尖端科技的水平。
那么設計成本究竟多高?過去幾個月以來，有不少人隨口估計32/28納米節(jié)點的龐大成本;回溯到1月份，Xilinx執(zhí)行長Moshe Gavrielov引述了一些
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Xilinx 32納米 半導體制造 fabless fab-lite
- 全球可編程邏輯解決方案領導廠商賽靈思公司(Xilinx, Inc. ) 今天宣布，在8月28日成都舉辦的“2009中國FPGA產業(yè)發(fā)展論壇”上，《中國電子報》把“2009 FPGA最佳產品獎”授予賽靈思目標設計平臺(Target Design Platform, 簡稱TDP)，對該平臺在幫助客戶大幅縮短研發(fā)周期，輕松實現創(chuàng)新設計并大大增強客戶競爭力方面的突出優(yōu)勢，給予了充分的肯定。
“賽靈思公司推出的目標設計平臺，給FPGA產品賦予了新
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Xilinx FPGA Virtex-6 DSP Spartan-6
- 隨著信息技術的發(fā)展，人們面臨的數字信號處理任務越來越繁重，對數據處理系統(tǒng)的要求也越來越高。數字信號處理功能一般在兩類可編程平臺上實現：數字信號處理器(DSP)和現場可編程門陣列(FPGA)。DSP是一種特殊的微處理器，計算功能很強大，可以用C語言或匯編語言進行編程，能實現復雜的信號處理算法;而FPGA是一種配置能力很強的硬件，可以用VHDL或VerilogHDL來編程，它的實時性很好，能并行進行大數據量的底層算法處理。
FPGA在紅外熱像儀中被采用
筆者主要從事紅外熱像儀的研制工作。紅外熱
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Xilinx DSP FPGA 紅外熱像儀
- 全球可編程邏輯解決方案領導廠商賽靈思公司(Xilinx, Inc. ) 今天宣布在IDG集團下屬權威電子雜志《電子設計技術》(EDN China)正在舉辦的2009年度創(chuàng)新獎評選中，其40nm 高性能Virtex?-6 FPGA 系列與目標設計平臺從數百項報名產品中脫穎而出，雙雙獲得提名進入最后入圍產品。
“賽靈思目標設計平臺獲得這一電子業(yè)界著名獎項的提名，再一次充分證明電子業(yè)界越來越重視推動FPGA進入主流系統(tǒng)開發(fā)的新方法的需求?！?賽靈思公司產品與解決方案管理
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Xilinx Virtex 40nm 目標設計平臺
- 全球可編程邏輯解決方案領導廠商賽靈思公司今天宣布其最新一代Virtex®-6 FPGA系列兼容PCI Express® 2.0標準，與前一代產品系列相比功耗降低50%，與競爭產品相比性能提高15%。在Virtex-6 FPGA中集成的第二代PCIe®模塊已經通過了1-8通道配置的PCI-SIG PCI Express 2.0版本兼容性與互操作性測試，進一步豐富了賽靈思及其支持廣泛采用的串行互連標準的聯盟成員的設計資源。這一重大的里程碑事件有望加速高帶寬PCIe 2.0系統(tǒng)在通信
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Xilinx Virtex FPGA ISE
- 繼臺積電傳出40納米制程出現良率問題，聯電客戶端FPGA(Field Programmable Gate Array)芯片業(yè)者賽靈思(Xilinx)，亦傳出因65納米制程良率問題，導致高階產品Virtex-5大缺貨，且可能要到9月才能獲得解決。臺積電、聯電先后在40納米、65納米出狀況，顯示晶圓代工廠宣告已成熟的先進制程技術，恐怕還是距離客戶期待有一段差距，由于晶圓廠跟不上出貨腳步，不僅讓賽靈思急得跳腳，甚至迫使其調降財測。不過，聯電對此并未發(fā)表評論。
近期半導體業(yè)界最熱門話題，就是晶圓代工廠與
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Xilinx 65納米 Virtex-5 40納米
- 目標
演示設計人員利用賽靈思目標設計平臺如何輕松開始下一項 FPGA 設計工作。該演示使用 Spartan®-6 FPGA SP601 評估套件展示客戶是如何之快：
1. 開箱后，立即可以開始設計工作。
2. 評估功耗、資源和架構權衡。
3. 重新利用并擴展參考設計。
演示規(guī)范
1. 利用板診斷測試確認硬件功能。
2. 實施基礎參考設計接口，演示如何通過簡便易用的 GUI 靈巧地使用 FPGA 的設計與特性。
a. 為了便于演示，我們比較圖形處理
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Xilinx Spartan FPGA SP601
- 全球可編程邏輯解決方案領導廠商賽靈思公司(Xilinx, Inc. )今天宣布，致力于加速基于Virtex?-6 和 Spartan?-6 現場可編程門陣列 (FPGA) 片上系統(tǒng) (SoC) 解決方案開發(fā)的賽靈思基礎目標設計平臺隆重推出。這款基礎級目標設計平臺在完全集成的評估套件中融合了 ISE? 設計套件 11.2版本、擴展的IP系列以及面向Virtex-6或Spartan-6 FPGA的預驗證參考設計，可幫助設計團隊大幅縮短開發(fā)時間，從而集中工程設計資源以提高產品差異化。
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Xilinx Virtex Spartan FPGA SoC ISE
- “安富利(Avnet) 公司長期以來一直致力于賽靈思開發(fā)板的設計，我們非常榮幸能夠利用賽靈思目標設計平臺將我們雙方的合作推至新的水平?；跇藴蕦嵤┑倪@些新型平臺， 配合 FMC 連接器與可擴展的子卡，成就了整個生態(tài)系統(tǒng)的雙贏合作。這不僅使我們能夠推出更豐富的賽靈思開發(fā)板及套件，同時還可使我們雙方共同的客戶能夠在 Spartan-6 與 Virtex-6 目標設計平臺之間獲得更加豐富的選擇以及更高的互操作性。”
── Jim Beneke，安富利電子全球技術市場營銷副總裁
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Xilinx Virtex FPGA芯片 可編程邏輯
- 全球可編程邏輯解決方案領導廠商賽靈思公司(Xilinx, Inc.? )今天宣布隆重推出賽靈思基礎目標設計平臺， 致力于加速基于其Virtex?-6 和 Spartan?-6 現場可編程門陣列 (FPGA) 的片上系統(tǒng) (SoC) 解決方案的開發(fā)。這款基礎級目標設計平臺在完全集成的評估套件中融合了 ISE? 設計套件 11.2版本、擴展的IP系列以及面向Virtex-6或Spartan-6 FPGA的預驗證參考設計，可幫助設計團隊大幅縮短開發(fā)時間，從而集中工程設計資源
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Xilinx Virtex Spartan.FPGA SoC
- 全球可編程邏輯解決方案領導廠商賽靈思公司(Xilinx, Inc. )今天宣布成為北京大學(北大)與美國加州大學洛杉機分校(UCLA)新成立的科學與工程聯合研究學院的首家贊助企業(yè)。本周在北京大學舉辦的研究學院成立儀式上， 北大校長周其鳳院士與UCLA校長Gene Block教授共同簽署了合作協(xié)議，相關政府官員、業(yè)界領導和學術界專家共同參加了簽字儀式。
新成立的科學與工程聯合研究學院致力于為兩所大學的多學科合作研究提供大力支持。除了工程實驗室合作，兩校師生還將通過兩校共同制定的教學大綱、實戰(zhàn)操作培
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Xilinx Virtex FPGA芯片 可編程邏輯
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