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polarfire? fpga 文章進入polarfire? fpga技術(shù)社區(qū)

基于FPGA的混合信號驗證流程

基于FPGA的混合信號驗證流程,隨著SoC設(shè)計上的混合信號組件數(shù)量增加了，基本的功能驗證對于硅初期能否成功也愈來愈重要。FPGA在系統(tǒng)整合難題上加入了一個新特點。在核心上，此新范例-可編程系統(tǒng)單芯片(programmable system chip,PSC)整合FPGA電閘
關(guān)鍵字：驗證流程信號混合 FPGA 基于

基于FPGA的檢糾錯邏輯算法的實現(xiàn)

基于FPGA的檢糾錯邏輯算法的實現(xiàn),星載計算機系統(tǒng)中電子器件容易受到空間環(huán)境電磁場的輻射和重粒子的沖擊，從而導致器件運行出錯，特別是存儲器中數(shù)據(jù)容易出現(xiàn)錯誤，需要具有檢糾錯功能的電路模塊對其進行糾正，以免造成嚴重的后果?；跐h明碼的糾錯
關(guān)鍵字：算法實現(xiàn) 邏輯糾錯 FPGA 基于

音頻編解碼芯片接口的FPGA應(yīng)用

音頻編解碼芯片接口的FPGA應(yīng)用,介紹了音頻編解碼芯片WM8731基于FPGA的接口電路的設(shè)計，包括芯片配置模塊與音頻數(shù)據(jù)接口模塊等，使得控制器只通過寄存器就可以方便地對其進行操作。整個設(shè)計以VHDL和Verilog HDL語言在Max+Plus Ⅱ里實現(xiàn)，并進行了驗
關(guān)鍵字： FPGA 應(yīng)用接口芯片解碼音頻

Altera演示第一款基于模型的FPGA浮點DSP工具

　　Altera公司日前演示了使用FPGA的浮點DSP新設(shè)計流程，這是業(yè)界第一款基于模型的浮點設(shè)計工具，支持在FPGA中實現(xiàn)復數(shù)浮點DSP算法。伯克萊設(shè)計技術(shù)公司 (Berkeley Design Technology, Inc, BDTI) 進行的獨立分析驗證了能夠在Altera 的Stratix 和Arria FPGA系列中簡單方便的高效實現(xiàn)高性能浮點DSP設(shè)計。　　
關(guān)鍵字： Altera FPGA

應(yīng)用于除顫器的FPGA解決方案

越來越多的人們認識到當心臟病患者的心臟驟停時，快速及時的救治能夠帶來很大的好處。這促使更多公共場所和辦...
關(guān)鍵字： FPGA 除顫器

一種基于Spartan3E的DDS優(yōu)化設(shè)計

在高可靠應(yīng)用領(lǐng)域，如果設(shè)計得當，將不會存在類似于MCU的復位不可靠和PC可能跑飛等問題。CPLD/FPGA的高可靠性還...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于ARM和FPGA架構(gòu)的三維圖形加速系統(tǒng)

引言隨著圖形處理的巨額運算量，CPU變得不堪重負。此時，需要使用特定的硬件設(shè)備來為嵌入式CPU承擔圖形處...
關(guān)鍵字： FPGA 圖形加速

為參加2011 Digilent Design Contest的中國代表團壯行

??????? 2011年9月12日，中秋月圓之夜，參加 2011 DDC? 德國總決賽的中國代表團整裝待發(fā)，即將登機遠赴德國慕尼黑參加DDC總決賽，與來自世界各地的16支隊伍進行角逐。讓我們?yōu)樗麄儔研?！預(yù)祝他們?nèi)〉煤贸煽儯? ??????
關(guān)鍵字： Digilent FPGA

基于FPGA的存儲測試系統(tǒng)的設(shè)計

摘要：針對某些特殊的測試試驗要求測試系統(tǒng)高性能、微體積、低功耗，在存儲測試理論基礎(chǔ)上，進行了動態(tài)存儲測試系統(tǒng)的FPGA設(shè)計。介紹了該系統(tǒng)的組成，對控制模塊進行了詳細設(shè)計。針對測試環(huán)境的多樣性設(shè)計了采樣策略
關(guān)鍵字： FPGA 存儲測試系統(tǒng)

基于Flash型FPGA的信號源卡設(shè)計

摘要：介紹了一種基于Flash型FPGA的多路模擬重信號源設(shè)計方法，該系統(tǒng)以ACTEL公司的A3P125VQ100芯片為核心，實現(xiàn)了系統(tǒng)的軟硬件結(jié)合。它包括數(shù)模轉(zhuǎn)換單元、電源模塊、多路模擬開關(guān)模塊以及運算放大單元等，實現(xiàn)了電源
關(guān)鍵字： Flash FPGA 信號源

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設(shè)計

摘要：為了在提高數(shù)據(jù)采集卡的速度的同時降低成本，設(shè)計了一種應(yīng)用流水線存儲技術(shù)的數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)應(yīng)用軟件與硬件相結(jié)合的方式來控制實現(xiàn)，通過MAX1308模數(shù)轉(zhuǎn)換器完成ADC的轉(zhuǎn)化過程，采用多片Nandflash流水線
關(guān)鍵字： FPGA 高速數(shù)據(jù) 采集系統(tǒng)設(shè)計

基于FPGA的SoC驗證平臺實現(xiàn)電路仿真?zhèn)慑e

基于FPGA的SoC驗證平臺實現(xiàn)電路仿真?zhèn)慑e,臺灣工業(yè)技術(shù)研究院提出一種能夠顯著提升客制化FPGA原型板驗證效率的創(chuàng)新方法，自動化現(xiàn)有的電路仿真(in-circuit emulation)偵錯功能，并提供更高的FPGA能見度。這個以FPGA為基礎(chǔ)的SoC驗證平臺對工研院而言是前景看好
關(guān)鍵字：實現(xiàn) 電路仿真平臺驗證 FPGA SoC 基于

FPGA配置模式

FPGA配置模式,FPGA有多種配置模式：并行主模式為一片F(xiàn)PGA加一片EPROM的方式;主從模式可以支持一片PROM編程多片F(xiàn)PGA;串行模式可以采用串行PROM編程FPGA;外設(shè)模式可以將FPGA作為微處理器的外設(shè)，由微處理器對其編程。　　如何實現(xiàn)快
關(guān)鍵字：模式配置 FPGA

FPGA芯片結(jié)構(gòu)分析

FPGA芯片結(jié)構(gòu)分析,目前主流的FPGA仍是基于查找表技術(shù)的，已經(jīng)遠遠超出了先前版本的基本性能，并且整合了常用功能(如RAM、時鐘管理和DSP)的硬核(ASIC型)模塊。如圖1-1所示(注：圖1-1只是一個示意圖，實際上每一個系列的FPGA都有其相應(yīng)的
關(guān)鍵字：分析結(jié)構(gòu) 芯片 FPGA

現(xiàn)代FPGA設(shè)計的能源優(yōu)化方案

現(xiàn)代FPGA設(shè)計的能源優(yōu)化方案,引言　　減少FPGA的功耗可帶來許多好處，如提高可靠性、降低冷卻成本、簡化電源和供電方式、延長便攜系統(tǒng)的電池壽命等。無損于性能的低功耗設(shè)計既需要有高功率效率的FPGA架構(gòu)，也需要有能駕馭架構(gòu)組件的良好設(shè)計規(guī)范
關(guān)鍵字：優(yōu)化方案能源設(shè)計 FPGA 現(xiàn)代

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利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設(shè)計的方法
基于FPGA的機載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠程監(jiān)控器設(shè)計與實現(xiàn)
基于FPGA的LCD顯示遠程更新

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如何使用FPGA實現(xiàn)多通道高速CMOS圖像采集系統(tǒng)的設(shè)計
如何使用FPGA實現(xiàn)新型高速CCD圖像數(shù)據(jù)采集系統(tǒng)
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基于UDP協(xié)議和FPGA的點到點數(shù)據(jù)傳輸方案
如何使用FPGA實現(xiàn)低成本網(wǎng)絡(luò)數(shù)據(jù)傳輸存儲系統(tǒng)

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