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基于MAX+plusⅡ開發(fā)平臺的EDA設(shè)計(jì)方法

　　MAX + plus Ⅱ是美國Altera 公司的一種EDA 軟件,用于開發(fā)CPLD 和FPGA 進(jìn)行數(shù)字系統(tǒng)的設(shè)計(jì)。用圖形輸入方式和文本輸入方式設(shè)計(jì)了一模60 計(jì)數(shù)器,介紹了數(shù)字系統(tǒng)設(shè)計(jì)的一般方法和過程,揭示了其在數(shù)字系統(tǒng)中的重要作用。　　EDA ( Elect ronic Design Automation) 即電子設(shè)計(jì)自動化技術(shù),是指以計(jì)算機(jī)為基本工作平臺,把應(yīng)用電子技術(shù)、計(jì)算機(jī)技術(shù)、智能化技術(shù)融合在一個電子CAD 通用軟件包中,輔助進(jìn)行三方面的電子設(shè)計(jì)工作,即集成電路設(shè)計(jì)、電子電路設(shè)計(jì)以及
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利用FPGA協(xié)處理器優(yōu)化高性能數(shù)字?jǐn)z像監(jiān)控系統(tǒng)

　　數(shù)字?jǐn)z像監(jiān)視系統(tǒng)現(xiàn)在具有更多的能力，是傳統(tǒng)模擬系統(tǒng)強(qiáng)有力的替代方案。除了提供先進(jìn)的壓縮技術(shù)，如MPEG-4和H.264，數(shù)字?jǐn)z像監(jiān)視系統(tǒng)現(xiàn)在配備了如圖像穩(wěn)定，全景攝像和視頻運(yùn)動檢測等算法。本文將討論這些新技術(shù)的優(yōu)點(diǎn)，和它們在用數(shù)字信號處理器（DSP）和FPGA協(xié)處理器平臺上的優(yōu)化實(shí)現(xiàn)。它將詳盡地闡述現(xiàn)代監(jiān)視系統(tǒng)的需求，這些系統(tǒng)中常用的算法和加快系統(tǒng)設(shè)計(jì)的開發(fā)平臺。　　商用攝像監(jiān)視系統(tǒng)的一般需求是支持一至八個攝像機(jī)，先進(jìn)的視頻壓縮如MPEG-4，Windows Media 9 H.264，低延遲編碼
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基于FPGA的USB2.0控制器設(shè)計(jì)

　　在視頻存儲和圖像寬帶領(lǐng)域中，經(jīng)常遇到實(shí)時高速數(shù)據(jù)傳輸?shù)囊蟆?000年4月，由Intel、Microsoft、NEC、Compaq、Lucent、Phillips等公司共同制訂的USB2.0（Universal Serial Bus）傳輸協(xié)議，其速度遠(yuǎn)遠(yuǎn)超過了目前使用IEEE1394接口進(jìn)行視頻傳輸?shù)?00Mbps，達(dá)到了480Mbps；而且具有即插即用的PnP（Plug And Play）、可進(jìn)行菊花鏈?zhǔn)降募壜?lián)（通過USB HUB進(jìn)行外圍擴(kuò)展）、可串連多達(dá)127個USB設(shè)備等優(yōu)點(diǎn)。應(yīng)用該協(xié)議可支持實(shí)
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AES加密算法的一種優(yōu)化的FPGA實(shí)現(xiàn)方法

本文介紹AES加密算法的一種FPGA實(shí)現(xiàn)的方法以及對其加密速度的優(yōu)化處理技巧。
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國內(nèi)首個開放源碼硬件創(chuàng)新大賽圓滿閉幕

覆蓋全國50所高等院校，1000多位在校研究生和博士生及其導(dǎo)師，近200個團(tuán)隊(duì)的首屆“中國電子學(xué)會Xilinx杯開放源碼硬件創(chuàng)新大賽”，于2008年4月20日在無錫國家集成電路基地經(jīng)過緊張的最后一輪顛峰對決和評委們的遴選，終于塵埃落定。來自北京郵電大學(xué)由林家儒教授指導(dǎo)的團(tuán)隊(duì)（田耘，徐文波，胡彬和谷濤）提交的“WCDMA系統(tǒng)字頻數(shù)域干擾抵消器”項(xiàng)目最終摘取桂冠，載譽(yù)而歸。獲得二等獎的分別是東北大學(xué)的“基于FPGA動態(tài)重配置技術(shù)的熱電廠集中監(jiān)控系
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如何用FPGA實(shí)現(xiàn)原型板原理圖的驗(yàn)證

　　首次流片成功取決于整個系統(tǒng)硬件和相關(guān)軟件的驗(yàn)證，有些公司提供的快速原型生成平臺具有許多調(diào)試功能，但這些平臺的價格非常高。　　因此最流行的做法是根據(jù)DUT和具體應(yīng)用設(shè)計(jì)復(fù)合FPGA板，驗(yàn)證這些板的原理圖通常是很麻煩的，本文提出一種利用FPGA實(shí)現(xiàn)原型板原理圖驗(yàn)證的新方法。　　由于價格競爭越來越激烈，首次流片成功或只需少量的修改變得越來越重要。　　為了達(dá)到這一目標(biāo)，對整個系統(tǒng)(即硬件和相關(guān)軟件)的驗(yàn)證成為重中之重。　　業(yè)界也涌現(xiàn)了許多策略來幫助設(shè)計(jì)師完成RTL上的軟件運(yùn)行。這些策略提供了在
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FPGA在微處理器系統(tǒng)中的在應(yīng)用配置

ALTERA公司SRAM工藝可編程器件應(yīng)用廣泛，專用配置器件比較昂貴。在具有微處理器的系統(tǒng)中，使用微處理器系統(tǒng)的存儲器來存儲配置數(shù)據(jù)，并通過微處理器配置FPGA，這種方法幾乎不增加成本。微處理器根據(jù)不同的程序應(yīng)用，采用不同的配置數(shù)據(jù)對FPGA進(jìn)行配置，使FPGA實(shí)現(xiàn)與該應(yīng)用有關(guān)的特定功能。詳細(xì)介紹了微處理器系統(tǒng)中連接簡單的被動串行配置方法和被動并行異步配置方法。
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Floorplanner工具在基于FPGA的嵌入式系統(tǒng)設(shè)計(jì)中的應(yīng)用

Floorplanner工具在基于FPGA的嵌入式系統(tǒng)設(shè)計(jì)中的應(yīng)用,利用本文談到的Floorplanner工具可以對嵌入式處理器、相關(guān)的IP和定制邏輯進(jìn)行布局控制和分組，簡化復(fù)雜系統(tǒng)級芯片的開發(fā)，提高系統(tǒng)整體性能。
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將FPGA/CPLD技術(shù)用于防止移動設(shè)備盜竊

從澳大利亞到中國，從美國到歐洲，手機(jī)制造商不斷為其產(chǎn)品增加新的語音/數(shù)據(jù)功能，而具有新功能的手機(jī)更容易被盜...
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FPGA中軟FIFO設(shè)計(jì)和實(shí)現(xiàn)

異步FIFO是一種在電子系統(tǒng)中得到廣泛應(yīng)用的器件，文中介紹了一種基于FPGA的異步FIFO設(shè)計(jì)方法。使用這種方法可以設(shè)計(jì)出高速、高可靠的異步FIFO。
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Stratix FPGA電源方案設(shè)計(jì)與驗(yàn)證

針對Stratix系列FPGA系統(tǒng)電源需求情況，給出了一套基于Intersil高效三輸出同步補(bǔ)償穩(wěn)定器的“單片”電源解決方案。
關(guān)鍵字：驗(yàn)證方案設(shè)計(jì) 電源 FPGA Stratix

采用靈活的汽車FPGA提高片上系統(tǒng)級集成和降低物料

汽車制造商們堅(jiān)持不懈地改進(jìn)車內(nèi)舒適性、安全性、便利性、工作效能和娛樂性，反過來，這些努力又推動了各種車內(nèi)數(shù)字技術(shù)的應(yīng)用。
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如何用FPGA實(shí)現(xiàn)算法的硬件加速

當(dāng)設(shè)計(jì)者試圖從算法中獲得最佳性能但軟件方法已無計(jì)可施時，可以嘗試通過硬件/軟件重新劃分來進(jìn)行加速。在64K...
關(guān)鍵字：實(shí)現(xiàn)算法 CRC 硬件加速 FPGA 查找表 typedef const 算術(shù)邏輯單元 ALU 狀態(tài)寄存器

四種常用FPGA/CPLD設(shè)計(jì)思想與技巧

上級數(shù)據(jù)和本級時鐘是異步的，也就是說上級芯片或模塊和本級芯片或模塊的時鐘是異步時鐘域的。為了避免異步時...
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基于FPGA的VGA顯示模式和像素頻率的識別

視頻采集卡不僅能用于影像處理，還可以用一臺顯示器同時顯示、監(jiān)控多臺主機(jī)的內(nèi)容，達(dá)到實(shí)時控制多臺主機(jī)的目的。隨著數(shù)字影像技術(shù)的不斷發(fā)展，使得視頻采集卡的需求不斷增加，在電子通信與信息處理領(lǐng)域得到廣泛應(yīng)用。而傳統(tǒng)的視頻采集卡硬件實(shí)現(xiàn)復(fù)雜，難于向便攜、嵌入的方向發(fā)展。因此，設(shè)計(jì)一種硬件簡單、使用方便、便于嵌入到系統(tǒng)中的視頻信號采集電路具有重要的意義。
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