processor(dsp) 文章 進(jìn)入processor(dsp)技術(shù)社區(qū)
FPGA設(shè)計(jì)工具視點(diǎn)
- 作為一個(gè)負(fù)責(zé)FPGA企業(yè)市場營銷團(tuán)隊(duì)工作的人，我不得不說，由于在工藝技術(shù)方面的顯著成就以及硅芯片設(shè)計(jì)領(lǐng)域的獨(dú)創(chuàng)性，F(xiàn)PGA正不斷實(shí)現(xiàn)其支持片上系統(tǒng)設(shè)計(jì)的承諾。隨著每一代新產(chǎn)品的推出，F(xiàn)PGA在系統(tǒng)中具有越來來越多的功能，可作為協(xié)處理器、DSP 引擎以及通信平臺(tái)等，在某些應(yīng)用領(lǐng)域甚至還可用作完整的片上系統(tǒng)。
- 關(guān)鍵字： 設(shè)計(jì)工具 DSP FPGA ASSP
基于C5509A的功放閉環(huán)數(shù)字控制系統(tǒng)(圖)
- 隨著通信系統(tǒng)的發(fā)展，要求通信具有更高的傳輸可靠性、更強(qiáng)的抗干擾能力。在無線信號(hào)發(fā)射過程中，射頻信號(hào)必須經(jīng)功放放大，再經(jīng)天線發(fā)射出去，信號(hào)經(jīng)功放后的幅度和穩(wěn)定性對(duì)通信的可靠性和抗干擾起著關(guān)鍵作用。攻放輸出信號(hào)的幅度越大通信可靠性越穩(wěn)定，接收的準(zhǔn)確性和可靠性就越高。在發(fā)射端，功放輸出功率控制一方面需要保證功放的安全可靠，另一方面又要盡可能使功放輸出功率最大。因此，對(duì)功放的輸出功率控制就顯得十分重要，早期的功放控制一般采用模擬等方法實(shí)現(xiàn)。
- 關(guān)鍵字： C5509A DSP 功放 閉環(huán) 數(shù)字控制
用FPGA實(shí)現(xiàn)FIR濾波器
- 你接到要求用FPGA實(shí)現(xiàn)FIR濾波器的任務(wù)時(shí)，也許會(huì)想起在學(xué)校里所學(xué)的FIR基礎(chǔ)知識(shí)，但是下一步該做什么呢?哪些參數(shù)是重要的?做這個(gè)設(shè)計(jì)的最佳方法是什么?還有這個(gè)設(shè)計(jì)應(yīng)該怎樣在FPGA中實(shí)現(xiàn)?現(xiàn)在有大量的低成本IP核和工具來幫助你進(jìn)行設(shè)計(jì)，因?yàn)镕IR是用FPGA實(shí)現(xiàn)的最普通的功能。
- 關(guān)鍵字： FIR濾波器 DSP LUT FPGA
DSP的特點(diǎn)、發(fā)展趨勢(shì)與應(yīng)用詳談
- 數(shù)字化技術(shù)正在極大地改變著我們的生活和體驗(yàn)。作為數(shù)字化技術(shù)的基石，數(shù)字信號(hào)處理(DSP)技術(shù)已經(jīng)、正在、并且還將在其中扮演一個(gè)不可或缺的角色。DSP的核心是算法與實(shí)現(xiàn)，越來越多的人正在認(rèn)識(shí)、熟悉和使用它。因此，理性地評(píng)價(jià)DSP器件的優(yōu)缺點(diǎn)，及時(shí)了解DSP的現(xiàn)狀以及發(fā)展趨勢(shì)，正確使用DSP芯片，才有可能真正發(fā)揮出DSP的作用。
- 關(guān)鍵字： DSP； 發(fā)展趨勢(shì)
異步DSP核心設(shè)計(jì)方略:更低功耗,更高性能
- 目前，處理器性能的主要衡量指標(biāo)是時(shí)鐘頻率。絕大多數(shù)的集成電路 (IC) 設(shè)計(jì)都基于同步架構(gòu)，而同步架構(gòu)都采用全球一致的時(shí)鐘。這種架構(gòu)非常普及，許多人認(rèn)為它也是數(shù)字電路設(shè)計(jì)的唯一途徑。然而，有一種截然不同的設(shè)計(jì)技術(shù)即將走上前臺(tái)：異步設(shè)計(jì)。 這一新技術(shù)的主要推動(dòng)力來自硅技術(shù)的發(fā)展?fàn)顩r。隨著硅產(chǎn)品的結(jié)構(gòu)縮小到 90 納米以內(nèi)，降低功耗就已成為首要事務(wù)。異步設(shè)計(jì)具有功耗低、電路更可靠等優(yōu)點(diǎn)，被看作是滿足這一需要的途徑。
- 關(guān)鍵字： 異步； DSP
用DSP和FPGA構(gòu)建多普勒測(cè)量系統(tǒng)
- 隨著FPGA性能和容量的改進(jìn)，使用FPGA執(zhí)行DSP功能的做法變得越來越普遍。
- 關(guān)鍵字： 多普勒 DSP 測(cè)量系統(tǒng) FPGA
基于DSP控制的全數(shù)字UPS逆變器設(shè)計(jì)(一)
- 隨著信息處理技術(shù)的不斷發(fā)展，尤其是計(jì)算機(jī)的廣泛應(yīng)用和Internet的迅猛發(fā)展，供電系統(tǒng)的可靠性要求越來越高，因此對(duì)不間斷電源（UPS）技術(shù)指標(biāo)的要求也越來越高。UPS的核心部分是一個(gè)恒頻恒壓逆變器，由于傳統(tǒng)模擬控制需要使用大量的分立元器件，老化和溫漂嚴(yán)重影響了系統(tǒng)的長期穩(wěn)定性?；贒SP的數(shù)字控制技術(shù)能大大改善產(chǎn)品的一致性，同時(shí)增加了控制的柔性，提高了整個(gè)系統(tǒng)的穩(wěn)定性和可靠性[1]。本文主要提出了一種數(shù)字控制的UPS逆變器結(jié)構(gòu)，詳細(xì)論述了控制系統(tǒng)的參數(shù)設(shè)計(jì)。
- 關(guān)鍵字： UPS逆變器 DSP 數(shù)字雙環(huán)控制器
幾種DSP與外接存儲(chǔ)器的連接方法
- 存儲(chǔ)器接口分為ROM接口和RAM接口兩種。ROM包括EPROM和FLASH，而RAM主要是指SRAM。TMS320C5409具有32K字的片內(nèi)RAM和16K字的掩膜ROM。但是在DSP應(yīng)用的很多場合，尤其是帶信號(hào)存儲(chǔ)的DSP應(yīng)用來說，TMS320C5409的片內(nèi)存儲(chǔ)資源是遠(yuǎn)遠(yuǎn)不夠用的。因此，設(shè)計(jì)一個(gè)TMS320C5409硬件系統(tǒng)一般應(yīng)該包括其與EPROM/FLASH和SRAM的接口設(shè)計(jì)，以存放程序和數(shù)據(jù)。本文介紹TMS320C5409與存儲(chǔ)器的接口設(shè)計(jì)方案。
- 關(guān)鍵字： 存儲(chǔ)器 DSP 連接
mcu,DSP,PLD/EDA的介紹/比較/分析
- 當(dāng)今,數(shù)字時(shí)代的核心動(dòng)力便是單片機(jī),DSP ,PLD/ EDA ,以其各自的特點(diǎn)滿足了各種需要,推動(dòng)著信息技術(shù)的快速發(fā)展。這里將對(duì)這三類電子產(chǎn)品分別加以介紹,并作比較和分析。
- 關(guān)鍵字： 單片機(jī)(Single-chipMicrocomputer) 數(shù)字信號(hào)處理(DSP) 可編程邏輯器件(PLD)/電子設(shè)計(jì)自動(dòng)化(EDA)
MAX706S在DSP系統(tǒng)中的應(yīng)用
- 對(duì)于實(shí)際的DSP應(yīng)用系統(tǒng)特別是產(chǎn)品化的DSP系統(tǒng)而言，可靠性是一個(gè)不容忽視的問題。由于DSP系統(tǒng)的時(shí)鐘頻率比較高，因此在運(yùn)行時(shí)極有可能發(fā)生干擾和被干擾的現(xiàn)象，嚴(yán)重時(shí)系統(tǒng)可能會(huì)出現(xiàn)死機(jī)。為了克服這種情況，除了在軟件上作一些保護(hù)措施外，硬件上也必須作相應(yīng)的處理。硬件上最有效的保護(hù)措施就是采用具有監(jiān)視(Watchdog)功能的自動(dòng)復(fù)位電路。各大公司生產(chǎn)了多種微處理器監(jiān)控器，用來監(jiān)測(cè)微處理器的運(yùn)行狀態(tài)，一旦微處理器失控就強(qiáng)行復(fù)位微處理器，引導(dǎo)程序重新運(yùn)行。
- 關(guān)鍵字： MAX706S DSP 監(jiān)控電路
基于DSP的加速度計(jì)的家用監(jiān)測(cè)設(shè)備設(shè)計(jì)
- 先進(jìn)的半導(dǎo)體技術(shù)正為體積越來越小、功能愈加強(qiáng)大的家用醫(yī)療設(shè)備的發(fā)展鋪平道路。對(duì)于病人來說，更小的便攜式設(shè)備帶來的好處是更容易進(jìn)行保健、更少去醫(yī)院以及進(jìn)一步降低醫(yī)療費(fèi)用。
- 關(guān)鍵字： DSP 家用監(jiān)測(cè) 加速度計(jì)
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