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Synopsys IC Compiler II改變設(shè)計游戲規(guī)則后端物理設(shè)計吞吐量提高10倍
- 亮點： 設(shè)計規(guī)劃速度提升了10倍，實現(xiàn)速度提升了5倍，容量提升了2倍?–?它們共同使吞吐量加速了10倍 構(gòu)建于全新的可擴展基礎(chǔ)架構(gòu)、時序和解析優(yōu)化引擎之上 已經(jīng)在成熟和新興的技術(shù)節(jié)點上成功生產(chǎn)流片 為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識產(chǎn)權(quán)(IP)及服務(wù)的全球性領(lǐng)先供應(yīng)商新思科技公司日前宣布：正式推出將導(dǎo)致游戲規(guī)則發(fā)生改變的IC?Compiler?II，它是當(dāng)前領(lǐng)先業(yè)界的布局和布線解決方案IC?Compiler?的繼任產(chǎn)品，可用于基于成熟和新
- 關(guān)鍵字： Synopsys IC RTL
工程師設(shè)計手冊：集成“硬”IP模塊的幾點建議
- 對“硬”IP模塊—那些以GDSII數(shù)據(jù)庫形式提交的模塊—的集成，讓系統(tǒng)設(shè)計工程師能夠把某些過去不得不在公...
- 關(guān)鍵字： IP模塊 工程師經(jīng)驗談 GDSII
Cadence推出新一代Encounter RTL-to-GDSII流程
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)，日前宣布推出最新版Cadence? Encounter? RTL-to-GDSII流程，面向高性能千兆級設(shè)計，包括在20納米最新技術(shù)節(jié)點上的新設(shè)計。這種最新的RTL-to-GDSII設(shè)計、實現(xiàn)與簽收流程是與領(lǐng)先的IP與晶圓廠合作伙伴及客戶合作開發(fā)的，能更有效地進行SoC開發(fā)，滿足并超越當(dāng)今市場所需的功耗、性能與面積需求。
- 關(guān)鍵字： Cadence RTL-to-GDSII
Synopsys綜合和布局及布線生產(chǎn)效率提升兩倍
- Synopsys日前宣布，在其Galaxy設(shè)計實現(xiàn)平臺中推出了最新的RTL綜合工具Design Compiler 2010，它將綜合和物理層實現(xiàn)流程增速了兩倍。Design Compiler自1988年問世以來，隨著工藝技術(shù)從1.5微米到32納米的進步，而不斷得到調(diào)整升級。而今時序與面積布線的優(yōu)化已成為主要的挑戰(zhàn)，最新版工具與時俱進，針對拓撲技術(shù)進行擴展，為Synopsys布局布線解決方案IC Compiler提供“物理層指引”;將時序和面積的一致性提升至5%的同時，還將IC
- 關(guān)鍵字： Synopsys RTL 32納米
Design Compiler 2010將綜合和布局及布線的生產(chǎn)效率提高2倍
- 全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證和制造的軟件及知識產(chǎn)權(quán)(IP)供應(yīng)商新思科技有限公司日前宣布：該公司在其Galaxy™設(shè)計實現(xiàn)平臺中推出了最新的創(chuàng)新RTL綜合工具Design Compiler 2010，它將綜合和物理層實現(xiàn)流程增速了兩倍。為了滿足日益復(fù)雜的設(shè)計中極具挑戰(zhàn)性的進度要求，工程師們需要一種RTL綜合解決方案，使他們盡量減少重復(fù)工作并加速物理實現(xiàn)進程。為了應(yīng)對這些挑戰(zhàn)，Design Compiler 2010對拓撲技術(shù)進行擴展，為Synopsys旗艦布局布線解決方案IC Compile
- 關(guān)鍵字： Synopsys Galaxy RTL
中芯國際和新思科技攜手推出Reference Flow 4.0
- 全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證和制造軟件及知識產(chǎn)權(quán)(IP)供應(yīng)商新思科技公司與中國內(nèi)地最大的芯片代工企業(yè)中芯國際集成電路制造有限公司日前宣布，將攜手推出全新的65納米RTL-to-GDSII參考設(shè)計流程4.0(Reference Flow 4.0)。作為新思科技專業(yè)化服務(wù)部與中芯國際共同開發(fā)的成果，該參考流程中增加了 Synopsys Eclypse™ 低功耗解決方案及IC Compiler Zroute布線技術(shù)，為設(shè)計人員解決更精細工藝節(jié)點中遇到的低功耗和可制造性設(shè)計(DFM)等問題提供更多
- 關(guān)鍵字： 中芯國際 65納米 Galaxy RTL-to-GDSII參考設(shè)計流程4.0
Magma 最新版Talus Design面世
- 美國加州圣荷塞 2009年4月14日– 芯片設(shè)計解決方案供應(yīng)商微捷碼（Magma®）設(shè)計自動化有限公司（納斯達克代碼：LAVA）日前宣布，該公司面向先進集成電路的全芯片綜合產(chǎn)品Talus® Design的最新版本正式面市。新版Talus® Design包括了一個增強的時序優(yōu)化引擎、改善的內(nèi)存使用效率以及先進的生產(chǎn)率改進，比如：創(chuàng)新性可用性、更為靈活的先進腳本語言以及領(lǐng)先的第三方可測性設(shè)計（DFT）產(chǎn)品支持。同時，Talus Design與Talus Vortex相結(jié)
- 關(guān)鍵字： Magma RTL DFT Talus
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