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          SAR ADC功率技術(shù)規(guī)格的謎團

          • 逐次逼近寄存器(SAR)型ADC的謎團之一,或者至少是造成嚴(yán)重混淆的原因,就是計算系統(tǒng)級的確切電源需求。經(jīng)研究發(fā)現(xiàn),相關(guān)技術(shù)手冊對于該技術(shù)規(guī)格讓人難以捉摸,而且令人沮喪。SAR ADC提供一種低功耗方法來測量輸入信
          • 關(guān)鍵字: SAR ADC  模擬技術(shù)  

          噪聲:模擬輸入的諸多討論

          • 在考慮噪聲因素以及與ADC模擬輸入和共模電壓節(jié)點有關(guān)的其他失真情況時,自帶開關(guān)電容輸入采樣網(wǎng)絡(luò)的ADC同樣也可作為一個簡單的指標(biāo)。圖1顯示集成驅(qū)動放大器和抗混疊濾波器(AAF)的典型ADC模擬輸入。集成放大器和AAF的
          • 關(guān)鍵字: 噪聲    模擬輸入    ADC  

          定制化PSoC實現(xiàn)8通道SAR ADC采樣16通道

          • 通過ADC進行信號采樣是MCU應(yīng)用的常見任務(wù),這可以將連續(xù)模擬信號轉(zhuǎn)換為一系列離散的數(shù)字?jǐn)?shù)據(jù)供MCU處理。在某些應(yīng)用中,單個ADC需要以高采樣率對多個通道進行采樣。例如電源監(jiān)測系統(tǒng)的管理子系統(tǒng)需要對多個穩(wěn)壓電源的
          • 關(guān)鍵字: PSoC    ADC    采樣  

          理解ADC電源噪聲的PSRR與PSMR

          • 研究電源噪聲時有三個熟悉的術(shù)語,分別是:PSRR-DC、PSRR-AC和PSMR。其中PSRR表示電源抑制比,PSMR表示電源調(diào)制比。為了理解電源噪聲入口,需要了解這些術(shù)語,以及它們對于ADC的含義。 一般而言,這些術(shù)語告訴我們?nèi)?/li>
          • 關(guān)鍵字: ADC    電源噪聲    PSRR    PSMR  

          逐次逼近型 ADC:確保首次轉(zhuǎn)換有效

          • 簡介最高 18 位分辨率、10 MSPS 采樣速率的逐次逼近型模數(shù)轉(zhuǎn)換器(ADC)可以滿足許多數(shù)據(jù)采集應(yīng)用的需求,包括便攜式、工 業(yè)、醫(yī)療和通信應(yīng)用。本文介紹如何初始化逐次逼近型 ADC 以實現(xiàn)有效轉(zhuǎn)換。逐次逼近型架構(gòu)逐次
          • 關(guān)鍵字: 逐次逼近    ADC    SAR  

          為逐次逼近型ADC 設(shè)計可靠的數(shù)字接口

          • 簡介逐次逼近型模數(shù)轉(zhuǎn)換器(因其逐次逼近型寄存器而稱為SAR ADC)廣泛運用于要求最高18 位分辨率和最高5 MSPS 速率的應(yīng)用中。其優(yōu)勢包括尺寸小、功耗低、無流水線延遲和易用。主機處理器可以通過多種串行和并行接口(
          • 關(guān)鍵字: 逐次逼近    ADC    SAR  

          針對交流性能優(yōu)化的18 位、5 MSPS數(shù)據(jù)采集系統(tǒng)

          • 電路功能與優(yōu)勢圖1中的電路是一款完整的18位、5 MSPS、低功耗、低噪聲、高精度數(shù)據(jù)采集信號鏈解決方案,功耗僅122 mW?;鶞?zhǔn)電壓源、基準(zhǔn)電壓源緩沖器、驅(qū)動放大器和ADC提供優(yōu)化解決方案,具有業(yè)界領(lǐng)先的99 dB SNR和
          • 關(guān)鍵字: 數(shù)據(jù)采集    ADC    放大器    基準(zhǔn)電壓源  

          用于±10 V輸入的12位、300 kSPS、單電源、完全隔離式數(shù)據(jù)采集系統(tǒng)

          • 連接/參考器件AD8606/ 精密、低噪聲、雙通道CMOS、軌到軌輸入/輸出運算放大器AD7091R/ 1 MSPS、超低功耗、12位ADCADuM5401/ 集成DC/DC轉(zhuǎn)換器的四通道2.5 kV隔離器12位、300 kSPS、單電源、完全隔離式數(shù)據(jù)采集系統(tǒng),
          • 關(guān)鍵字: 數(shù)據(jù)采集系統(tǒng)    運算放大器    ADC    隔離式    單電源  

          JESD204B轉(zhuǎn)換器內(nèi)確定性延遲解密

          • 對于需要一系列同步模數(shù)轉(zhuǎn)換器(ADC)的高速信號采樣和處理應(yīng)用,轉(zhuǎn)換器具有去相位偏移和匹配延遲變化的能力至關(guān)重要。圍繞該特性展開的系統(tǒng)設(shè)計極為關(guān)鍵,因為從模擬采樣點到處理模塊之間的任何延遲失配都會使性能下
          • 關(guān)鍵字: JESD204B    ADC    FPGA  

          ADC分類及特點介紹

          • 在儀器儀表系統(tǒng)中,常常需要將檢測到的連續(xù)變化的模擬量如:溫度、壓力、流量、速度、光強等轉(zhuǎn)變成離散的數(shù)字量,才能輸入到計算機中進行處理。這些模擬量經(jīng)過傳感器轉(zhuǎn)變成電信號(一般為電壓信號),經(jīng)過放大器放大后
          • 關(guān)鍵字: ADC    逐次逼近    SAR    Σ-Δ    雙積分  

          SoC內(nèi)ADC子系統(tǒng)集成驗證挑戰(zhàn)

          • 現(xiàn)實世界的本質(zhì)就是模擬。我們需要從周圍世界采集的任何信息始終是一個模擬值。但要在微處理器內(nèi)處理模擬數(shù)據(jù)需要先將這些數(shù)據(jù)轉(zhuǎn)換為數(shù)字形式。因此,SoC中使用多種不同的ADC(模數(shù)轉(zhuǎn)換器)。根據(jù)幾個參數(shù)(即吞吐量、
          • 關(guān)鍵字: SoC    ADC    驗證  

          基于單片機的數(shù)控恒流源系統(tǒng)設(shè)計

          • 摘要:主要介紹了一種高穩(wěn)定性恒流源系統(tǒng)的設(shè)計方案,該系統(tǒng)在負(fù)載為1Omega;~15Omega;時,恒流輸出可調(diào)范圍0A~1A,且恒流源電流可以在該范圍內(nèi)任意設(shè)定,精度為plusmn;3mA。該恒流源系統(tǒng)主要由PIC單片機電路、A
          • 關(guān)鍵字: PIC單片機  ADC  DAC  恒流源  

          用于低噪聲CMOS圖像傳感器的流水線ADC設(shè)計及其成像驗證

          • 摘要:在對低噪聲CMOS圖像傳感器的研究中,除需關(guān)注其噪聲外,目前數(shù)字化也是它的一個重要的研究和設(shè)計方向,設(shè)計了一種可用于低噪聲CMOS圖像傳感器的12 bit,10 Msps的流水線型ADC,并基于0.5mu;m標(biāo)準(zhǔn)CMOS工藝進行
          • 關(guān)鍵字: CMOS  ADC  低噪聲  成像驗證    

          Giga ADC 介紹及雜散分析

          • 摘要Giga ADC 是 TI 推出的采樣率大于 1GHz 的數(shù)據(jù)轉(zhuǎn)換產(chǎn)品系列,主要應(yīng)用于微波通信、衛(wèi)星通信以及儀器儀表。本文介紹了 Giga ADC 的主要架構(gòu)以及 ADC 輸出雜散的成因分析,以及優(yōu)化性能的主要措施。1、Giga ADC
          • 關(guān)鍵字: Giga  ADC  雜散分析  射頻  通信  

          在不損失SNR的前提下,將高壓信號轉(zhuǎn)換成低壓ADC輸入

          •   模/數(shù)轉(zhuǎn)換器(ADC)電路設(shè)計中,特別是當(dāng)系統(tǒng)設(shè)計人員需要處理各種擺幅的電壓信號時,很容易產(chǎn)生的一個誤區(qū)是縮小輸入信號范圍,以適應(yīng)ADC的滿量程范圍,這將大大降低信噪比(SNR)。綜合來看,相對于高壓ADC,低壓(5V或者更低) ADC的選擇范圍更寬。高電源電壓通常會導(dǎo)致大的功耗,電路板設(shè)計也更加復(fù)雜,例如,需要使用更多的去耦電容。這篇應(yīng)用筆記討論了由于信號縮小所引起的SNR損失,如何量化這些損失,以及如何減小這些損失。   很多傳感器或系統(tǒng)輸出為高壓或雙極性消耗,比如,常見的±10V
          • 關(guān)鍵字: SNR  ADC  
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          sar-adc介紹

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