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          SERDES的數(shù)字系統(tǒng)中高效時(shí)鐘設(shè)計(jì)方案

          • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
          • 關(guān)鍵字: SERDES  數(shù)字系統(tǒng)  高效時(shí)鐘  

          低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術(shù)

          • 低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術(shù),由于現(xiàn)代數(shù)字信號處理器(dsp)設(shè)計(jì)、半導(dǎo)體工藝、并行處理和互連與傳輸技術(shù)的進(jìn)步,現(xiàn)代高性能dsp的處理能力得到極大發(fā)展。但在移動(dòng)通信、雷達(dá)信號處理和實(shí)時(shí)圖像處理等復(fù)雜電子系統(tǒng)中,單片dsp的性能仍可能無法滿足需
          • 關(guān)鍵字: 數(shù)據(jù)傳輸  技術(shù)  分組  全雙工  差分  SerDes  低壓  

          第四代無線基礎(chǔ)架構(gòu)的離散式 SerDes 解決方案

          • 當(dāng)網(wǎng)絡(luò)設(shè)備制造商建置4G的基礎(chǔ)架構(gòu)時(shí),對于分布式基站架構(gòu)部署中無線電設(shè)備控制及無線電設(shè)備之間的高序列數(shù)據(jù)速率需求將大幅升高。要滿足如此需求,光纖纜線兩端的SerDeson必須發(fā)揮更高的效能。網(wǎng)絡(luò)設(shè)備制造商可將系統(tǒng)切割開來,便能使用同一個(gè)熟悉的FPGA平臺進(jìn)行邏輯層處理。
          • 關(guān)鍵字: SerDes  解決方案  離散  架構(gòu)  基礎(chǔ)  無線  

          高性能FPGA中的高速SERDES接口

          • 引言  串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)的帶寬不斷增加至多吉比特范圍,并行接口已經(jīng)被高速串行鏈接,或SERDES (串化器/ 解串器)所取代 。起初, SERDES是獨(dú)立的ASSP或ASIC器
          • 關(guān)鍵字: SERDES  FPGA  性能  接口    

          符合EMI/EMC標(biāo)準(zhǔn)的SerDes――基本測試策略和指南

          • 摘要:電磁干擾(EMI)和電磁兼容(EMC)測試是汽車應(yīng)用領(lǐng)域中串行器/解串器(SerDes)設(shè)計(jì)必須驗(yàn)證的參數(shù),需要在設(shè)計(jì)之初謹(jǐn)慎考慮EMI和EMC問題,避免不必要的設(shè)計(jì)修改。以下應(yīng)用筆記詳細(xì)介紹了如何在SerDes系統(tǒng)
          • 關(guān)鍵字: SerDes  EMI  EMC  標(biāo)準(zhǔn)    

          基于SERDES收發(fā)器和CPRI的電信系統(tǒng)低延遲變化設(shè)計(jì)

          • 基于SERDES收發(fā)器和CPRI的電信系統(tǒng)低延遲變化設(shè)計(jì),  本文討論利用帶嵌入式SERDES收發(fā)器和CPRI鏈路IP內(nèi)核的低成本FPGA,來實(shí)現(xiàn)電信系統(tǒng)低延遲變化設(shè)計(jì)的考慮因素?! o線電信設(shè)備制造商正受到以更小體積、更低功耗、更低制造成本來布署基站架構(gòu)的壓力。當(dāng)通過WiMa
          • 關(guān)鍵字: 延遲  變化  設(shè)計(jì)  系統(tǒng)  電信  SERDES  收發(fā)器  CPRI  基于  

          TI推出分立式雙通道串行器/解串器

          •   日前,德州儀器 (TI) 宣布推出業(yè)界首款 6 千兆位每秒 (Gbps) 的雙通道串行器-解串器 IC (SerDes),其可為無線應(yīng)用提供 高達(dá)470 兆位每秒 (Mbps) 至6.25 Gbps 的連續(xù)數(shù)據(jù)速率。該 TLK6002 支持從原有速度到最新更快速度的升級,符合所有無線基站設(shè)計(jì)所需的 OBSAI 與 CPRI 標(biāo)準(zhǔn)要求。TLK6002 可用于各種無線基礎(chǔ)設(shè)施應(yīng)用,其中包括 WiMAX、TD-SCDMA、WCDMA 以及 CDMA2000 等。   最新 SerDes 使用統(tǒng)一 12
          • 關(guān)鍵字: TI  串行器  解串器  SerDes  

          Maxim推出吉比特串行器/解串器芯片組

          •   Maxim為其高速LVDS串行器/解串器(SerDes)產(chǎn)品線增添新成員:MAX9259/MAX9260 SerDes芯片組。該吉比特多媒體芯片組通過一對直流平衡的雙絞線或差分線構(gòu)成完備的雙向數(shù)字視頻鏈路。Maxim正在申請專利的差分、全雙工控制通道無需外部CAN或LIN接口,在簡化設(shè)計(jì)的同時(shí)可有效減小方案尺寸、降低成本。該方案支持顯示模塊的雙向通信,并可通過UART/I²C接口逐幀設(shè)置攝像模式。MAX9259/MAX9260芯片組非常適合信號識別、防撞系統(tǒng)、夜視系統(tǒng)、車道偏離報(bào)警等汽車應(yīng)用
          • 關(guān)鍵字: Maxim  SerDes  串行器  解串器  

          SERDES的FPGA實(shí)現(xiàn)(07-100)

          •   芯片功能的增加和數(shù)據(jù)吞吐量的要求,促使芯片行業(yè)從較低數(shù)據(jù)率的并行連接,轉(zhuǎn)向較高速度的串行連接。SERDES(Serializer-Dese rializer,)是經(jīng)高速差分對,而不是經(jīng)較低速度的并行總線傳輸串行化的數(shù)據(jù)。一個(gè)實(shí)例是用單個(gè)PCI-Express通道,替代傳統(tǒng)的32位、64MHz PCI總線(可達(dá)到2.112Gb/s),僅用4條線(運(yùn)行在2.5GHz),可達(dá)到4Gb/s總數(shù)據(jù)率。簡言之,SERDES協(xié)議允許用較少的引腳數(shù)傳輸較高的數(shù)據(jù)率。
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          Intersil推出新型視頻SERDES 接口IC

          •   全球高性能模擬半導(dǎo)體設(shè)計(jì)和制造領(lǐng)導(dǎo)廠商Intersil公司(納斯達(dá)克全球精選市場交易代碼:ISIL)今天宣布,推出ISL34340 SERDES接口IC。該器件可以將27位的視頻數(shù)據(jù)和雙向I2C傳送到一條長達(dá)10米的高速LVDS電纜。   ISL34340特別適用于包括在工業(yè)、醫(yī)療顯示、印刷和安全等領(lǐng)域的視頻系統(tǒng)中的SERDES應(yīng)用。   Intersil 公司推出的這款器件的多種性能和集成的增強(qiáng)性有助于設(shè)計(jì)人員大幅降低成本,同時(shí)改善視頻信號的距離和可靠性。它采用標(biāo)準(zhǔn)的視頻流,可以將3×
          • 關(guān)鍵字: Intersil  SERDES  接口IC  

          TI推出高度靈活的雙速 SerDes 器件

          •   德州儀器 (TI) 推出一款低功耗的串行器/解串器 (SerDes) 器件,該產(chǎn)品可提供快速的重鎖時(shí)間,并支持點(diǎn)對點(diǎn)數(shù)據(jù)傳輸系統(tǒng)中 1~2.6 Gbps的高數(shù)據(jù)帶寬。SerDes 收發(fā)器的獨(dú)立傳輸與接收通道允許異步數(shù)據(jù)速率操作。這種功能使設(shè)計(jì)人員能夠靈活地開發(fā)可支持 1.25 Gbps、2.5 Gbps 或二者混合的以太網(wǎng)無源光纖網(wǎng)絡(luò) (EPON) 光纖線路終端 (OLT),從而使現(xiàn)有系統(tǒng)的升級更輕松簡便。   TLK2541 可提供超高速的輸入/輸出數(shù)據(jù)通道,能夠通過約 50Ω 的受控
          • 關(guān)鍵字: TI  SerDes  EPON  OLT  收發(fā)器  

          串行/解串器的差分阻抗設(shè)計(jì)

          •   當(dāng)今許多手持電子設(shè)備都在LCD、照相機(jī)和鍵盤的接口電路中采用串行器/解碼器(SerDes)技術(shù)。SerDes可以減少穿過鉸鏈或滑動(dòng)裝置的信號數(shù)量,從而允許采用新的鉸鏈或滑動(dòng)裝置,并可以降低成本。從并行傳輸線轉(zhuǎn)換成串行傳輸線將產(chǎn)生差分阻抗的問題,差分阻抗將嚴(yán)重影響差分信號的完整性,導(dǎo)致LCD屏幕閃爍、射頻干擾以及器件的容限問題。本文討論手持電子設(shè)備中高速信號的差分阻抗效應(yīng),并討論如何測量、調(diào)試和解決這些問題。   SerDes器件一般都采用差分阻抗為100Ω的傳輸線,但在手持設(shè)備中實(shí)現(xiàn)10
          • 關(guān)鍵字: 差分阻抗 解碼器 SerDes   

          FPGA實(shí)現(xiàn)中的SERDES接口設(shè)計(jì)和測試

          • 近年來,芯片功能的增強(qiáng)和數(shù)據(jù)吞吐量要求推動(dòng)了芯片產(chǎn)業(yè)從低速率數(shù)據(jù)并行連接轉(zhuǎn)變到高速串行連接。這個(gè)概念被稱為SERDES(Serializer-Deserializer),包括在高速差分對上串行地傳送數(shù)據(jù),而不是用低速的并行總線。
          • 關(guān)鍵字: SERDES  FPGA  接口設(shè)計(jì)  測試    

          安華高科技推出支持Intel QuickPath互連規(guī)格的SerDes

          • Avago Technologies(安華高科技)宣布,推出業(yè)內(nèi)第一款符合Intel QuickPath互連規(guī)格的SerDes(串行/解串)知識產(chǎn)權(quán)(IP)產(chǎn)品,通過90納米(nm) CMOS展現(xiàn)Intel QuickPath互連支持,Avago讓服務(wù)器制造商能夠?qū)崿F(xiàn)采用Intel架構(gòu)計(jì)算應(yīng)用的ASIC解決方案,同時(shí)幫助客戶符合性能、上市速度以及批量生產(chǎn)目標(biāo)的需求。Avago將在9月18日到20日于美國舊金山舉辦的Intel開發(fā)者論壇(IDF)服務(wù)器專區(qū)演示支持In
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          DVEO在國際空間站的視頻流式傳輸系統(tǒng)采用Cypress的SERDES

          •        賽普拉斯半導(dǎo)體公司日前宣布:CMI的廣播分公司DVEO已經(jīng)在其DVB Master FDTM PCI卡中選用了Cypress的SERDES。作為NASA空間視頻網(wǎng)關(guān)(Space Video Gateway)系統(tǒng)的一部分,Cypress的HOTLinkTM SERDES發(fā)送器和接收器用于從國際空間站向地面?zhèn)魉透咔逦入娨暎℉DTV)實(shí)況信號。DVB Mas
          • 關(guān)鍵字: Cypress  DVEO  SERDES  國際空間站  視頻流式傳輸系統(tǒng)  
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          serdes介紹

            SERDES 并串行與串并行轉(zhuǎn)換器,串化器/并化器 A device that serializes output from, and deserializes input to, a business machine.   一種(信號)轉(zhuǎn)換設(shè)備,對商業(yè)計(jì)算機(jī)的輸出(信號)進(jìn)行并串行(串行化)轉(zhuǎn)換,而對其輸入(信號)進(jìn)行串并行(解串)轉(zhuǎn)換。SERializer/DESerializer的縮 [ 查看詳細(xì) ]

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