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Synopsys公司Design Compiler拓樸繪圖技術(shù)助ST加速ASIC設(shè)計
- Synopsys宣布意法半導(dǎo)體在其90nm和65nm 的ASIC設(shè)計流程中，應(yīng)用Design Compiler拓樸繪圖技術(shù)，縮短了整個設(shè)計時間。意法半導(dǎo)體在其ASIC方法集中應(yīng)用Design Compiler拓樸繪圖技術(shù)，從而消除了設(shè)計的反復(fù)(Iteration)，實現(xiàn)了內(nèi)部設(shè)計團隊和外部客戶整個設(shè)計環(huán)節(jié)工作的順暢。 在ASIC模式下，設(shè)計能否按計劃完成，在很多程度上取決于設(shè)計收斂完成前，網(wǎng)表在客戶與ASIC供應(yīng)商間反復(fù)時間的縮短。Design Compil
- 關(guān)鍵字： ASIC設(shè)計 Compiler拓樸繪圖技術(shù) Design ST Synopsys 單片機 嵌入式系統(tǒng) EDA IC設(shè)計
瑞薩科技采用Synopsys VCS解決方案和VMM方法論
- Synopsys的SystemVerilog解決方案被用于驗證針對網(wǎng)絡(luò)、外設(shè)和消費應(yīng)用的下一代 片上互連架構(gòu) 全球電子設(shè)計自動化軟件工具（EDA）領(lǐng)導(dǎo)廠商Synopsys（Nasdaq: SNPS）近日宣布，全球領(lǐng)先的移動、汽車和PC/音頻視頻半導(dǎo)體系統(tǒng)解決方案供應(yīng)商—瑞薩科技采用其VCS®的功能驗證解決方案，開發(fā)復(fù)雜的芯片上系統(tǒng)（SoC），并選定了VMM方法集，即《Verification Methodology Manual (VMM) for
- 關(guān)鍵字： Synopsys VCS解決方案 VMM方法論 單片機 工業(yè)控制 嵌入式系統(tǒng) 瑞薩科技 工業(yè)控制
Synopsys公司發(fā)布DFM新系列產(chǎn)品
- 解決45納米及以下工藝相關(guān)變異問題 創(chuàng)新的工藝識別DFM系列產(chǎn)品有助于設(shè)計者減少工藝變異的影響， 改善先進半導(dǎo)體的制造設(shè)計 全球領(lǐng)先的電子設(shè)計自動化（EDA）軟件工具領(lǐng)導(dǎo)廠商Synopsys推出了具備工藝識別功能的可制造性設(shè)計(DFM)新系列產(chǎn)品PA－DFM，用于分析45納米及以下工藝定制/模擬設(shè)計階段的工藝變異的影響。隨著工藝尺寸的日益減小，先進硅技術(shù)將引起更多如應(yīng)力工程的變異問題，這將越來越影響電路的性能。Synopsys PA-DFM系列的核心產(chǎn)品Seismos 和 P
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威捷采用Synopsys IC Compiler進行90納米設(shè)計
- 易于移植、強有力的技術(shù)發(fā)展路線圖等優(yōu)勢使其在競爭中脫穎而出 全球電子設(shè)計自動化軟件工具（EDA）領(lǐng)導(dǎo)廠商Synopsys（Nasdaq: SNPS）近日宣布，美國威捷半導(dǎo)體公司（Silicon Optix）采用Synopsys IC Compiler下一代布局布線解決方案，設(shè)計其高性能視頻處理器。長期以來，威捷半導(dǎo)體一直是Synopsys布局布線技術(shù)的用戶。為了轉(zhuǎn)向90納米工藝，威捷半導(dǎo)體評估了市場上所有的解決方案，并最終選定了IC Compiler，這是
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Synopsys與聯(lián)華電子合作以低功耗和DFT功能加強90納米參考流程
- Synopsys與聯(lián)華電子合作，以低功耗和DFT功能加強90納米參考流程 針對聯(lián)華電子的90納米工藝，Synopsys的 Galaxy®設(shè)計平臺業(yè)已通過多電壓 （Multi-Vdd）功能的實戰(zhàn)驗證 全球電子設(shè)計自動化軟件工具（EDA）領(lǐng)導(dǎo)廠商Synopsys（Nasdaq: SNPS）與世界半導(dǎo)體晶圓專工領(lǐng)導(dǎo)者臺灣聯(lián)華電子共同宣布，雙方合作以Synopsys的Galaxy™ 設(shè)計解決方案平臺為基礎(chǔ)，針對聯(lián)華電子的90納米工藝，在參考設(shè)計流程中增
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華虹NEC與Synopsys攜手開發(fā)參考設(shè)計流程2.0
- 華虹NEC選擇Synopsys作為其首選EDA供應(yīng)商 全球領(lǐng)先的電子設(shè)計自動化（EDA）軟件工具領(lǐng)導(dǎo)廠商Synopsys 與中國最先進的集成電路制造商之一上海華虹NEC電子有限公司今日宣布，雙方將攜手開發(fā)應(yīng)用于華虹NEC 0.18微米工藝的參考設(shè)計流程 2.0。華虹NEC選擇Synopsys作為其首選EDA供應(yīng)商后，將充分利用Synopsys Professional Services開發(fā)基于Synopsys Galaxy™
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Tensilica實現(xiàn)對Synopsys和Cadence支持
- TensilicaÒ宣布增加了自動可配置處理器內(nèi)核的設(shè)計方法學(xué)以面對90納米工藝下普通集成電路設(shè)計的挑戰(zhàn)。這些增加支持Cadence和Synosys工具的最新能力，包括自動生成物理設(shè)計流程腳本，自動輸入用戶定義的功耗結(jié)構(gòu)以及支持串繞分析。 Tensilica利用Synopsys的Power Compiler™的低功耗優(yōu)化能力，同時在Xtensa LX內(nèi)核和所有設(shè)計者自定義的擴展功能中自動的插入精細度時鐘門控，從而降低動態(tài)功耗。新自動生成的Xtensa布線腳本可
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在設(shè)計過程早期發(fā)現(xiàn)并解決問題
- 在設(shè)計過程早期發(fā)現(xiàn)并解決問題 在電路和系統(tǒng)設(shè)計中，需要昂貴的驗證周期這一點證明電子設(shè)計師和 EDA 供應(yīng)商也都是不免要犯錯的，所以最好使用能避免大多數(shù)錯誤的工具和方法。 要 點 ● 制造能力與工程生產(chǎn)率之間的差距繼續(xù)在加大?！ ?nbsp; 現(xiàn)在不存在標準的驗證方法?！ ?nbsp; 形式證明可減小設(shè)計師對功能驗證的依賴性?！ ?nbsp; 由于深亞微米加工存在許多電子物理學(xué)問題，電路驗證的重要性正在增加?！ ≡O(shè)計驗證需要每個設(shè)計小組花費大量的時間和資源。設(shè)計驗證費用與設(shè)計的規(guī)模和
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Synopsys支持國家集成電路人才培養(yǎng)基地講學(xué)活動
- 國家集成電路人才培養(yǎng)基地首期先進課程講學(xué)活動于近期在杭州舉行。此次活動邀請來自美國頂級高等院校的8位集成電路方面的權(quán)威教授，向17所國內(nèi)高校的教師及特邀人員講授了集成電路領(lǐng)域最先進的技術(shù)和最新的分析研究方法。此次活動得到了Synopsys公司的大力支持，幫助邀請并組織了這8位權(quán)威教授來華講學(xué)。通過此次合作，Synopsys為中國培養(yǎng)集成電路人才提供了多方面的支持，也是Synopsys與中國戰(zhàn)略伙伴之間開展長期合作的一個延續(xù)。www.synopsys.com
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IPCore采用Synopsys解決方案作為首選設(shè)計流程
- Synopsys公司宣布已與智芯科技公司(IPCore)簽署了一項協(xié)議，IPCore將采用Synopsys的Galaxy設(shè)計平臺、Discovery驗證平臺和廣泛的DesignWare IP產(chǎn)品系列作為其首選的內(nèi)部設(shè)計流程。通過此次兩家公司的合作，將為130nm及以下的流片工藝開發(fā)出全面的深亞微米級設(shè)計流程。同時，根據(jù)協(xié)議內(nèi)容， Synopsys 專業(yè)化服務(wù)部也將通過有選擇性地在轉(zhuǎn)包合同基礎(chǔ)上與IPCore進行合作，從而拓展自身在中國的業(yè)務(wù)提供能力。www.synopsys.com
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Synopsys擴建上海研發(fā)中心 高度關(guān)注中國市場
- 3月下旬，全球領(lǐng)先的EDA軟件提供商Synopsys宣布啟用擴建后的上海研發(fā)中心，該中心擁有200多名銷售、研發(fā)和技術(shù)支持人員。上海研發(fā)中心已經(jīng)成為Synopsys在海外最大的研發(fā)中心，它將與位于美國總部的研發(fā)中心一起，為全世界的IC設(shè)計者開發(fā)新一代的設(shè)計工具，并不斷為中國的半導(dǎo)體產(chǎn)業(yè)提供深入支持。目前，Synopsys與中國科學(xué)院及國內(nèi)知名高校建立了戰(zhàn)略合作關(guān)系，包括與中國科學(xué)院共建先進的SoC設(shè)計聯(lián)合實驗室，以及支持國家集成電路設(shè)計產(chǎn)業(yè)化基地孵化器建設(shè)項目等。此外，中芯國際（SMIC）也表示，把中芯國
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聯(lián)電與Synopsys合作開發(fā)0.13mm參考設(shè)計流程
- 新思科技(Synopsys)與聯(lián)電宣布針對聯(lián)電0.13mm工藝及新思的Galaxy平臺開發(fā)出參考設(shè)計流程。該流程使用了新思的Design Compilera、DFT Compilera、VCS、Formality、Physical Compilera、Astroa、PrimeTimea、Star-RCXTa、以及HerculesaPVS等工具，以協(xié)助客戶面對深亞微米工藝所帶來的挑戰(zhàn)。www.synopsys.com
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中國科學(xué)院EDA中心獲得Synopsys和SUN公司的EDA工具
- 為幫助中國科學(xué)院培養(yǎng)出能夠掌握最先進IC設(shè)計軟件和硬件平臺的高級人才，從而推動中國IC產(chǎn)業(yè)的發(fā)展，Synopsys與SUN公司聯(lián)手，通過美國Charles Babbage基金會向中國科學(xué)院EDA中心贈予20套IC設(shè)計全流程EDA工具軟件、20臺工作站和1臺服務(wù)器。作為對中國市場長期承諾的一部分，Synopsys公司一直致力于幫助中國加快IC產(chǎn)業(yè)，特別是IC設(shè)計業(yè)的成長。在此次合作中，Synopsys除了上述捐贈活動外，還將提供相應(yīng)的技術(shù)培訓(xùn)與咨詢服務(wù)。該中心的IC設(shè)計開發(fā)人員在應(yīng)用Synopsys最先進工
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Synopsys與華虹NEC共同推出參考設(shè)計流程
- 隨著中國IC產(chǎn)業(yè)的快速發(fā)展，IC設(shè)計廠商需要它們的Foundry廠商能夠達到高產(chǎn)能并擁有設(shè)計流程的靈活性。為滿足這些需求，Synopsys公司與上海華虹NEC電子有限公司針對華虹NEC 0.25mm芯片生產(chǎn)線，為共同的用戶一起開發(fā)并推出了新一代的參考設(shè)計流程。這一經(jīng)驗證的流程基于Synopsys Galaxy設(shè)計平臺和華虹NEC 的I/O和0.25mm標準單元庫。設(shè)計者可以從華虹NEC得到設(shè)計流程，而且馬上就能夠開始使用Synopsys基于頂級設(shè)計工具并經(jīng)過驗證的方法，從而幫助他們解決復(fù)雜SoC設(shè)計中時序
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synopsys介紹
Synopsys公司(Nasdaq: SNPS)是為全球集成電路設(shè)計提供電子設(shè)計自動化(EDA)軟件工具的主導(dǎo)企業(yè)。為全球電子市場提供技術(shù)先進的IC設(shè)計與驗證平臺，致力于復(fù)雜的芯片上系統(tǒng)(SoCs)的開發(fā)。同時，Synopsys公司還提供知識產(chǎn)權(quán)和設(shè)計服務(wù)，為客戶簡化設(shè)計過程，提高產(chǎn)品上市速度。
Synopsys公司總部設(shè)在美國加利福尼亞州Mountain View，有超過60家分公司分布在北美 [ 查看詳細 ]
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