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xilinx fpga 文章進入xilinx fpga技術(shù)社區(qū)

基于FPGA的大動態(tài)數(shù)控AGC系統(tǒng)設(shè)計

隨著軟件無線電技術(shù)和FPGA、DSP、AD 等技術(shù)的高速發(fā)展，數(shù)字接收機的應(yīng)用日益廣泛。為了擴大數(shù)字接收機的ADC 動態(tài)范圍，廣泛采用了自動增益控制(AGC) ，使接收機的增益隨著信號的強弱進行調(diào)整，其性能的好壞直接
關(guān)鍵字： FPGA AGC 動態(tài) 數(shù)控

基于FPGA的視頻采集與顯示模塊設(shè)計

本文給出的視頻采集和顯示模塊在設(shè)計時，選取分辨率為768times;494像素的NTSC制式，并選用輸出像素為640times;480的CCD攝像頭； FPGA選取Altera CyclONeⅡ系列Ep2c35F672c36 (內(nèi)含35000個邏輯單元)；主動串行配
關(guān)鍵字： FPGA 視頻采集顯示模塊

基于FPGA的測角脈沖細分電路的設(shè)計

摘要：對傳統(tǒng)的數(shù)字化轉(zhuǎn)角測量方法進行了簡要介紹，提出了一種能夠提高測角分辨率的脈沖細分技術(shù)，并結(jié)合激光陀螺輸出信號對該方法進行了誤差分析。接著利用FPGA對此項技術(shù)進行了硬件實現(xiàn)，具體描述了電路各部分的工
關(guān)鍵字： FPGA 脈沖電路

基于FPGA和DDS技術(shù)的任意波形發(fā)生器設(shè)計

摘要：根據(jù)現(xiàn)代電子系統(tǒng)對信號源的頻率穩(wěn)定度、準確度及分辨率越來越高的要求，結(jié)合直接數(shù)字式頻率合成器(DDS)的優(yōu)點，利用FPGA芯片的可編程性和實現(xiàn)方案易改動的特點，提出了一種基于FPGA和DDS技術(shù)的任意波形發(fā)生器
關(guān)鍵字： FPGA DDS 任意波形發(fā)生器

基于FPGA與VHDL的微型打印機的驅(qū)動設(shè)計

摘要：為了取代傳統(tǒng)利用單片機驅(qū)動微型打印機，使用Altera公司的FPGA芯片EP3C225Q240C8N設(shè)計驅(qū)動打印機的硬件控制電路，并正確控制微型打印機的工作時序。軟件使用硬件描述語言VHDL實現(xiàn)對微型打印機的時序控制，并通
關(guān)鍵字： FPGA VHDL 微型打印機驅(qū)動設(shè)計

基于FPGA的數(shù)字示波器

摘要：提出一種基于FPGA的簡易數(shù)字示波器設(shè)計方法，硬件上采用以Altera公司的EP2C8Q208CN現(xiàn)場可編程門陣列芯片作為核心器件，同時結(jié)合FPGA和NIOS軟核的優(yōu)勢，設(shè)計高效的片上可編程系統(tǒng)(SoPC)對高速A／D所采集的數(shù)據(jù)進
關(guān)鍵字： FPGA 數(shù)字示波器

基于FPGA的FFT算法硬件實現(xiàn)

設(shè)計了一種基于FPGA的1024點16位FFT算法，采用了基4蝶形算法和流水線處理方式，提高了系統(tǒng)的處理速度，改善了系統(tǒng)的性能。提出了先進行前一級4點蝶形運算，再進行本級與旋轉(zhuǎn)因子復(fù)乘運算的結(jié)構(gòu)。合理地利用了硬件資源。對系統(tǒng)劃分的各個模塊使用Verilog HDL進行編碼設(shè)計。對整個系統(tǒng)整合后的代碼進行功能驗證之后，采用QuartusⅡ與Matlab進行聯(lián)合仿真，其結(jié)果是一致的。該系統(tǒng)既有DSP器件實現(xiàn)的靈活性又有專用FFT芯片實現(xiàn)的高速數(shù)據(jù)吞吐能力，在數(shù)字信號處理領(lǐng)域有廣泛應(yīng)用。
關(guān)鍵字： FPGA FFT 算法硬件實現(xiàn)

基于FPGA的跳頻通信頻率合成器實現(xiàn)

摘要：介紹了一種基于ARM平臺、以太網(wǎng)和GPRS無線通信技術(shù)的智能家居遠程監(jiān)控系統(tǒng)，給出了系統(tǒng)的組成及工作原理，著重闡述了系統(tǒng)主要硬件和軟件的設(shè)計。智能家居遠程監(jiān)控系統(tǒng)的核心是嵌入式Web服務(wù)器。通過該嵌入式We
關(guān)鍵字： FPGA 跳頻通信頻率合成器

Zynq-7000 EPP: 工業(yè)電機控制應(yīng)用

Zynqtrade;-7000 EPP 實現(xiàn)了高性能與高靈活性的獨特組合，能夠充分滿足當(dāng)前及未來電機控制系統(tǒng)在高級處理和集成方面的要求。設(shè)計人員可加快產(chǎn)品投放市場的時間，同時支持系統(tǒng)內(nèi)置的可編程性，進而確保產(chǎn)品滿足未來應(yīng)
關(guān)鍵字： xilinx 賽靈思 Zynq

用CPLD和Flash實現(xiàn)FPGA配置

摘要：FPGA可以通過串行接口進行配置。本文對傳統(tǒng)的配置方法進行了研究，并從更新配置文件的方法入手，提出了利用處理機通過網(wǎng)絡(luò)更新的方法，給出了一個用CPLD和Flash對FPGA進行配置的應(yīng)用實例。
關(guān)鍵詞：現(xiàn)場可編程
關(guān)鍵字： Flash CPLD FPGA

賽靈思推出行業(yè)第一個可擴展處理平臺 Zynq-7000 產(chǎn)品系列

賽靈思推出行業(yè)第一個可擴展處理平臺 Zynq-7000 產(chǎn)品系列, 第一代可擴展式處理平臺Zynqtrade;-7000 系列是 Xilinx 推出的首款可擴展式處理平臺 (EPP)。這種新型產(chǎn)品將業(yè)界標準的 ARMreg; 雙核 Cortextrade;-A9 MPCoretrade; 處理系統(tǒng)與 Xilinx 一體化 28nm 架構(gòu)完美整合
關(guān)鍵字： xilinx 賽靈思 Zynq

基于FPGA的擴頻測距快速捕獲仿真研究

分析了擴頻測距理論原理與優(yōu)勢，給出了一種基于FPGA的快速擴頻測距模型。通過運用FFT IP Core計算收發(fā)序列間的互相關(guān)函數(shù)，可以實現(xiàn)快速捕獲。仿真結(jié)果表明，該方法具有速度快、誤差小、設(shè)計靈活、效率高的特點。
關(guān)鍵字： FPGA 擴頻快速捕獲仿真研究

基于FPGA的32位ALU軟核設(shè)計

介紹了一種基于可編程邏輯器件FPGA和硬件描述語言VHDL的32位ALU的設(shè)計方法。該ALU采取層次化設(shè)計方法，由控制模塊、邏輯模塊、加減法模塊、乘法模塊和除法模塊組成，能實現(xiàn)32位有符號數(shù)和無符號數(shù)的加減乘除運算，另外還能實現(xiàn)9種邏輯運算、6種移位運算以及高低字節(jié)內(nèi)容互換。該ALU在QuartuslI軟件環(huán)境下進行了功能仿真，通過驗證表明，所設(shè)計的ALU完全正確，可供直接調(diào)用。
關(guān)鍵字： FPGA ALU 軟核

基于FPGA控制的數(shù)字化語音存儲與回放系統(tǒng)

摘要：數(shù)字化語音存儲與回放系統(tǒng)的作用是對語音進行錄音和放音，并實現(xiàn)數(shù)字化控制。能夠做到語音回放的方法有很多，本課題研究的是基于FPGA控制下的語音存儲與回放系統(tǒng)。
關(guān)鍵詞：語音錄放；數(shù)模轉(zhuǎn)換；模數(shù)轉(zhuǎn)換；FP
關(guān)鍵字： FPGA 數(shù)字化回放系統(tǒng) 語音存儲

FPGA基礎(chǔ)入門（二）

很多兄弟對于CPLD下JTAG的下載很熟悉了,可轉(zhuǎn)到FPGA來的時候,多多少少有些迷惑,怎么出現(xiàn)配置芯片了,為什么...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

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xilinx fpga介紹

　　Xilinx FPGA 　　Xilinx FPGA主要分為兩大類，一種側(cè)重低成本應(yīng)用，容量中等，性能可以滿足一般的邏輯設(shè)計要求，如Spartan系列；還有一種側(cè)重于高性能應(yīng)用，容量大，性能能滿足各類高端應(yīng)用，如Virtex系列，用戶可以根據(jù)自己實際應(yīng)用要求進行選擇。在性能可以滿足的情況下，優(yōu)先選擇低成本器件。　　Xilinx FPGA可編程邏輯解決方案縮短了電子設(shè)備制造商開發(fā)產(chǎn)品的時間 [ 查看詳細 ]

xilinx fpga電路

利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設(shè)計的方法
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基于FPGA+DSP遠程監(jiān)控器設(shè)計與實現(xiàn)
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xilinx fpga資料下載

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