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          次要部分決定全局

          • 作者:TI電池管理解決方案產(chǎn)品部高級應用工程師UpalSengupta最近,我終于有時間清理扔在我辦公室柜子后角的...
          • 關鍵字: 次要部分  全局  

          基于全局貪心的有向傳感器網(wǎng)絡覆蓋算法

          • 摘要:針對分布式貪心算法(DGreedy)以傳感器節(jié)點的剩余能量為優(yōu)先級,節(jié)點處理順序沒有考慮相鄰節(jié)點間的關系對網(wǎng)絡覆蓋率的影響,從而影響覆蓋率的不足,在此提出了一種新的有向傳感器網(wǎng)絡覆蓋算法?;谌重澬牡脑?/li>
          • 關鍵字: 覆蓋  算法  網(wǎng)絡  傳感器  全局  貪心  基于  

          FPGA全局復位及局部復位設計

          • 隨著FPGA設計越來越復雜,芯片內(nèi)部的時鐘域也越來越多,使全局復位已不能夠適應FPGA設計的需求,更多的設計趨向于使用局部的復位。本節(jié)將會從FPGA內(nèi)部復位“樹”的結(jié)構(gòu)來分析復位的結(jié)構(gòu)。我們的復位線將會
          • 關鍵字: FPGA  全局    

          全局快門像素技術和CMOS圖像傳感器形成強大的技術組合

          • 傳統(tǒng)上,全局快門像素技術主要用于CCD圖像傳感器。由于CMOS圖像傳感器的不斷普及,且由于機器視覺、電影制作、工業(yè)、汽車和掃描應用要求必須以高圖像品質(zhì)捕捉快速移動的物體,圖像傳感器供應商Aptina公司已經(jīng)致力于克
          • 關鍵字: 技術  形成  強大  組合  傳感器  CMOS  快門  像素  全局  圖像  

          FPGA全局時鐘資源相關Xilinx器件原語及使用

          • FPGA全局時鐘資源相關Xilinx器件原語及使用,FPGA全局時鐘資源一般使用全銅層工藝實現(xiàn),并設計了專用時鐘緩沖與驅(qū)動結(jié)構(gòu),從而使全局時鐘到達芯片內(nèi)部的所有可配置單元(CLB)、I/O單元(IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應復雜設
          • 關鍵字: Xilinx  器件  使用  相關  資源  全局  時鐘  FPGA  

          利用全局及外部變量實現(xiàn)C51無能數(shù)化調(diào)用A51函數(shù)

          • 闡述了ASM51無參數(shù)化調(diào)用C51 函數(shù)的實現(xiàn)原理并給出實例來驗證該方法的優(yōu)越性和可行性。作者在文章中表明這樣一種觀點:“利用匯編語言對I/O接口、中斷向量及程序空間分配的巨大優(yōu)勢,讓程序員對MCS51內(nèi)的每一字
          • 關鍵字: 無能  調(diào)用  A51  函數(shù)  C51  實現(xiàn)  全局  外部  變量  利用  

          擁有全局網(wǎng)絡智能 邊緣交換機智能與性能

          • 如果網(wǎng)絡的邊緣設備將QoS、速率限制、ACL、PBR及sFlow集成到硬件芯片上,使得這些智能不致影響到基本二層、三層的線速轉(zhuǎn)發(fā)性能,那么端到端的智能網(wǎng)絡才得以大規(guī)模開展,從而使得整個網(wǎng)絡不僅擁有全局的連接能力,也
          • 關鍵字: 全局  交換機  網(wǎng)絡  性能    

          基于LabVIEW仿真的全局最短路徑的遺傳算法設計

          • 為了利用遺傳算法解決全局最短路徑問題,提出了一種基于矩陣判斷的編碼方法。隨機產(chǎn)生種群個體,每個種群個體都可以直觀反映一種連線的方法。定義一個判斷矩陣,每次使用種群個體前用判斷矩陣進行合法性判斷。為了適應這種編碼方法,提出了新的遺傳策略。利用LabVIEW進行仿真。仿真結(jié)果表明LabVIEW獨有的數(shù)組運算規(guī)則可以方便有效的實現(xiàn)這種遺傳算法。相比較一般的編碼方法,該編碼方法更簡單、實用,不需要解碼過程,更高效,適用于無線模塊組網(wǎng)、灌溉網(wǎng)絡管道連接、配電網(wǎng)設置等多類工程設計。
          • 關鍵字: LabVIEW  仿真  全局  最短路徑    

          FPGA全局時鐘資源相關原語及使用

          • FPGA全局時鐘資源相關原語及使用, FPGA全局時鐘資源一般使用全銅層工藝實現(xiàn),并設計了專用時鐘緩沖與驅(qū)動結(jié)構(gòu),從而使全局時鐘到達芯片內(nèi)部的所有可配置單元(CLB)、I/O單元(IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應復雜
          • 關鍵字: 相關  使用  資源  時鐘  全局  FPGA  
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